• 제목/요약/키워드: VDL and so on

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지능형 해양교통 안전망 구축을 위한 조사 (The study for Installation an intelligent AtoN AIS)

  • 최영종
    • 한국항해항만학회:학술대회논문집
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    • 한국항해항만학회 2009년도 공동학술대회
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    • pp.535-537
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    • 2009
  • 대형원료 운반선(원유선, 광탄선 등)의 해양오염사고를 줄이기 위하여 주요항로 및 통항로 상의 천수구역, 긴급 위험물 및 위험지역에 기존 AIS Base Station을 활용한 가상항로표지(Virtual AtoN AIS)를 설치하여 일반선박(소형)의 통항에는 장애물로 작용하지 않고 대형선의 AIS, ECDIS 및 레이더상에 위험요소임을 알려준다.

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AIS 통신부하 관리를 위한 실시간 메시지 분석에 관한 연구 (A Study on Real-time Message Analysis for AIS VDL Load Management)

  • 이상재;정중식;김민엽;박계각
    • 한국지능시스템학회논문지
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    • 제23권3호
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    • pp.256-261
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    • 2013
  • AIS(Automatic Identification System)는 지난 10년간 해상에서 선박의 안전운항을 위해 광범위하게 사용되어 왔다. 이에 따라 AIS에서 사용하는 VHF 대역의 데이터 링크에서 통신량도 꾸준하게 증가하고 있다. AIS 디이터 트래픽의 증가는 AIS 서비스 통신품질의 저하를 야기할 수 있다. 국내 주요항만에서 AIS 통신량의 현황분석을 통하여 통신증가의 문제점을 지적한 바는 있지만 이에 대한 대책을 제시한 연구결과는 없다. 본 연구에서는 해상에서 AIS 기지국 장치에서 제공하는 메시지를 이용하여 AIS 기지국의 통신슬롯의 점유율을 분석하는 분석방법과 그 분석정보를 이용한 AIS 기지국의 자동 제어방안을 제시하고자 한다.

버니어 지연단을 이용한 26ps, 8비트 게이티드 링 오실레이터 시간-디지털 변환기의 설계 (Design of a 26ps, 8bit Gated-Ring Oscillator Time-to-Digital Converter using Vernier Delay Line)

  • 진현배;박형민;김태호;강진구
    • 대한전자공학회논문지SD
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    • 제48권2호
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    • pp.7-13
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    • 2011
  • 본 논문에서는 디지털 위상고정루프(All-digital PLL)를 구성하는 핵심 블록인 시간-디지털 변환기(Time-to-Digital Converter)를 제안하고 구현하였다. 본 연구에서는 게이티드 링 오실레이터 시간-디지털 변환기(GRO-TDC)의 기본 구조에 버니어 지연단(VDL)을 이용하여 다중 위상을 얻음으로써 보다 높은 해상도를 얻을 수 있는 구조를 제안하였다. 게이티드 링 오실레이터(GRO)는 총 7개의 지연셀을 사용하였고, 버니어 지연단(VDL) 3단을 이용하여 총 21개의 다중 위상을 사용하여 시간-디지털 변환기(TDC)를 설계하였다. 제안한 회로는 $0.13{\mu}m$ 1P-6M CMOS 공정을 사용하여 설계 및 구현하였다. 측정결과, 제안한 시간-디지털 변환기(TDC)의 최대 입력 주파수는 100MHz이고, 해상도는 26ps로 측정되었으며, 출력은 8-비트이며, 검출이 가능한 최대 위상 차이는 5ns의 위상 차이까지 검출이 가능하였다. 전력 소비는 측정된 Enable 신호의 크기에 따라 최소 8.4mW에서 최대 12.7mW로 측정되었다.