디스플레이 시장이 rigid에서 flexible로 변화하기 시작하면서 유연 투명전극 소재에 대한 수요가 증가하고 있다. 투명전극으로 대표되는 Indium Tin Oxide(ITO)는 고투과 저저항의 장점을 가지지만 유연성이 떨어져 이를 대체 할 투명전극 소재로 Metal mesh, Ag nano-wire, CNT, Graphene, Conductive polymer 등에 대한 응용 연구가 활발히 진행되고 있다. 본 연구에서는 Metal mesh 용 Cu thin film 형성을 위해 플라즈마 표면처리 기술로 플라스틱 기판과 Cu 박막 사이의 밀착력을 향상시키고자 공정 연구를 수행하였다. 고품질의 Cu thin film 제작을 위해 양산용 roll to roll 장비를 이용하였고, 선형이온소스를 적용하여 플라즈마 표면처리를 수행하였다. 이후 마그네트론 스퍼터링을 통해 Ni buffer layer 및 Cu 박막 증착 공정을 in-situ로 진행하였다. 이러한 공정을 통해 제작한 Cu thin film의 밀착력을 평가하기 위해 cross cut test(ASTM D3359)를 수행하였다. 그 결과 플라스틱 기판과 Cu 금속 박막 사이의 밀착력이 0B에서 5B까지 향상된 것을 확인하였고, 플라즈마 표면처리 공정을 통해서 저항 또한 감소되는 결과를 얻을 수 있었다. 본 연구를 통해 polyethylene terephthalate(PET)뿐만 아니라 polyimide(PI) 기판 상에서도 플라즈마 표면처리를 통해 금속 박막의 밀착력이 향상되는 결과를 확인하였으며, flexible copper clad laminate (FCCL) 같은 유연 정보 소자 분야에 응용 가능할 것으로 기대된다.
The effect of different thermal treatments on the sub-50 nm copper nanoparticles is examined in the aspects of chemical, electrical and surface morphology. The copper nanoparticles are chemically synthesized and fabricated for paste-type solution. Simple bar coating method is practiced as a deposition process to form copper thin film on a typical slide glass. Deposited copper thin films are annealed by two different routes: general tube furnace with 99.99 % Ar atmosphere and selective laser sintering process. The thermal behavior of the different thermal-treated copper thin films is compared by SEM, XRD, FT-IR and XPS analysis. In this study, the laser sintering process ensures low annealing temperature, fast working speed and ambient-accessible route. Moreover, the laser-sintered copper thin film shows good electrical property and enhanced chemical stability than conventional thermal annealing process. Consequently, the proposed laser sintering process can be compatible with plastic substrate for flexible applications.
We have investigated the fabrication and properties of bendable PZT film formed on plastic substrates for the application in flexible memory. These devices used the PZT active layer formed on $SiO_2/Si$ wafer by sol-gel method with optimized device layouts and Pt electrodes. After etching Pt/PZT/Pt layers, patterned by photolithography process. these layers were transferred on PET plastic substrate using elastomeric stamp. The level of performance that can be achieved approaches that of traditional PZT. devices on rigid bulk wafers.
본 논문에서는 RF 마그네트론 스퍼터링법으로 비정질 실리콘을 증착하여 진공분위기에서 엑시머 레이저 어닐링을 이용하여 플라스틱 기판위에 극저온 다결정 실리콘 박막(<$150^{\circ}C$)을 형성하였다. 비정질 실리콘 박막은 $120^{\circ}C$에서 Ar/He 혼합가스로 증착하였으며, Rutherford Backscattering Spectrometry로 측정한 박막내 아르곤 함량은 2% 이하였다. 에너지 밀도 320mJ/$\textrm{cm}^2$일 때 다결정 실리콘의 결정화도는 62%, Root-Mean-Square roughness는 267$\AA$를 나타내었다. 엑시머 레이저 결정화 후 결정립의 크기는 50nm에서 100nm 정도를 나타내었다.
A simple method to measure the elastic modulus E and Poisson's ratio v of diamod-like carbon (DLC) films deposited on Si wafer was suggested. Using the anisotropic etching technique of Si we could make the edge of DLC overhang free from constraint of Si substrate. DLC film is chemically so inert that we could not on-serve any surface damage after the etching process. The edge of DLC overhang free from constraint of Si substrate exhibited periodic sinusoidal shape. By measuring the amplitude and the wavelength of the sinu-soidal edge we could determine the stain of the film required to adhere to the substrate. Since the residual stress of film can be determine independently by measurement of the curvature of film-substrate com-posite we could calculated the biaxial elastic modulus E/(1-v) using stress-strain relation of thin films. By comparing the biaxial elastic modulus with the plane-strain modulus E/(1-{{{{ { v}^{2 } }}) measured by nano-in-dentation we could further determine the elastic modulus and Poisson's ratio independently. This method was employed to measure the mechanical properties of DLC films deposited by {{{{ { {C }_{6 }H }_{6 } }} rf glow discharge. The was elastic modulus E increased from 94 to 169 GPa as the {{{{ { V}_{ b} / SQRT { P} }} increased from 127 to 221 V/{{{{ {mTorr }^{1/2 } }} Poisson's ratio was estimated to be abou 0.16∼0.22 in this {{{{ { V}_{ b} / SQRT { P} }} range. For the {{{{ { V}_{ b} / SQRT { P} }} less than 127V/{{{{ {mTorr }^{1/2 } }} where the plastic deformation can occur by the substrate etching process however the present method could not be applied.
The plasma damage free and room temperature processedthin film deposition technology is essential for realization of various next generation organic microelectronic devices such as flexible AMOLED display, flexible OLED lighting, and organic photovoltaic cells because characteristics of fragile organic materials in the plasma process and low glass transition temperatures (Tg) of polymer substrate. In case of directly deposition of metal oxide thin films (including transparent conductive oxide (TCO) and amorphous oxide semiconductor (AOS)) on the organic layers, plasma damages against to the organic materials is fatal. This damage is believed to be originated mainly from high energy energetic particles during the sputtering process such as negative oxygen ions, reflected neutrals by reflection of plasma background gas at the target surface, sputtered atoms, bulk plasma ions, and secondary electrons. To solve this problem, we developed the NBAS (Neutral Beam Assisted Sputtering) process as a plasma damage free and room temperature processed sputtering technology. As a result, electro-optical properties of NBAS processed ITO thin film showed resistivity of $4.0{\times}10^{-4}{\Omega}{\cdot}m$ and high transmittance (>90% at 550 nm) with nano- crystalline structure at room temperature process. Furthermore, in the experiment result of directly deposition of TCO top anode on the inverted structure OLED cell, it is verified that NBAS TCO deposition process does not damages to the underlying organic layers. In case of deposition of transparent conductive oxide (TCO) thin film on the plastic polymer substrate, the room temperature processed sputtering coating of high quality TCO thin film is required. During the sputtering process with higher density plasma, the energetic particles contribute self supplying of activation & crystallization energy without any additional heating and post-annealing and forminga high quality TCO thin film. However, negative oxygen ions which generated from sputteringtarget surface by electron attachment are accelerated to high energy by induced cathode self-bias. Thus the high energy negative oxygen ions can lead to critical physical bombardment damages to forming oxide thin film and this effect does not recover in room temperature process without post thermal annealing. To salve the inherent limitation of plasma sputtering, we have been developed the Magnetic Field Shielded Sputtering (MFSS) process as the high quality oxide thin film deposition process at room temperature. The MFSS process is effectively eliminate or suppress the negative oxygen ions bombardment damage by the plasma limiter which composed permanent magnet array. As a result, electro-optical properties of MFSS processed ITO thin film (resistivity $3.9{\times}10^{-4}{\Omega}{\cdot}cm$, transmittance 95% at 550 nm) have approachedthose of a high temperature DC magnetron sputtering (DMS) ITO thin film were. Also, AOS (a-IGZO) TFTs fabricated by MFSS process without higher temperature post annealing showed very comparable electrical performance with those by DMS process with $400^{\circ}C$ post annealing. They are important to note that the bombardment of a negative oxygen ion which is accelerated by dc self-bias during rf sputtering could degrade the electrical performance of ITO electrodes and a-IGZO TFTs. Finally, we found that reduction of damage from the high energy negative oxygen ions bombardment drives improvement of crystalline structure in the ITO thin film and suppression of the sub-gab states in a-IGZO semiconductor thin film. For realization of organic flexible electronic devices based on plastic substrates, gas barrier coatings are required to prevent the permeation of water and oxygen because organic materials are highly susceptible to water and oxygen. In particular, high efficiency flexible AMOLEDs needs an extremely low water vapor transition rate (WVTR) of $1{\times}10^{-6}gm^{-2}day^{-1}$. The key factor in high quality inorganic gas barrier formation for achieving the very low WVTR required (under ${\sim}10^{-6}gm^{-2}day^{-1}$) is the suppression of nano-sized defect sites and gas diffusion pathways among the grain boundaries. For formation of high quality single inorganic gas barrier layer, we developed high density nano-structured Al2O3 single gas barrier layer usinga NBAS process. The NBAS process can continuously change crystalline structures from an amorphous phase to a nano- crystalline phase with various grain sizes in a single inorganic thin film. As a result, the water vapor transmission rates (WVTR) of the NBAS processed $Al_2O_3$ gas barrier film have improved order of magnitude compared with that of conventional $Al_2O_3$ layers made by the RF magnetron sputteringprocess under the same sputtering conditions; the WVTR of the NBAS processed $Al_2O_3$ gas barrier film was about $5{\times}10^{-6}g/m^2/day$ by just single layer.
The stress-strain behavior and its effects on the crack initiation and growth of ITO film on PET substrate with a sheet resistance of 45 ohms/sq were investigated. Electrical resistance increased gradually at the strain of 0.7% in the elastic to plastic transition region of the stress strain curves. Numerous cracks were observed after 1% strain and the increase of the resistance can be linked to the cracking of ITO thin films. The onset strain for the increase of resistance increased with increasing strain rate, suggesting the crack initiation is dependent on the strain rate. Upon loading, the initial cracks perpendicular to the tensile axis were observed and propagated the whole sample width with increasing strain. The spacing between horizontal cracks is thought to be determined by the fracture strength and the interfacial strength between ITO and PET. The crack density increased with increasing strain. The spacing between horizontal cracks (perpendicular to the stress axis) increased with decreasing strain rate, The increase of crack density with decreasing strain rate can be attributed to the higher fraction of the plastic strain to the total strain at a given total strain. As the strain increased over 5% strain, cracks parallel to the stress axis were developed and increased in number with strain, accompanied by drastic increases of resistance.
본 연구는 자동차, 건축, 디스플레이 부품 접합 등에 사용되는 다층구조형 양면 점착테이프에 대한 것으로 UV 경화에 의해 제조된 아크릴폼 기재에 용제 건조형 점착제(AD)를 양면에 붙이고 피착제 종류에 따른 박리강도와 전단접착강도를 고찰하였다. AD 종류와 기재 조성에 따른 접착력 변화 및 피착재로 사용한 플라스틱에 대한 접착력을 고찰한 결과, AD의 분자량(MW)이 증가할수록 박리강도 및 전단접착강도가 증가하였으나 약 65만 이상의 MW를 가진 AD는 접착력이 감소하는 거동을 보였다. 양면 점착테이프에 사용된 AD층 두께가 얇을수록 온도감소와 함께 높은 물성 값을 보였다. 기재와 AD와의 계면접합 특성은 MW 615000(AD-4)을 사용한 것이 가장 우수하였으며, MW가 615000보다 낮으면 기재인 아크릴 폼과의 계면이 분리되는 결과를 보였다. 따라서 본 연구에서 검토한 다층구조형 양면 점착테이프는 표면에너지가 낮은 플라스틱 부품 및 곡면 부위에 적용가능한 산업분야에 유용하게 사용될 수 있을 것으로 판단된다.
본 논문에서는 플라스틱 기판에 OTFT를 스위칭 소자로 사용하여 유연한 EPD 패널을 제작하였다. OTFT의 채널 폭과 길이의 비(W/L)는 EPD의 응답속도를 고려하여 15이상으로 설계를 하였다. 게이트전극은 Al, 절연층은 cross-linked PVP, 반도체층은 펜타센, 중간층은 PVA/Acryl를 사용하였다. 플라스틱 기판은 보호층 처리를 통하여 열처리 공정 시 발생하는 입자를 제거하였고, 거친 표면을 평탄화하였다. 반도체층의 크기는 게이트 전극 보다 작도록 제한하여 누설전류를 줄일 수 있었다. EPD-상판과 OTFT-하판 사이에 픽셀전극을 삽입하고 또한 OTFT-하판을 보호하기 위하여 PVA/Acryl로 구성된 중간층을 상빙하였다. 완성된 OTFT-하판에서 OTFT의 이동도는 $0.21cm^2/V.s$, 전류점멸비(Ion/Ioff)는 $10^5$ 이상의 성능을 보였다.
We present a novel process for the ultra low temperature (<150$^{\circ}C$) polycrystalline silicon (ULTPS) TFT for the flexible display applications on the plastic substrate. The sequential lateral solidification (SLS) was used for the crystallization of the amorphous silicon film deposited by rf magnetron sputtering, resulting in high mobility polycrystalline silicon (poly-Si) film. The gate dielectric was composed of thin $SiO_2$ formed by plasma oxidation and $Al_2O_3$ deposited by plasma enhanced atomic layer deposition. The breakdown field of gate dielectric on poly-Si film showed above 6.3 MV/cm. Laser activation reduced the source/drain resistance below 200 ${\Omega}$/ㅁ for n layer and 400 ${\Omega}$/ㅁ for p layer. The fabricated ULTPS TFT shows excellent performance with mobilities of 114 $cm^2$/Vs (nMOS) and 42 $cm^2$/Vs (pMOS), on/off current ratios of 4.20${\times}10^6$ (nMOS) and 5.7${\times}10^5$ (PMOS).
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[게시일 2004년 10월 1일]
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