• 대한전기학회:학술대회논문집
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• 대한전기학회 2002년도 추계학술대회 논문집 전기기기 및 에너지변환시스템부문
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• pp.197-199
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• 2002

The invention of VHDL(Very High Speed Integrated Circuit Hardware Description Language), Technical language of Hardware, is a kind of turning point in digital circuit designing, which is being more and more complicated and integrated. Because of its excellency in expression ability of hardware, VHDL is not only used in designing Hardware but also in simulation for verification, and in exchange and conservation, composition of the data of designs, and in many other ways. Especially, It is very important that VHDL is a Technical language of Hardware standardized by IEEE, intenational body with an authority. The biggest problem in modern circuit designing can be pointed out in two way. One is a problem how to process the rapidly being complicated circuit complexity. The other is minimizing the period of designing and manufacturing to survive in a cutthroat competition. To promote the use of VHDL, more than a simple use of simulation by VHDL, it is requested to use VHDL in composing logical circuit with chip manufacturing. And, by developing the quality of designing technique, it can contribute for development in domestic industry related to ASIC designing. In this paper in designing SMPS(Switching mode power supply), programming PWM by VHDL, it can print static voltage by the variable load, connect computer to chip with byteblaster, and download in Max(EPM7064SLCS4 - 5)chip of ALTER. To achieve this, it is supposed to use VHDL in modeling, simulating, compositing logic and product of the FPGA chip. Despite its limit in size and operating speed caused by the specific property of FPGA chip, it can be said that this method should be introduced more aggressively because of its prompt realization after designing.

• 한국콘텐츠학회논문지
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• 제8권5호
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• pp.52-60
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• 2008

위성 통신 분야에서 널리 사용되는 시분할 다중 스위칭 시스템은 많은 저대역폭 가입자들로부터 발생되는 트랙픽을 반복되는 프레임에 타임 슬롯을 할당해야 한다. 본 논문에서는 타임 슬롯 할당을 위한 새로운 방법을 제안한다. 기존의 방법인 네트워크 흐름 모델을 사용하지 않고 새로운 방법인 그래프 채색방법을 사용하여 효율적인 타임 슬롯 할당 알고리즘을 제안하였다. 제안된 알고리즘은 주어진 트래픽의 프레임 길이가 2의 멱승일 경우 트래픽을 정확히 반으로 나누어 할당한다. 분할된 트래픽의 프레임 길이가 1이 될 때까지 이 과정을 계속적으로 반복해 분할한다. 제안된 알고리즘의 시간 복잡도는 프레임의 길이가 L이고 스위치 크기가 N인 경우에는 기존의 네트워크 흐름 모델을 사용한 최적의 타임 슬롯 할당 알고리즘의 시간 복잡도는 $O(N^{4.5})$ 인데 반해 $O(NLlog_2L)$이다.

• 한국진공학회:학술대회논문집
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• 한국진공학회 2012년도 제42회 동계 정기 학술대회 초록집
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• pp.154-154
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• 2012

Flexible complementary inverters based on thin-film transistors (TFTs) are important because they have low power consumption and high voltage gain compared to single type circuits. We have manufactured flexible complementary inverters using pentacene and amorphous indium gallium zinc oxide (IGZO) for the p-channel and n-channel, respectively. The circuits were fabricated on polyimide (PI) substrate. Firstly, a thin poly-4-vinyl phenol (PVP) layer was spin coated on PI substrate to make a smooth surface with rms surface roughness of 0.3 nm, which was required to grow high quality IGZO layers. Then, Ni gate electrode was deposited on the PVP layer by e-beam evaporator. 400-nm-thick PVP and 20-nm-thick ALD Al2O3 dielectric was deposited in sequence as a double gate dielectric layer for high flexibility and low leakage current. Then, IGZO and pentacene semiconductor layers were deposited by rf sputter and thermal evaporator, respectively, using shadow masks. Finally, Al and Au source/drain electrodes of 70 nm were respectively deposited on each semiconductor layer using shadow masks by thermal evaporator. The characteristics of TFTs and inverters were evaluated at different bending radii. The applied strain led to change in voltage transfer characteristics of complementary inverters as well as source-drain saturation current, field effect mobility and threshold voltage of TFTs. The switching threshold voltage of fabricated inverters was decreased with increasing bending radius, which is related to change in parameters of TFTs. Throughout the bending experiments, relationship between circuit performance and TFT characteristics under mechanical deformation could be elucidated.

• 한국산학기술학회논문지
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• 제14권10호
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• pp.5105-5114
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• 2013

본 논문은 심해저 환경을 고려한 케이블 및 필터 설계에 관한 연구를 수행하였다. 심해저 플랜트에서 사용하고 있는 전기 아키텍처는 해상에서 고전압의 전원 공급 장치, 고용량 구동시스템, 장거리 케이블과 전동기로 구성되어있다. 전도 노이즈는 전동기 구동용 인버터의 고속 스위칭 시 발생하는 급속한 전압변화로 인해 발생하며, 케이블의 길이가 길어질수록 전동기에 심각한 과도 전압을 발생시킨다. 따라서 심해저 플랜트에 사용되는 장거리 케이블의 R, L, 선간 C, 선-접지 C를 고려한 선로를 설계하여 구동 전동기에 발생하는 과전압을 확인하였다. 또한, PWM 인버터 구동시스템의 전도 노이즈 저감을 위한 필터를 설계하여 심해저 플랜트 모델의 가이드라인을 제안하고자 한다.

• 한국통신학회논문지
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• 제32권7C호
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• pp.652-657
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• 2007

광 부반송파 다중화 방식을 사용하는 광 레이블 교환망에서, 광섬유 마하-젠더 간섭계로 구성된 인터리버를 사용하여 광 레이블 신호를 검출하였다. 이중 전극 마하-젠더 광 변조기로부터 발생된 10-GHz 광 단측파대신호 또는 양측파대 신호를 광 부반송파 레이블로 사용하여 검출 실험을 수행하였다. 인터리버의 레이블 추출 출력에서 광 스펙트럼을 측정한 결과, 단측파대 신호의 경우에 상측파대가 하측파대보다 약 16.8 dB 정도 억압되는 것을 확인하였다. 양측파대 입력 신호의 경우에는 인터리버의 레이블 추출 출력에 양측파대가 모두 같은 파워 레벨을 갖고 나타났으며, 손실은 거의 발생하지 않았다. 위상 천이 방법으로 단측파대 신호를 발생하였기 때문에, 단측파대 출력 신호 레벨이 양측파대 신호 보다 약 3 dB 정도 높게 나타났다.

• 조명전기설비학회논문지
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• 제19권2호
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• pp.42-48
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• 2005

DC-DC 컨버터는 각종 산업용, 가정용 기기에 널리 이용되어지고 있다. 다양한 전장품을 내장한 자동차에서는 전압이 다른 전장품을 한 개의 밧데리에서 DC-DC 컨버터를 이용해서 전압을 변환해서 이용되고 있다. 그러므로 이와 같은 구성의 전원회로에는 각각의 전장품에 대응하기 위해 복수의 변환기를 필요로 하지만 회로가 복잡하고 코스트가 상승하는 원인이 된다. 본 논문에서는 이러한 배경으로 하나의 전원을 이용한 간단한 구성의 새로운 승$\cdot$강압 초퍼 회로를 제안하여 서로 다른 복수의 출력 전압을 얻었다. 제안한 초퍼 회로는 기존의 회로에 승압용 스위치를 추가하여 구성하였으며, 이를 이용하여 부하를 분할화 시켰다 그리고 제안한 회로는 승압용 스위치와 강압용 스위치의 듀티비를 각각 별도로 조절하여 넓은 범위에서 서로 다른 2개의 출력전압을 정확히 제어하였다. 이러한 모든 사항은 시뮬레이션과 실험을 통하여 그 타당성을 증명하였다.

• 대한전기학회논문지:전기물성ㆍ응용부문C
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• 제54권6호
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• pp.255-261
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• 2005

Recently, the RF inductive discharge or inductively coupled plasma continues to attract growing attention as an effective plasma source in many industrial applications, the best known of which are plasma processing and lighting technology. To the point of lighting sources, the ring-shaped electrodeless fluorescent lamps utilizing an inductively coupled plasma have been objects of interest and research during the last decades, mainly because of their potential for extremely long life, high lamp efficacies, rapid power switching response. In this paper, maxwell 3D finite element analysis program (Ansoft) was used to obtain electromagnetic properties associated with the coil and nearby structures. The electromagnetic emitting properties were presented by 3D simulation software operated at 250 kHz and some specific conditions. The electromagnetic field in the ferrite core was shown to be high and symmetric. An LS-100 luminance meter and a Darsa-2000 spectrum analyzer were used in the experiment. According to data on the lamp tested using high magnetic field ferrite, the optical and thermal wave fields were shown to be high around the ring-shaped electrodeless fluorescent lamp. The optical or light field was high at the center of the bulb rather than around the ferrite core. The light conditions of the bulb were assumed to be complex, depending on the condition of the filler gas, the volume of the bulb, and the frequency of the inverter. Our results have shown coupling between the gas plasma and the field of the light emitted to be nonlinear.

• 문화기술의 융합
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• 제6권2호
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• pp.515-520
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• 2020

디지털 회로설계 기술에서 사용되는 CMOS는 양자 터널링 현상 등으로 인해 집적도의 한계에 다다르고 있다. 이를 대체할 수 있는 양자점 셀룰러 오토마타(QCA : Quantum-dot Cellular Automata)는 적은 전력 소모와 빠른 스위칭 속도 등으로 많은 장점이 있음으로 CMOS의 많은 디지털 회로들이 QCA 기반으로 제안되었다. 그중에서도 멀티플렉서는 D-플립플롭, 레지스터 등 다양한 회로에 쓰이는 기본 회로로써 많은 연구가 되고 있다. 하지만 기존의 멀티플렉서는 공간 효율성이 좋지 않다는 단점이 있다. 따라서, 본 논문에서는 셀 간 상호작용을 이용하여 새로운 다층구조 멀티플렉서를 제안하고, 이를 이용하여 D-래치를 제안한다. 본 논문에서 제안하는 멀티플렉서와 D-래치는 면적, 셀 개수, 지연시간이 개선되었으며, 이를 이용하여 큰 회로를 설계할 시 연결성과 확장성이 우수하다. 제안된 모든 구조는 QCADesigner를 이용해 시뮬레이션하여 동작을 검증한다.

• 한국인터넷방송통신학회논문지
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• 제16권2호
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• pp.151-155
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• 2016

우리는 이 논문에서 ADPCM (adaptive differential pulse code modulation)을 적용함으로써 디밍 콘트롤러를 갖는 LED 드라이버의 설계를 제시한다. ADPCM 장비는 고해상도를 가지고 LED 전류를 정확하게 제어하며, 고조파 전류 펄스의 퍼짐으로 인하여 초래되는 RFI 를 감소시켜 준다. 또한 제어 동작의 정밀도를 높여준다. 이 연구에서 LED에 펄스 전류를 인가함으로써 고효율 에너지의 LED를 제어하는 디지털 제어회로의 설계를 제시한다. 우리가 설계한 LED 전류구동시스템은 디지털 제어 부와 아날로그 SMPS (스위치 모드 파워 서플라이)를 별도로 구현한 두개의 시스템이다. 입력레벨이 0.7 인 경우의 시뮬레이션 결과는 시그마 델타 변조를 하여 얻은 D/A 컨버터의 출력을 나타내었다. 개수가 510 개인 펄스신호의 경우 0.15 % 의 정밀도를 얻을 수 있었다.

• 대한전자공학회논문지SD
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• 제41권10호
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• pp.69-75
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• 2004

본 논문에서는 온도 및 전원전압에 덜 민감한 기준전압을 위해 온-칩 필터를 사용하는 8b 220 MS/s 230 rnW 3단 파이프라인 CMOS A/D 변환기 (ADC) 회로를 제안한다. 제안하는 RC 저대역 필터는 기존의 큰 값을 가진 칩 외부의 바이패스 캐패시터를 사용하지 않고도 고속 동작 시 발생하는 여러 가지 잡음을 효과적으로 감쇄시키고 큰 R, C 부하에서도 기준전압의 정착시간을 줄인다. 시제품 ADC는 0.25 um CMOS 공정을 이용하여 설계 및 제작되었고, 입/출력단의 패드를 제외한 코어 면적은 2.25 ㎟ 이며 측정된 DNL 및 INL은 각각 -0.35～+0.43, LSB, -0.82～+0.71 LSB 수준을 보여준다. 또한, SNDR은 200 MS/s, 220 MS/s 샘플링 주파수에서 입력 주파수가 수 MHz에서 110 MHz까지 증가할 때 각각 43 dB 및 41 dB로 유지되었고, 입력주파수가 500 MHz 까지 증가할 때는 입력주파수가 110 MHz의 경우에 비해 3 dB 정도만 감소되었다.