본 논문에서는 기존의 설계 방법의 문제점을 해결하기 위한 설계 방법인 플랫폼 기반 설계에서 사용할 수 있는 DSP 기반 플랫폼을 구현하였다. 구현된 DSP 기반 플랫폼을 AMBA AHB 버스를 바탕으로한 듀얼프로세서 플랫폼과 crossbar switch 구조의 버스 구조를 가지고 4개의 프로세서를 연결한 멀티프로세서 플랫폼으로 확장하여 검증함으로서 이질적인 환경에서 동작함을 나타내었다. 멀티프로세서 플랫폼에서는 DVB-T baseband 수신기를 HW/SW 분할 구현하고 성능 평가를 수행하였다. DSP 기반 플랫폼은 유연성, 확장성, 고속의 연산의 특징을 가진다.
본 논문에서는 멀티미디어 SoC 플랫폼의 ASIC 설계에 대해 기술한다. 구현된 플랫폼은 32비트 OpenRISC1200 마이크로프로세서, WISHBONE 온 칩 버스, VGA 제어기, 디버그 인터페이스, SRAM 인터페이스 및 UART로 구성된다. 32 비트 OpenRISC1200 프로세서는 명령어 버스와 데이터 버스가 분리된 하버드 구조와 5단 파이프라인 구조를 가지고 VGA 제어기는 메모리로부터 읽은 이미지 파일에 대한 데이터를 RGB 값으로 CRT 혹은 LCD에 출력한다. 디버그 인터페이스는 플랫폼에 대한 디버깅 기능을 지원하고 SRAM 인터페이스는 18비트 어드레스 버스와 32비트 데이터 버스를 지원한다. UART는 RS232 프로토콜을 지원하는 시리얼 통신 기능을 제공한다. 본 플랫폼은 Xilinx VIRTEX-4 XC4VLX80 FPGA에 설계 및 검증되었다. 테스트 코드는 크로스 컴파일러로 생성되었고 JTAG 유틸리티 소프트웨어와 gdb를 이용하여 패러럴 케이블을 통해 FPGA 보드로 다운로드 하였다. 이 플랫폼은 최종적으로 Chartered 0.18um 공정을 이용하여 단일 ASIC 칩으로 구현 되었으며 100MHz 클록에서 동작함을 확인하였다.
내장형 프로세서에 대한 기능요구사항이 날로 증가함에 따라 데이터 처리량을 늘리기 위한 많은 연구들이 지속되어 왔으며, 그중 파이프라인의 컨트롤 해저드로 인한 성능저하를 최소화하기 위한 분기 예측 기법이 다양한 방식으로 제안되어 왔다. 본 논문에서는 분기예측 방법으로서 구현이 간단하고 분기 예측률이 높은 BTB 방식을 32비트 프로세서에 적용하고, 해당 프로세서를 사용하는 SoC 플랫폼을 구성하여 분기예측기법 사용으로 인한 성능향상을 측정하고, 0.18um ASIC 공정을 적용하여 SoC 플랫폼을 구현한 결과를 제시한다.
본 논문에서는 다양한 분야와 환경에서 필요에 따라 기능을 쉽게 교환하고 조립이 가능한 모듈형 웨어러블 플랫폼을 제안한다. 제안된 플랫폼은 국내 CPU 코어 기반의 모듈형 플랫폼과 다양한 환경에 빠르게 대응하여 자유롭게 연결 가능한 plug & play 플랫폼으로 구성된다. 설계된 SoC는 32-bit RISC CPU, 32-bit symmetric multi-core processor, 그리고 16-bit DSP (CDSP)로 구성되고 여기에 필요에 따라 센서 모듈과 통신 모듈이 체인 형태로 연결된다. SoC 칩은 130nm 공정으로 개발되었고 온도와 습도 센서를 이용하여 제안된 모듈형 웨어러블 플랫폼의 기능의 동작을 검증하였다.
본 논문에서는 멀티미디어 어플리케이션을 위한 BTB(Branch Target Buffer)를 이용한 RISC 프로세서 기반 SoC 플랫폼의 ASIC 설계에 대해 기술한다. 제안된 SoC 플랫폼은 성능 개선을 위해 BTB를 포함하며 분기 명령어 패치 시 분기할 타깃 주소를 BTB에 저장함으로써 예측 주소의 명령어를 미리 패치, 파이프라인의 지연을 최소화하였다. 또한, 다양한 멀티미디어 어플리케이션을 위해 VGA 제어기, AC97 제어기, UART 제어기, SRAM 인터페이스, 디버그 인터페이스를 포함한다. 구현된 플랫폼은 다양한 테스트 프로그램을 사용하여 시뮬레이션을 수행하였으며, Xilinx VIRTEX-4 XC4VLX80 FPGA를 이용해 기능 및 타이밍 검증을 수행하였다. 최종적으로 Chartered 0.18um 공정을 이용하여 단일 ASIC 칩으로 구현되었으며 100MHz에서 정상 동작함을 확인하였고, 이전 OpenRISC 마이크로프로세서를 사용한 플랫폼과의 비교를 위해 산술연산 및 AC97 테스트 프로그램을 이용한 시뮬레이션 결과 5~9%의 성능향상을 확인하였다.
AR/VR 디바이스에서 무손실 이미지 압축을 위한 JPEG-LS(: LosSless) 코덱에서 SBT 기반 프레임 압축기술로 메모리와 지연을 줄이는 설계를 제안하였다. 제안된 JPEG 무손실 코덱은 주로 콘텍스트 모형화 및 업데이트, 픽셀과 오류 예측 그리고 메모리 블록으로 구성된다. 모든 블록은 실시간 영상처리를 위해 파이프라인 구조를 가지며, LOCO-I 압축 알고리즘에 SBT 코딩기반의 개선된 2차원 접근방식을 사용한다. 제시한 STB-FLC기법을 통해 Block-RAM 사이즈를 기존 유사연구보다 1/3로 줄이고 예측(prediction) 블록의 병렬 설계는 처리속도에 향상을 가져올 수 있었다.
임베디드 시스템이 점점 다기능화 고기능화 됨에 따라 구현과정도 복잡해지고 있으며, 빠른 제품 주기등의 영업적인 이유로 개발 기간을 단축하려는 요구는 증대되고 있다. 특히 SoC 분야는 하드웨어와 소프트웨어를 동시에 개발하기 때문에 두 부분이 동시에 정상 동작하는지의 검증이 어렵다. 이러한 문제들을 해결하기 위해, 다양한 시스템에 적용 가능한 플랫폼을 제안하고, 이 플랫폼을 기본 골격으로 사용하는 플랫폼 기반 개발 방법이 등장하게 되었다. 이 방법은 개발 과정에서 플랫폼 모듈을 재사용하기 때문에 안전성을 확보할 수 있고, 많은 자동화를 이룰 수 있어 개발 시간을 단축할 수 있다. 본 논문에서는 이 플랫폼 기반 개발 방법을 프로토타이핑 과정에 적용한 프로토타이핑 미들웨어를 제안한다. 이 미들웨어를 통해, 구현된 하드웨어의 정상 동적 여부를 빠르게 확인할 수 있고, 프로토타이핑 과정을 마치고 최종 소프트웨어를 작성할 때에도 참고가 될 수 있다. 또한 설정 부분은 미들웨어 사용자의 편의를 위해 XML을 이용해 사용자가 직관적으로 알 수 있게 하였고, 사용자 작성 모듈은 미들웨어에서 정해진 인터페이스를 통해 미들웨어의 재 컴파일 없이, 사용자 모듈만 컴파일하면 동작하는 특징을 갖는다. 그리고 이 미들웨어를 도어락 제어 시스템에 적용하여 편의성을 평가한다.
갈수록 복잡해져 가는 시스템을 한번에 하나의 칩까지 완성하기란 쉬운 일이 아니다. 컴퓨터에서 시뮬레이션이 정상적으로 되었다고 해서 완벽한 동작을 보장하는 것도 아니다. 전체 시스템을 검증하는 것도 컴퓨터 시뮬레이션으로는 불가능한 단계에 왔다. 이로 인하여 시스템 전체가 제대로 동작하는지 검증하기 위한 새로운 방법이 요구된다. 이러한 개념으로 접근하고자 하는 것이 본 논문에서 이야기할 플랫폼 기반의 SoC설계이다. 이 논문에서는 임의의 무선통신시스템의 요구사항을 만족할 수 있는 베이스플랫폼 보드의 구조와 설계 시 고려되어야 할 점을 제안한다.
마찰 나노 발전을 활용한 TENG(: Triboelectric nanogenerators)는 작은 진동에서 높은 변환 효율과 지속적인 전력을 얻을 수 있는 장점이 있다. 하지만, 마찰 전기 에너지 수집을 위해서는 비선형 에너지 추출 기술이 요구되며, 연결 인터페이스 회로를 통한 동기화 기반의 능동적인 스위치회로가 요구된다. 본 연구는 사람으로의 움직임으로부터 발생한 비선형(non-linear) 에너지를 효율적으로 저장하는 기법을 제시하였다. 또한, 개발된 보드는 서로 다른 방향으로 움직이는 동작으로부터 발생하는 에너지를 효율적으로 수확하고 저장할 수 있다. 본 연구에서 개발된 실리콘기반 압전기반의 TENG 셀과 다중모듈이 연결 가능한 에너지 하베스팅 보드의 측정하였다. 결과적으로, 다중입력 에너지 수집환경에서 안정적인 에너지의 저장 유지를 통해 약 49.2mW/count를 발전하였다.
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[게시일 2004년 10월 1일]
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