비닐백이 시장을 점령하기 전 어머니 손에 들려있던 알록달록한 장바구니를 기억하는가! 비록 색상과 모양은 평범했지만 환경을 생각하는 면에서는 최고였다. 장바구니가 평범한 역할을 벗어나 요즘 '에코백'이란 이름으로 주부는 물론 학생, 직장인들에게도 사랑 받는 패션아이템이 되었다. 에코디자인의 대표주자이며, 지구를 지킬 수 있는 친환경 소재로 거듭나고 있는 에코백의 무한한 변신을 만나보자.
The dynamic simulation for automobile running on bumpy road is introduced. The modeling method that is a very close approximation to automobile is presented. Because the output printed at every integration time step is lots of amount, to save the time of interpretation of dynamic response, the ouptput data are interactively processed by PLOT88, also a configuration of automobile is generated by animated graphic displays using PADL and APPLICON.
In this study, we described the result of computer simulation which is real time extraction of FECG and FHR using adaptive digital signal processing. And we designed 2 channel cassette interface circuit to save FECG signal.
쿨비즈란 시원하다(cool)와 사업 업무(business)의 합성어로 여름철 넥타이를 매지 않고 재킷을 벗는 등 간편한 옷차림으로 근무하는 것을 뜻한다. 이것은 간편한 옷차림을 입도록 권장하고, 실내온도를 $28^{\circ}C$로 유지하도록 하는 에너지 절약 캠페인의 일환이다. 현재 직장인 88.7%는 직장에서 쿨비즈 캠페인을 시행 중이며 격식 간소화, 더위 스트레스 해소 등의 이유로 만족도도 높은 것으로 나타났다.
This paper discribes the differen-ces between making handset sample and handset massproductions. To save time during mass production, Calibrat-ion should be automated and SW do-wnloading also be automated and Par-allely done. All this processes are des-cribed here. Especially Calibration are more detaily explained in this paper.
A new time-domain decoder for Reed-Solomon (RS) codes is proposed. Because this decoder can correct both errors and erasures without computing the erasure locator, errata locator, or errata evaluator polynomials, the computational complexity can be substantially reduced. Herein, to demonstrate this benefit, complexity comparisons between the proposed decoder and the Truong-Jeng-Hung and Lin-Costello decoders are presented. These comparisons show that the proposed decoder consistently has lower computational requirements when correcting all combinations of ${\nu}$ errors and ${\mu}$ erasures than both of the related decoders under the condition of $2{\nu}+{\mu}{\leq}d_{\min}-1$, where $d_{min}$ denotes the minimum distance of the RS code. Finally, the (255, 223) and (63, 39) RS codes are used as examples for complexity comparisons under the upper bounded condition of min $2{\nu}+{\mu}=d_{\min}-1$. To decode the two RS codes, the new decoder can save about 40% additions and multiplications when min ${\mu}=d_{min}-1$ as compared with the two related decoders. Furthermore, it can also save 50% of the required inverses for min $0{\leq}{\mu}{\leq}d_{\min}-1$.
IEIE Transactions on Smart Processing and Computing
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v.6
no.2
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pp.133-139
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2017
Vehicles have increasingly evolved and become intelligent with convergence of information and communications technologies (ICT). Vehicle communications (VC) has become one of the major necessities for intelligent vehicles. However, VC suffers from serious security problems that hinder its commercialization. Hence, the IEEE 1609 Wireless Access Vehicular Environment (WAVE) protocol defines a security service for VC. This service includes Advanced Encryption Standard-Counter with CBC-MAC (AES-CCM) for data encryption in VC. A high-speed AES-CCM crypto module is necessary, because VC requires a fast communication rate between vehicles. In this study, we propose and implement an efficient AES-CCM hardware architecture for high-speed VC. First, we propose a 32-bit substitution table (S_Box) to reduce the AES module latency. Second, we employ key box register files to save key expansion results. Third, we save the input and processed data to internal register files for secure encryption and to secure data from external attacks. Finally, we design a parallel architecture for both cipher block chaining message authentication code (CBC-MAC) and the counter module in AES-CCM to improve performance. For implementation of the field programmable gate array (FPGA) hardware, we use a Xilinx Virtex-5 FPGA chip. The entire operation of the AES-CCM module is validated by timing simulations in Xilinx ISE at a speed of 166.2 MHz.
Carry-save-adder(CSA) is one of the most effective operation cells in implementing an arithmetic hardware with high performace and small circuit area. An fundamental drawback of the existing CAS applications is that the applications are limited to the local parts of arithmetic circuit that are directly converted to additions. To resolve the limitation, we propose a set of new CSA transformation techniques: optimizing arithmetics with multiplexors, optimizing arithmetics in multiple designs, and optimizing arithmetics with multiplications. We then design a new CSA transformation algorithm which integrates the proposed techniques, so that we are able to utilize CSAs more globally. An extensive experimentation for practical designs are provided to show the effectiveness of our proposed algorithm over the conventional CSA techniques.
A study about economical blasting methods which can improve fragmentation and save explosive in blasting is in progress. One of the blasting methods is an air decking method making air layers in boreholes. However, it is difficult to apply this method to the boreholes filled with water. In this study, an underwater Air Tube was manufactured and tried to place it at a certain location in a water filled borehole. It was found that the application of underwater air tube in wet boreholes could improve the fragmentation and save 10~15% of the explosives.
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[게시일 2004년 10월 1일]
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