• 전자공학회논문지
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• 제54권8호
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• pp.107-114
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• 2017

본 논문에서는 3상 4선식 전력계통에서 새로운 전압제어 방식의 역률보상시스템을 제안한다. 제안하는 전압제어 방식의 역률보상시스템은 슬라이닥을 이용하여 가변되는 출력전압을 커패시터에 인가하는 것으로 보상에 필요한 무효전력을 생성한다. 기존의 커패시터 뱅크 방법을 이용하는 역률보상시스템은 선택 가능한 커패시터 용량이 한정되어 있어 부하 상황에 따라 역률보상 오차가 발생하지만, 제안 시스템은 변화하는 부하를 추종하여 오차 없이 역률을 100%까지 보상할 수 있다. 본 논문에서는 3상 4선식 전력계통에서 전압제어 방식의 역률보상시스템과 제어 알고리즘을 개발하였고 모의실험과 실험을 통해 성능을 확인한다. 제안 시스템을 수용가에 설치할 경우 역률 개선을 통한 전기료 감소, 선로손실 감소, 부하 용량 증대 효과가 기대된다. 특히 발전 사업가 측에서는 역률 보상 성능의 향상으로 송전 여유 용량 확보와 발전량 절감이 가능하다.

• 한국전자파학회논문지
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• 제15권12호
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• pp.1152-1160
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• 2004

OFDM 기술은 채널의 시간확산에 대처할 수 있는 대역효율이 높은 전송방식으로서 IEEE 802.1 la 표준안으로 채택되어 고속 무선 랜, 유럽 DVB 등에 사용되고 있다. IEEE 802.113의 표준에서의 데이터 패킷은 프리앰블, 데이터 두 가지 부분으로 조성되고 있다. 프리앰블은 short pilots, long pilots로 조성되어 동기화, 주파수 옵셋 및 채널 추정에 사용되고 있다. 우리는 이러한 파일럿을 이용하여 송수신 과정에서 발생하는 위상잡음의 영향을 효과적으로 보상한다. 위상잡음은 주파수 옵셋보다 더 복잡한 현상으로서 시스템 성능에 매우 큰 영향을 준다. 본 연구에서는 위상잡음의 영향에 의해 발생하는 CPE와 ICI성분을 동시에 보상하는 새로운 방법을 제안하고 기존 연구와 비교 분석한다. 분석결과, CPE 제거기법, PNS 알고리즘, 그리고 CPE와 ICI 동시 보상기법을 사용하였을 경우, 위상잡음에 의한 성능 저하를 현저히 개선한다. 또한 제안한 CPE와 ICI 동시 보상기법을 사용한 경우 기존의 방법보다 더 우수한 통신성능을 얻을 수 있다.

• 전자공학회논문지
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• 제52권8호
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• pp.29-39
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• 2015

본 논문은 모바일 광학식 손떨림 보정(OIS) 움직임 검출부의 성능과 안정도를 높이기 위하여 퍼지기반 손떨림 상태 검출 및 오차 보상 알고리즘의 설계 및 구현을 기술한다. OIS 움직임 검출을 위한 자이로 센서 출력에는 소자의 고유 오차가 포함되어 있기 때문에 신속한 손떨림 보정과 안정적인 손떨림 상태 검출을 위해서 정확한 오차 보상이 요구된다. 본 연구에서는 퍼지 알고리즘을 기반으로 낮은 연산량을 통해서 손떨림 주파수에 대한 각도 및 위상 오차를 신속하게 줄여서 보정 성능을 개선하였다. 또한 손떨림 각도 크기에 따라 {정지, 작은 손떨림, 큰 손떨림, 팬/틸트} 등의 손떨림 상태를 적절히 구분해서 시스템의 안정성을 향상시켰다. 모바일 OIS 움직임 검출부를 위해 제안된 알고리즘의 성능 및 안정도를 실제 손떨림과 같은 2~12Hz 주파수 범위의 ${\pm}0.5^{\circ}$, ${\pm}0.8^{\circ}$ 손떨림 진동에 대해서 정량적 및 정성적 실험으로써 평가하였다. 실험결과를 통해서 기존 BACF/DCF 알고리즘과 비교해서 평균 3.71dB의 개선된 성능을 검증하였고, 4가지 손떨림 상태를 안정적으로 검출하는 동작을 확인하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1999년도 하계학술대회 논문집 B
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• pp.976-978
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• 1999

Recently PWM invertor is broadly used for control of induction motor. The invertor is able to generate sin wave current from high speed switching power device such as IGBT. However the invertor is disturbed by dead time inevitably needed to prevent a short of the DC link voltage, and the dead time mainly causes distortions of the output current. In this Paper the dead time compensation method which corrects the voltage error from dead time, and Min Max algorithm enlarging the operating voltage of PWM were Proposed. This method can be implemented by software programming without any additional hardware circuit. The proposed algorithms were implemented by DSP(TMS320C31, 40MHz) and FPGA(QL2007, Quick Logic) described in VHDL. and applied to 3 phase induction motor(2.2 KW) to show the superior performance

• 전기학회논문지
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• 제64권2호
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• pp.342-348
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• 2015

In this paper, fuel cell power generation system that is being studied in recent railway field was applied to compensate for the voltage drop due to the load as driving electric vehicle. PSIM simulation program is to be used to implement the modeling of the electric railway for AC AT feeder system. For it, It was applied to the product-type single-phase PLL algorithm, step-down converter is controlled as power so as to have the fuelcell generation system. Based on it's result, a reactive power due to the catenary impedance in accordance with the current flowing is compensated as linked with fuelcell generation system which supplied the current to the power supply grid. and then its performance was confirmed that voltage compensation effect obtained at SubStation (SS), SubSectioning Post (SSP), Sectioning Post (SP).

• 대한전기학회논문지
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• 제38권7호
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• pp.481-491
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• 1989

A compensation strategy for the phase-difference control method, which has been reported as a new driving method of a 2-phase inverter-fed induction motor, is proposed. The phase-difference control method extends the control range of the speed and eliminates the harmonic contents of the output voltage of the 2-phase inverter-fed induction motor. However, the phase-difference angle becomes narrower, motor efficiency deceases more and pulsating torque increases more. As the counterplan for these shortcomings of the phase-difference control method, a hybrid control method which combines the phase-difference control with the voltage control is proposed. The algorithm to realize a hybrid method is presented. As an example, a model composed of 5 regions has been analyzed by computer simulation in terms of motor performance and the results have been compared with experimental results.

• Journal of Electrical Engineering and Technology
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• 제10권4호
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• pp.1655-1666
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• 2015

This paper proposes a new approach of Field Programmable Gate Array (FPGA) controlled digital implementation of shunt active power filter (SAPF) under steady state and dynamic operations. Typical implementations of SAPF uses microprocessor and digital signal processor (DSP) but it limited for complex algorithm structure, absence of feedback loop delays and their cost can be exceed the benefit they bring. In this paper, the hardware resources of an FPGA are configured and implemented in order to overcome conventional microcontroller or digital signal processor implementations. This proposed FPGA digital implementation scheme has very less execution time and boosts the overall performance of the system. The FPGA controller integrates the entire control algorithm of an SAPF, including synchronous reference frame transformation, phase locked loop, low pass filter and inverter current controller etc. All these required algorithms are implemented with a single all-on chip FPGA module which provides freedom to reconfigure for any other applications. The entire algorithm is coded, processed and simulated using Xilinx 12.1 ISE suite to estimate the advantages of the proposed system. The coded algorithm is also defused on a single all-on-chip Xilinx Spartan 3A DSP-XC3SD1800 laboratory prototype and experimental results thus obtained match with simulated counterparts under the dynamic state and steady state operating conditions.

• 전력전자학회:학술대회논문집
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• 전력전자학회 2001년도 Proceedings ICPE 01 2001 International Conference on Power Electronics
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• pp.586-590
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• 2001

In this paper, a novel control scheme compensating source voltage unbalance and harmonic currents for hybrid active power filters is proposed, where no low/high-pass filters are used in compensation voltage composition. The phase angle and compensation voltages for source harmonic current and unbalanced voltage components are derived from the positive sequence component of the unbalanced voltage set, which is simply obtained by using digital all-pass filters. Since a balanced set of the source voltage obtained by scaling the positive sequence components is used as reference values for source current and load voltage, it is possible to eliminate the necessity of low/high-pass filters in the reference generation. Therefore the control algorithm is much simpler and gives more stable performance than the conventional method. In addition, the source harmonic current is eliminated by compensating for the harmonic voltage of the load side added to feedback control of the fundamental component.

• 한국산학기술학회논문지
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• 제11권12호
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• pp.5036-5041
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• 2010

이 논문은, 델타함수열에 기본을 둔 블라인드 알고리듬을 복소 채널에 적용할 수 있도록 그 복소화 과정을 소개하고 복소 채널의 블라인드 등화에서 채널의 위상왜곡 문제를 해결할 수 있음을 보였다. 또한, 기존의 랜덤 심볼열을 사용한 방식에 비해 가우시안 커널의 폭이 비교적 작은 값을 갖는 것으로 나타나, 출력 신호점을 원하는 심볼점에 끌어오는 정보 포텐셜의 값이 보다 큰 것으로 분석되었다. 16 QAM 시스템에 복소 위상왜곡 채널을 기준으로 하여 자승평균오차 (MSE)의 수렴 성능과 심볼점 집결성능을 평가하였으며 시뮬레이션 결과에서 채널 위상 왜곡이 효과적으로 보상됨을 성상도 성능에서 보였으며 정상상태 MSE 성능에서는 기존 방식보다 5 dB 이상 개선되었다.

• 조명전기설비학회논문지
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• 제28권11호
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• pp.68-76
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• 2014

This paper presents an offset error compensation algorithm for the accurate phase angle of the grid voltage in single-phase grid-connected inverters. The offset error generated from the grid voltage measurement process cause the fundamental harmonic component with grid frequency in the synchronous reference frame phase lock loop (PLL). As a result, the grid angle is distorted and the power quality in power systems is degraded. In addition, the dq-axis currents in the synchronous reference frame and phase current have the dc component, first and second order ripples compared with the grid frequency under the distorted grid angle. In this paper, the effects of the offset and scaling errors are analyzed based on the synchronous reference frame PLL. Particularly, the offset error can be estimated from the integrator output of the synchronous reference frame PLL and compensated by using proportional-integral controller. Moreover, the RMS (Root Mean Square) function is proposed to detect the offset error component. The effectiveness of the proposed algorithm is verified through simulation and experiment results.