Non-ferrous metals, widely used in the mechanical industry, are difficult to machine, particularly by drilling and tapping. Since non-ferrous metals have a strong tendency to adhere to the cutting tool, the tool life is greatly deteriorated. Diamond-like carbon (DLC) is one of the promising candidates to improve the performance and life of cutting tool due to their low frictional property. In this study, a sacrificial DLC layer is applied on the hard nitride coated drill tool to improve the durability. The DLC coatings are fabricated by controlling the acceleration voltage of the linear ion source in the range of 0.6~1.8 kV. As a result, the optimized hardness(20 GPa) and wear resistance(1.4 x 10-8 ㎣/N·m) were obtained at the 1.4 kV. Then, the optimized DLC coating is applied as an sacrificial layer on the hard nitride coating to evaluate the performance and life of cutting tool. The Vickers hardness of the composite coatings were similar to those of the nitride coatings (AlCrN, AlTiSiN), but the friction coefficients were significantly reduced to 0.13 compared to 0.63 of nitride coatings. The drilling test were performed on S55C plate using a drilling machine at rotation speed of 2,500 rpm and penetration rate of 0.25 m/rev. The result showed that the wear width of the composite coated drills were 200 % lower than those of the AlCrN, AlTiSiN coated drills. In addition, the cutting forces of the composite coated drills were 13 and 15 % lower than that of AlCrN, AlTiSiN coated drills, respectively, as it reduced the aluminum clogging. Finally, the application of the DLC sacrificial layer prevents initial chipping through its low friction property and improves drilling quality with efficient chip removal.
본 논문에서는 DB하이텍 0.18㎛ CMOS 공정을 이용하여 진성난수 생성기에 사용되는 베타선 센서 회로를 설계하였다. CSA 회로는 PMOS 피드백 저항과 NMOS 피드백 저항을 선택하는 기능, 50fF과 100fF의 피드백 커패시터를 선택하는 기능을 갖는 회로를 제안하였다. 그리고 펄스 셰이퍼(pulse shaper) 회로는 비반전 증폭기를 이용한 CR-RC2 펄스 셰이퍼 회로를 사용하였다. 본 논문에서 사용한 OPAMP 회로는 이중 전원(dual power) 대신 단일 전원(single power) 사용하고 있으므로 CR 회로의 저항과 RC 회로의 커패시터의 한쪽 노드는 GND 대신 VCOM에 연결한 회로를 제안하였다. 그리고 펄스 셰이퍼의 출력신호가 단조 증가가 아닌 경우 비교기 회로의 출력 신호가 다수의 연속된 펄스가 발생하더라도 단조 다중발진기(monostable multivibrator) 회로를 사용하여 신호 왜곡이 안되도록 하였다. 또한 CSA 입력단인 VIN과 베타선 센서 출력단을 실리콘 칩의 상단과 하단에 배치하므로 PCB trace 간의 커패시터 커플링 노이즈(capacitive coupling noise)를 줄이도록 하였다.
Attila, Zsolnai;Istvan, Egerszegi;Laszlo, Rozsa;David, Mezoszentgyorgyi;Istvan, Anton
Animal Bioscience
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제36권1호
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pp.10-18
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2023
Objective: In this study, we aimed to position the Hungarian Merino among other Merinoderived sheep breeds, explore the characteristics of our sampled animals' genetic similarity network within the breed, and highlight single nucleotide polymorphisms (SNPs) associated with daily weight-gain. Methods: Hungarian Merino (n = 138) was genotyped on Ovine SNP50 Bead Chip (Illumina, San Diego, CA, USA) and positioned among 30 Merino and Merino-derived breeds (n = 555). Population characteristics were obtained via PLINK, SVS, Admixture, and Treemix software, within-breed network was analysed with python networkx 2.3 library. Daily weight gain of Hungarian Merino was standardised to 60 days and was collected from the database of the Association of Hungarian Sheep and Goat Breeders. For the identification of loci associated with daily weight gain, a multi-locus mixed-model was used. Results: Supporting the breed's written history, the closest breeds to Hungarian Merino were Estremadura and Rambouillet (pairwise FST values are 0.035 and 0.036, respectively). Among Hungarian Merino, a highly centralised connectedness has been revealed by network analysis of pairwise values of identity-by-state, where the animal in the central node had a betweenness centrality value equal to 0.936. Probing of daily weight gain against the SNP data of Hungarian Merinos revealed five associated loci. Two of them, OAR8_17854216.1 and s42441.1 on chromosome 8 and 9 (-log10P>22, false discovery rate<5.5e-20) and one locus on chromosome 20, s28948.1 (-log10P = 13.46, false discovery rate = 4.1e-11), were close to the markers reported in other breeds concerning daily weight gain, six-month weight, and post-weaning gain. Conclusion: The position of Hungarian Merino among other Merino breeds has been determined. We have described the similarity network of the individuals to be applied in breeding practices and highlighted several markers useful for elevating the daily weight gain of Hungarian Merino.
국내에서 말 마취에 관한 보고서는 매우 드물다. 본 연구의 목적은 말임상에서 마취중 폐사율을 알아보기 위하여 2005년 1월부터 2010년 10월까지 부산경남경마공원 동물병원에서 Thoroughbred 경주마를 대상으로 조사하였다. 기간 중 전마취는 detomidine hydrochloride(0.01 mg/kg) 또는 xylazine(0.5 mg/kg)를 사용하였고, 근육이완제는 guaifenesin(50-100 mg/kg)을 사용하였으며, ketamine hydrochloride(2 mg/kg)으로 정맥전신마취를 유도하였고, 그 후 isoflurane(1.3-1.5%)으로 흡입마취를 유지하였다. 190 마리 중 각각 150 마리가 흡입마취를, 40 마리가 정맥마취를 받았다. 마취 목적은 근골격계 장애를 위한 수술이 가장 흔하였고 다음으로는 비뇨기계와 호흡기계 순이었다. 마취에 의한 폐사는 골편을 제거하기 위한 관절경수술을 받는 경우에서 한 건이 있었다. 마취시간은 150 분이었으며 사인은 마취기계 미숙에 의한 저산소증이었다. 결론적으로 Thoroughbred 경주마의 마취중 폐사율은 0.52%로 나타났다.
본 논문에서는 태양광 발전시스템을 이용한 승압 초퍼와 전압형 PWM(Pulse Width Modulation) 인버터인 전력변환기로 구성하였고, 안정된 변조를 위해서 동기신호와 제어신호를 원칩 마이크로프로세서에 의해서 처리하였다. 전력비교에 따라 시간 비율을 변화시키지만 태양전지는 전형적인 수하특성을 갖고 있어, 일사량과 온도변화에 관계없이 항상 최대 출력점을 추적하도록 승압초퍼를 제어하였다. 또한 PWM 전압형 인버터는 태양전지가 연속 발전할 수 없는 단점을 보완하기 위해 일반 상용전원과 연계함으로써 약 $10{\sim}20[%]$ 전력절감효과를 얻을 수 있는 에너지절약 전원 복합형 전력변환장치로 구성하였다. 그리고 태양광 발전의 효율을 높이기 위하여 센서와 마이크로프로세서를 이용한 태양광위치추적 장치를 설계하여 고정방식의 태양광 발전에 대하여 비교해 보았다. 그 결과, 태양광 위치추적장치는 고정방식의 태양광 발전에 비해 5% 정도 개선됨을 알 수 있었다. 또한, PWM 전압형 인버터와 위상동기를 위해서 계통전압을 검출하여 계통전압과 인버터 출력을 동상 운전하므로 잉여전력을 계통과 연계할 수 있게 하였다. 그리고 고역율과 저고조파 출력을 유지함으로서 부하와 계통에 전력이 안정하게 공급될 수 있도록 제어하였다.
최근에는 다양한 플랫폼 서비스가 인공지능을 활용하여 제공되고 있으며, 그 중 하나로 ChatGPT는 대량의 데이터를 자연어 처리하여 자가 학습 후 답변을 생성하는 역할을 수행하고 있다. ChatGPT는 IT 분야에서 소프트웨어 프로그래밍 분야를 포함하여 다양한 작업을 수행할 수 있는데, 특히 프로그램을 대표하는 C언어를 통해 간단한 프로그램을 생성하고 에러를 수정하는데 도움을 줄 수 있다. 이러한 능력을 토대로 C언어를 기반으로 만들어진 하드웨어 언어인 베릴로그 HDL도 ChatGPT에서 원활한 생성이 예상되지만, 베릴로그 HDL의 합성은 명령문들을 논리회로 구조 형태로 생성하는 것이기에 결과물들의 정상적인 실행 여부를 확인해야 한다. 본 논문에서는 용이한 실험을 위해 규모가 적은 논리회로들을 선택하여 ChatGPT에서 생성된 디지털회로와 인간이 만든 회로들의 결과를 확인하려 한다. 실험 환경은 Xilinx ISE 14.7로 모듈들을 모델링하였으며 xc3s1000 FPGA칩을 사용하여 구현하였다. 구현된 결과물을 FPGA의 사용 면적과 처리 시간을 각각 비교 분석함으로써 ChatGPT의 생성물과 베릴로그 HDL의 생성물의 성능을 비교하였다.
본 연구에서는 전해 격막의 방식 및 재질, 전해액에 따른 전기분해수의 물리적 특성과 미생물의 표면살균 효과를 검토하였다. 격막 방식의 전기분해수 제조 시스템의 최적조건은 간극이 1.0mm, 20% NaCl 첨가량이 6mL/min 일 때 제조된 전기분해수의 물성치가 ORP 1,170mV 수준, HClO 함량 100ppm 수준, pH 2.5 수준으로 가장 우수하게 나타났으며, 1단 방식보다는 2단의 전기분해 방식이 물성 측면에서 우수함을 알 수 있었다. 무격막 방식의 전기분해수는 간극이 1.0mm, 20% NaCl 첨가량이 4mL/min 일 때 격막 방식의 최적조건과 가장 유사하게 나타났으나 차아염소산 함량은 132-266ppm 수준, pH는 9 수준으로 격막 방식과는 크게 달라지는 것을 알 수 있었다. 전극의 재질에 따른 성능을 평가한 결과, $IrO_{2}$ 및 Pt+Ir 재질의 극판이 산화환원전위 1,144-1,142mV 수준, 차아염소간 함량 190-235ppm 수준, pH 2.24-2.73으로 Pt 재질에 비해 물성치가 다소 높음을 볼 수 있으며 제조 수량도 가장 양호하게 나타났다. 전극판의 재질 특성에 따라 제조한 전기분해수의 미생물 살균효과는 Salmonella typhimurium을 제외한 나머지 3균주는 초기 $10^{7}-10^{9}CFU/mL$에서 30초 후에 모두 사멸되는 것으로 나타났으나, Salmonella typhimurium는 $IrO_{2}$ 재질에서는 1-2분 이내에 사멸되었다. 전해액으로 NaCl 및 $CaCl_{2}$, KCl을 사용하여 제조한 전기분해수의 ORP및 HClO 함량은 NaCl, KCl, $CaCl_{2}$ 순으로 높게 나타났으나 큰 차이는 없었으며, 미생물 사멸효과는 동일하게 나타났다.c}C$에서 발효한 비지장에서 glucose 함량이 높게 나타났다. 대두로 비지를 제조했을 때와 비지장의 발효과정 중 isoflavones 조성은 glucosides 함량은 감소하고 aglycones 함량은 증가하였으며 $40^{\circ}C$에서 발효한 비지장에서 그 증감의 폭이 컸다. 이상의 결과로부터 비지장의 맛과 인체 이용율에 바람직한 영향을 주는 요인이라 생각되는 ${\beta}-amylase$와 중성 protease 활성도, 단백질 분해율과 용해율, 유리 아미노산 총함량 및 조성, 환원당과 glucose 함량, genistein과 daidzein의 함량 등을 고려했을 때 품질이 우수한 비지장을 얻기 위해서는 $40^{\circ}C$에서 48시간 발효시키는 것이 바람직할 것으로 생각된다.. 환원당(還元糖)은 원기(元氣)가 가장 많고 도입(導入) 2호(號)가 가장 적었고 자당(蔗糖)은 칠복(七福)이 가장 많고 원기(元氣)가 가장 낮았으며 가용성전당(可溶性全糖)은 유심(琉心)이 가장 많고 천미(千美)가 가장 적었다. 3. 전단백질함량(全蛋白質含量)은 수원(水原) 147호(號)가 가장 높고 유심(琉心)이 가장 낮았으며 가용성단백질함량(可溶性蛋白質含量)은 칠복(七福)이 가장 높고 유심(琉心)이 가장 낮았으며 전단백질함량(全蛋白質含量)과 수용성단백질함량(水溶性蛋白質含量) 간(間)의 차이(差異)도 각각(各各) 상이(相異)하였다.& Inner part)의 순서등 5품종을 선정하였다. B. 숙성온도별 영향으로서 실온 $24{\sim}25^{\circ}C,\;30^{\circ}C,\;45^{\circ}C$ 별로 각 fine spirit에 oak chip을 넣고 숙성시킨 결과 $45^{\circ}C$에서 숙성시킨 것이 가장 숙성이 촉진 되었고
본 연구에서 여름철 성수기를 앞두고 생산된 아이스크림류에 대하여 대장균군과 E. coli O157:H7, S. aureus, C. perfringens, L. monocytogenes, Salmonella spp. 등 식중독균 검출여부를 조사한 결과 모든 제품에서 검출되지 않았다. 이에 반하여 세균수에 있어서는 11개 제조공장별로, 그리고 아이스크림류 유형별로 $2.5{\times}10^3$에서부터 $5.5{\times}10^5cfu/g$까지 다양한 수준을 나타내었다. 또한, OEM 생산업체에서 제조된 아이스크림을 포함하여 아이스크림 제품별로는 과자류, 찰떡, 초코렛, 과일쥬스 등의 부원료가 추가적으로 사용되거나, 손작업이 필요로 하는 stic bar type 등 7개 제품에서 세균수 허용기준이 초과된 것으로 나타났다. 세균수 허용기준을 초과한 제품에 대하여 아이스크림류 유형별로 분석한 바, 아이스크림은 10개중 3개 제품(30.0%), 아이스밀크는 6개중 3개 제품(50.0%), 샤베트는 2개중 1개 제품(50.0%)으로 조사되어 약간의 차이가 있었다. 아이스크림류 제조공정 중 미생물의 품질관리를 위하여 포장용기에 대한 미생물 모니터링 검사를 포함하여 동결 공정에 추가적인 CCP 설정 등과 같은 HACCP제도의 도입 및 보완을 고려해 보아야 할 것으로 생각된다.
본 논문에서는 기준신호를 나타내는 하나의 파일럿채널과 다수의 트래픽채널을 갖는 DS/CDMA용 송수신기구조를 제안한다. 파일럿채널은 데이타 변조가 되지 않은 순수 PN 부호성분을 전송하며 수신단에서 PN 동기 및 동기복조의 기준신호로 이용한다. 또한 이러한 구조는 순방향뿐만 아니라 역방향 링크에도 적용된다. 제안된 DS/CDMA 방식의 특징은 다음과 같다. 첫째, 트래픽채널의 확산 방식은 I-phase 및 Q-phase의 확산부호를 파일럿채널의 그것과 교차하게 배치한 interlaced quardrature-spreading(IQS) 구조를 갖는데 이는 기존의 확산방식에 비해 데이타 신호의 영교차율을 줄여 송신단 출력신호 레벨의 변화를 작게한다. 둘째, PN부호의 초기동기 및 동기초적시 임계값을 적응적으로 자동설정하며, 초기동기시 PN 부호를 한 칩씩 이동하게 하여, 기존의 방식에 비해 초기동기 시간을 절반으로 줄이게 했으며, 수신부에서 PN 부호 발생기를 하나만 사용하여 초기동기 및 동기추적이 되게했다. 또한 state machine을 이용하여 재동기 timing을 자동설정 하도록 설계했다. 셋째, 본 방식에서는 자동주파수조절(automatic frequency control: AFC)기능, 입력신호의 크기에 따라 능동적으로 유효한 출력 레벨을 조절하는 자동 레벨조절(automatic level control: ALC)기능, bit-error-rate(BER)을 자동계산하는 기능, 인접 채널과의 간섭을 최소화하기 위한 스펙트럼 성형기능 등을 도입하여 사용자 편의를 도모했다. 넷째, 데이타 전송속도를 16Kbps~1.024Mbps로 가변이 되게함으로써 다양한 응용에 대처할 수 있게 설계했다. 한편, 본 논문에서 제안한 DS/CDMA 모뎀구조는 다양한 simulation을 통하여, 알고리즘 검증 과정을 거쳤으며, 제안된 DS/CDMA 모뎀 구조는 VHDL을 이용하여 ASIC으로 구현하였다. DS/CDMA용 ASIC은 송신부 ASIC과 수신부 ASIC으로 나누어 개발 하였으며, 한개의 ASIC당 3개의 채널을 동시에 수용할 수 있으며, 다수의 ASIC을 사용하여 여러 채널의 다중접속이 가능하다. 제작완료된 ASIC은 기능시험을 완료했으며 실제 line-of-sight(LOS) 시스템 구현에 적용중이다.
본 논문에서는 누설전력 소비뿐만 아니라 스위칭 전력 소비를 동시에 줄일 수 있는 새로운 저전력 SRAM 회로를 제안한다. 제안된 저전력 SRAM은 대기모드와 쓰기동작에서는 셀의 소스라인 전압을 $V_{SSH}$로 증가시키고 읽기동작에서만 소스라인 전압을 다시 $V_{SS}$가 되도록 동적으로 조절한다. SRAM 셀의 소스라인 전압을 동적으로 조절하면 reverse body-bias 효과, DIBL 효과, 음의 $V_{GS}$ 효과를 이용하여 셀 어레이의 누설전류를 1/100 까지 감소시킬 수 있다. 또한 누설전류를 억제하기 위해 사용된 소스라인 드라이버를 이용하여 SRAM의 쓰기동작에서 비트라인 전압의 스윙 폭을 $V_{DD}-to-V_{SSH}$로 감소시킴으로써 SRAM의 write power를 대폭 감소시킬 수 있고 쓰기동작 중에 있는 셀들의 누설 전류 소비도 동시에 줄일 수 있다. 이를 위해 새로운 write driver를 사용하여 low-swing 쓰기동작 시 성능 감소를 최소화하였다. 누설전력 소비 감소 기법과 스위칭 전력 소비 감소 기법을 동시에 사용함으로써 제안된 SRAM은 특히 미래의 큰 누설전류가 예상되는 70-nm 이하 급 초미세 공정에서 유용할 것으로 예측된다. 70-nm 공정 파라미터를 이용해서 시뮬레이션한 결과 누설전력 소비의 93%와 스위칭 전력 소비의 43%를 줄일 수 있을 것으로 보인다. 본 논문에서 제안된 저전력 SRAM의 유용성과 신뢰성을 검증하기 위해서 $0.35-{\mu}m$ CMOS 공정에서 32x128 bit SRAM이 제작 및 측정되었다. 측정 결과 기존의 SRAM에 비해 스위칭 전력이 30% 적게 소비됨을 확인하였고 사용된 메탈 차폐 레이어로 인해서 $V_{DD}-to-V_{SSH}$ 전압이 약 1.1V 일 때까지 오류 없이 동작함을 관측하였다. 본 논문의 SRAM 스위칭 전력감소는 I/O의 bit width가 증가하면 더욱 더 중요해질 것으로 예상할 수 있다.
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[게시일 2004년 10월 1일]
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