• 제목/요약/키워드: Novel Transceiver

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A Low Power smartRF Transceiver Hardware Design For 2.4 GHz Applications

  • Kim, Jung-Won;Choi, Ung-Se
    • 전기전자학회논문지
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    • 제12권2호
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    • pp.75-80
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    • 2008
  • There are many researches to reduce power consumption of battery-operated Transceiver for 2.4 GHz smartRF applications. However, components such as processor, memory and LCD based power managements reach the limit of reducing power consumption. To overcome the limit, this research proposes novel low-power Transceiver and transceiver Hardware Design. Experimental results in the real smartRF Transceiver show that the proposed methods can reduce power consumption additionally than component based power managements.

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A Study on Improvement of the Channel Efficiency of FH-SS Transceiver Based on DDS Technique

  • Kim, Gi-Rae;Choi, Young-Kyu
    • Journal of information and communication convergence engineering
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    • 제6권1호
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    • pp.47-50
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    • 2008
  • A novel high channel efficiency transceiver based on a fast acquisition frequency synthesizer has been designed. The direct digital synthesis (DDS) technique is applied and a simple memory look-up table is incorporated to expedite channel acquisition. The technique simplifies the frequency control process in the transceiver and thus reduces the channel switching time. As a result, the channel efficiency is improved. The designed transceiver is ideal for frequency hopping mobile communication applications.

CDSK 변조 방식과 카오스 송수신기의 지연시간에 따른 Boss Map의 BER 성능 평가 (BER Performance Evaluation of Boss Map According to Delay Time in CDSK Modulation Scheme and Chaos Transceiver)

  • 이준현;금홍식;이동형;유흥균
    • 한국통신학회논문지
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    • 제39A권7호
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    • pp.365-371
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    • 2014
  • 카오스 통신 시스템은 카오스 신호를 이용하여 시스템의 보안성을 향상시킨다. 또한, 도청 확률을 줄일 수 있으며, 간섭 신호나 재밍 신호에 강한 특징을 가진다. 하지만 디지털 통신 시스템보다 BER(Bit Error Rate) 성능이 좋지 않은 단점을 가진다. 이런 이유로 인해 카오스 통신 시스템의 BER 성능을 향상시키기 위한 연구가 활발이 이루어지고 있다. 우리는 이전 연구에서 BER 성능을 향상시키기 위해 새로운 카오스 맵을 제안하고 이 카오스 맵을 'Boss map'이라 불렀다. 또한, 새로운 카오스 송수신기 구조를 제안하여 BER 성능을 향상시켰다. 하지만 BER 성능은 송수신기에서 사용하는 지연 시간에 따라 다르게 평가된다. 따라서 Boss map을 효과적으로 사용하기 위해서는 CDSK(Correlation Delay Shift Keying) 방식과 제안된 카오스 송수신기의 최적의 지연시간을 찾아야 한다. 본 논문에서는 Boss map을 사용했을 때, CDSK 방식과 새로운 송수신기 구조의 지연시간에 따른 BER 성능을 평가한다. 지연 시간에 따른 BER 성능을 평가한 후, CDSK 방식과 새로운 송수신기 구조에서 최적의 BER 성능을 가질 수 있는 지연 시간을 확인한다.

A 6 Gbps/pin Low-Power Half-Duplex Active Cross-Coupled LVDS Transceiver with Switched Termination

  • Kim, Su-A;Kong, Bai-Sun;Lee, Chil-Gee;Kim, Chang-Hyun;Jun, Young-Hyun
    • ETRI Journal
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    • 제30권4호
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    • pp.612-614
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    • 2008
  • A novel linear switched termination active cross-coupled low-voltage differential signaling (LVDS) transceiver operating at 1.5 GHz clock frequency is presented. On the transmitter side, an active cross-coupled linear output driver and a switched termination scheme are applied to achieve high speed with low current. On the receiver side, a shared pre-amplifier scheme is employed to reduce power consumption. The proposed LVDS transceiver implemented in an 80 nm CMOS process is successfully demonstrated to provide a data rate of 6 Gbps/pin, an output data window of 147 ps peak-to-peak, and a data swing of 196 mV. The power consumption is measured to be 4.2 mW/pin at 1.2 V.

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Novel UWB Transceiver for WBAN Networks: A Study on AWGN Channels

  • Zhao, Chengshi;Zhou, Zheng;Kwak, Kyung-Sup
    • ETRI Journal
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    • 제32권1호
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    • pp.11-21
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    • 2010
  • A novel ultra-wideband (UWB) transceiver structure is presented to be used in wireless body area networks (WBANs). In the proposed structure, a data channel and a control channel are combined into a single transmission signal. In the signal, a modulation method mixing pulse position modulation and pulse amplitude modulation is proposed. A mathematical framework calculating the power spectrum density of the proposed pulse-based signal evaluates its coexistence with conventional radio systems. The transceiver structure is discussed, and the receiving performance is investigated in the additive white Gaussian noise channel. It is demonstrated that the proposed scheme is easier to match to the UWB emission mask than conventional UWB systems. The proposed scheme achieves the data rate requirement of WBAN; the logical control channel achieves better receiving performance than the logical data channel, which is useful for controlling and maintaining networks. The proposed scheme is also easy to implement.

0.18㎛ CMOS 3.1Gb/s VCSEL Driver 코아 칩 설계 (Design of Core Chip for 3.1Gb/s VCSEL Driver in 0.18㎛ CMOS)

  • 양충열;이상수
    • 한국통신학회논문지
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    • 제38A권1호
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    • pp.88-95
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    • 2013
  • 본 논문에서는 $0.18{\mu}m$ CMOS 공정 기술을 이용하여 광트랜시버에 사용된 1550 nm 고속 VCSEL을 구동하는 드라이버 회로를 제안한다. 3.1Gb/s 데이터 속도에서 기존 구조에 비하여 향상된 대역폭, 이득 및 아이 다이어그램을 확인하였다. 본 논문에서는 다중채널 어레이 집적모듈을 갖는 광트랜시버에 응용하기 위한 3.1Gb/s VCSEL 드라이버의 설계 및 레이아웃을 확인한다.

A Novel 3-Level Transceiver using Multi Phase Modulation for High Bandwidth

  • Jung, Dae-Hee;Park, Jung-Hwan;Kim, Chan-Kyung;Kim, Chang-Hyun;Kim, Suki
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2003년도 하계종합학술대회 논문집 II
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    • pp.791-794
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    • 2003
  • The increasing computational capability of processors is driving the need for high bandwidth links to communicate and store the information that is processed. Such links are often an important part of multi processor interconnection, processor-to-memory interfaces and Serial-network interfaces. This paper describes a 0.11-${\mu}{\textrm}{m}$ CMOS 4 Gbp s/pin 3-Level transceiver using RSL/(Rambus Signaling Logic) for high bandwidth. This system which uses a high-gain windowed integrating receiver with wide common-mode range which was designed in order to improve SNR when operating with the smaller input overdrive of 3-Level. For multi-gigabit/second application, the data rate is limited by Inter-Symbol Interference (ISI) caused by low pass effects of channel, process-limited on-chip clock frequency, and serial link distance. In order to detect the transmited 4Gbps/pin with 3-Level data sucessfully ,the receiver is designed using 3-stage sense amplifier. The proposed transceiver employes multi-level signaling (3-Level Pulse Amplitude Modulation) using clock multi phase, double data rate and Prbs patten generator. The transceiver shows data rate of 3.2 ~ 4.0 Gbps/pin with a 1GHz internal clock.

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다중 셀 다중 안테나 하향링크 채널에서의 간섭 정렬 송수신기 설계 (Design on the Interference Alignment Transceiver for Multi-Cell MIMO Downlink Channels)

  • 이현호;고영채
    • 한국통신학회논문지
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    • 제37B권10호
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    • pp.921-928
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    • 2012
  • 본 논문에서는 임의의 셀 수 혹은 셀 당 임의의 사용자 수를 가지는 다중 셀 다중 안테나 하향링크 채널에 적용 가능한 간섭 정렬 기반 송수신기 설계를 제안한다. 타 셀로부터 오는 간섭 신호를 유효 타 셀 간섭 채널로 정렬시키는 수신 빔포머를 설계한 후, 해당 기지국으로부터 야기되는 모든 간섭 신호를 제거할 수 있는 송신 프리코더를 설계한다. 제안된 송수신기 설계는 사용자 당 전송하는 데이터 스트림 수 만큼의 자유도를 획득할 수 있고 이를 위한 안테나 조건을 구한다. 모의 실험 결과를 통하여 기지국과 사용자의 안테나 수가 동일한 조건 하에서 제안된 송수신기 설계가 기존의 기법보다 높은 자유도를 얻음을 확인한다.

조명 및 무선통신이 동시에 가능한 가시광 송수신기에 관한 연구 (Investigation of visible light communication transceiver applicable to both of illumination and wireless communication)

  • 송석수;공영식;박진우
    • 한국통신학회논문지
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    • 제37권4A호
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    • pp.219-226
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    • 2012
  • 본 연구는 조명 및 무선통신이 동시에 가능한 가시광 송수신기에 대해 가시광 통신 본연의 가시성, 무선 통신의 사용 편의성 그리고 고속의 통신 속도를 고려해 edge-emitting laser diode와 silicon photo diode를 기반으로한 고속 가시광 무선 송수신기를 구현하였다. 제안된 가시광 무선 송수신기는 120Mbit/s의 고속에서 양방향 전송이 가능하도록 설계되었으며 이때 발생하는 누화(crosstalk)를 방지하기 위한 방법으로 shielding 방식을 적용해 가시광 송수신기의 성능을 실험적으로 측정 분석하였다. 또 수신기의 시야각 확대를 위한 방법으로는 새로운 구조의 광학적 antenna를 적용해 광학적 antenna가 없는 두 개의 송수신기 사이의 전송링크 특성과 광학적 antenna를 사용한 두 개의 송수신기 사이의 전송링크 특성을 2차원 평면상에서 전송거리, 적용범위 그리고 기울임 정도를 변화시켜 실험과 시뮬레이션을 통해 그 성능을 비교 분석하였다.