효율적이고 안전한 전자 지불시스템을 설계하는 것은 전자상거래에서 아주 중요하다. 본 논문에서는 ID를 기반으로 한 공개키 암호 시스템을 적용하여 다중 처리를 허용하는 효율적인 지불시스템을 설계하였다. 제안한 지불 시스템은 유한체 Fq상에서의 타원곡선 암호 시스템을 사용하는 Weil-pairing 기법에 의해 생성된 인증키를 생성하는 과정을 이용한다. 따라서, 이 방법은 알려진 키 공격과 위장 공격에 대해 보다 안전하고 속도의 향상 및 안정성을 제공한다.
This paper proposes an efficient micro mobility scheme to support user mobility inside an access network which employs Ipv6. The proposed scheme, namely SMM(Sparse-mode Multicast for mobility), utilizes a class of multicast protocol, PIM-SM, in the visited access network to reduce signaling to the home agent as well as to the correspondent node and to minimize packet loss during the handoff when mobile user changes its point of attachment frequently. Through the simulation, the performance of the proposed SMM is analyzed and compared with those of Mobile nv6 and for the case which adpots PIM-DM. The result shows that SMM provides significantly better performance in terms of packet loss that is invariant to transmission rate and packet size.
In this paper, we describe implemented DMAC (Direct Memory Access Controller) architecture on Altera's $Excalibur^{TM}$ that includes industry-standard $ARM922T^{TM}$ 32-bit RISC processor core operating at 200 MHz. We implemented DMAC based on AMBA (Advanced Micro-controller Bus Architecture) AHB (Advanced Micro-performance Bus) interface. Implemented DMAC has 8-channel and can extend supportable channel count according to user application. We used round-robin method for priority selection. Implemented DMAC supports data transfer between Memory-to-Memory, Memory-to-Peripheral and Peripheral-to-Memory. The max transfer count is 1024 per a time and it can support byte, half-word and word transfer according to AHB protocol (HSIZE signals). We implemented with VHDL and functional verification using $ModelSim^{TM}$. Then, we synthesized using $LeonardoSpectrum^{TM}$ with Altera $Excalibur^{TM}$ library. We did FPGA P&R and targeting using $Quartus^{TM}$. We can use implemented DMAC module at any system that needs high speed and broad bandwidth data transfers.
본 연구는 스마트분전반 MG(;Micro-Grid) 구성의 중심축으로 모듈형 하이브리드 발전원과 DC버스를 통하여 링크를 갖으며 표준소켓을 사용하여 불법연결을 감지 차단하는 기능을 부여하고, 전력계통의 안정화를 달성함을 목적으로 한다. 전력변환장치, 스마트분전반, 통합제어시스템의 개발과 효율적인 수요관리가 필요하며, MG 전체시스템과의 호환성이 절실하다. 이는 공통 전력 연결 규약으로 안전하고 누구나 연결을 쉽게 할 수 있는 하이브리드발전시스템으로 데이터 관리가 용이해지고 다양한 제조사의 시스템 확대설치에 대한 대비가 가능하다.
Kim, Jung-Gon;Hong, Won?Pyo;Yun, Byeong-Ju;Kim, Dong-Hwa
제어로봇시스템학회:학술대회논문집
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제어로봇시스템학회 2005년도 ICCAS
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pp.414-420
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2005
The ShortStack Micro Server enables any product that contains a microcontroller or microprocessor to quickly and inexpensively become a networked, Internet-accessible device. The ShortStack Micro Server provides a simple way to add LonWorks networking to new or existing smart devices. . It implements the LonTalk protocol and provides the physical interface with the LonWorks communication. The ShortStack host processor can be an 8, 16, or 32-bit microprocessor or microcontrollers. The ShortStack API and driver typically require about 4kbytes of program memory on the host processor and less than 200 bytes of RAM. The interface between host processor and the ShortStack Micro Server may be a Serial Communication Interface (SCI). The LonWorks control module with a high performance is developed, which is composed of the 8 bit PIC Microprocessor for host processor and the smart neuron chip for the ShortStack Micro Server. This intelligent control board is verified as proceeding the various function tests from experimental system with an boost pump and inverter driving systems. It is also confirmed that the developed control module provides stably 0-10VDC linear signal to the input signal of inverter driving system for varying the induction motor speed. Thus, the experimental results show that the fabricating intelligent board carried out very well the various functions in the wide operating ranges of boost pump system. This developed control module expect to apply to industrial fields to require the comparatively exact control and monitoring such as multi-motor driving system with inverter, variable air volume system and the boost pump water supply systems.
In this study I construct CAN(Controller Area Network) for automobiles similar to LAN(Local Area Network) and build communication modules in the major part of an automobile to link several sub-systems. Since each station replaces the communication function of sub-systems and has various types of sensor, actuator, controller, and switch, every information about automobile's status is obtained from the network. The manufactured system showed a superior capability. The following is the contents of study. 1. The definition of communication packet through the analysis of CAN protocol. 2. The Design of modules using micro-controller 80C196CA. 3. The Network configuration.
본 논문에서는 핸드오프가 빈번하게 발생할 수 있는 마이크로 및 피코 셀 환경에 적합한 MIPv6 바인딩 갱신 프로토콜을 제안한다. 이는 안전성과 효율성을 고려하기 위해 CGA (Cryptographically Generated Addresses) 기반의 티켓 방식을 이용한다. 프로토콜의 분석 결과 기존의 다른 프로토콜에 비해 적은 계산량을 필요로 한다.
무선 환경에서의 전자상거래가 빠르게 성장함에 따라 종단간 보안이 필요하다. 기존 WTLS를 사용하는 WPP 프로토콜에서는 종단간 사용자 안전성을 보장하고 있지 않다. 이 논문에서는 AIP 프로토콜에서 사용자와 서비스 제공자간에 종단간 안전성이 제공되는 무선 인터넷 플랫폼에 독립적인 소액지불 프로토콜을 제안한다. 또한 인증기관이 인증과정에 참여할 경우 ID 기반 공개키 암호 시스템을 적용한 세션키를 생성하여 제안 프로토콜의 안전성 및 효율성을 분석한다.
Hierachical Mobile IPv6 (HMIPv6) solves Micro-mobility protocol problem about Handover. Mobility Anchor Point(MAP) helps reducing the handover, but this makes a load on the MAP. Besides the MAP operates this work everytime, and every Nodes. In this paper, we propose the algorithm that reduces the amount of Map working.
본 논문에서는 UHF(Ultra High Frequency)와 MW(Micro Wave) 대역의 RFID 리더 시스템을 위한 디지털 코덱을 제안하였다. 현재 RFID 시스템은 하나의 프로토콜만을 지원하는 것이 대부분이다. 하지만, 현재 제정되어 있는 표준은 5개의 주파수 대역마다 각각 하나씩 제정되어 있고, 전 세계적으로 가장 널리 쓰이고 있는 UHF 대역의 경우에는 A,B,C 타입이 있으며 향후 더 많은 표준이 제정될 것이다. 또한 앞으로 모바일 RFID 시스템의 관심이 고조되면서 하나 이상의 프로토콜을 지원하는 RFID 시스템의 필요성은 더욱 더 증가할 것이다. 따라서 본 논문에서는 UHF 대역과 MW대역의 dual-band RFID 시스템을 위한 디지털 코덱을 제안하였다. UHF 대역은 EPC 클래스 1 제너레이션 2(EPC Class1 Generation2)표준인 18000-6C 와 MW 대역의 표준인 18000-4 표준을 기반으로 시스템을 구현하였다. 설계된 회로는 알테라사의 쿼터스II 를 이용하여 합성 하였다. 목적 디바이스는 Altera 사의 CycloneII 계열인 EP2C20Q240C8이다. 주 클럭 주파수는 19.2MHz 로 설정하였으며 합성 시 사용된 FPGA의 소자(element)는 18,752개이다.
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[게시일 2004년 10월 1일]
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