이동통신사 주도의 LPWA(Low Power Wide Area) 기반 IoT 기술은 NB-IoT와 LTE Cat.M1이 상용화되어 서비스되고 있다. LPWA 기반 IoT에 대한 서비스 요구사항이 증가되면서 이러한 서비스 가입자도 증가하고 있는 상황이다. 서비스 초기에는 NB-IoT 및 LTE Cat.M1을 수용하기 위한 기지국 용량에 이슈가 없었으나, 가입자 증가로 하나의 셀에서 수용하기 위한 용량이 부족해지는 문제가 발생하고 있다. 이러한 Active UE 용량 문제는 지속적인 증가로 인한 과부하와 일시적인 증가로 인한 과부하 문제가 발생할 수 있다. 본 논문에서는 기지국에서 NB-IoT 및 LTE Cat.M1 단말의 일시적인 증가로 인해 발생 하는 LTE 접속제어 채널인 RRC(Radio Resource Control) Active UE 용량 부족 및 기지국 과부하 문제를 해결하기 위한 방안을 제시한다. 제시한 방안은 이동통신의 셀 분할 및 추가 기지국 투자 없이 셀 용량을 증대 시킬 수 있는 방안을 제시함으로써, 증가하는 IoT 단말을 수용해 서비스 성능을 개선시킨다.
본 논문에서는 저전력장거리 기술과 임베디드 보드를 이용한 치매 돌봄 스마트 신발과 응용 소프트웨어를 구현하였다. Cortex-M3 보드와 로라 모듈로 구성된 통신 모듈은 신발 밑창의 홈에 내장 된다. 위치추적 응용 소프트웨어는 임베디드 보드에서 제공하는 신호와 GPS와 로라 망을 이용하여 보호자가 치매 환자의 위치 추적할 수 있다. 외부 환경에서 스마트 신발의 위치 추적 및 데이터 전송 동작이 성공적으로 확인되었다. 이러한 실험을 통해 본 논문에서 개발한 스마트 신발이 치매 환자의 돌봄을 위한 실종을 막는 안전장치로 응용 가능할 것으로 판단된다.
4차 산업혁명의 핵심 기술 중의 하나로서 사물인터넷 (Internet of Things)은 무선 네트워크, 통신모듈 및 센서, 스마트 단말 등의 기술 발전 및 보급 확산으로 그 영향력이 의료, 교통, 제조, 유통, 교육 등의 산업분야를 넘어 과학기술 및 공공분야로까지 확대되고 있다. 특히 과학기술 분야에서도 점차 IoT 기술 연구 및 활용 연구가 증가하고 있으며, 이를 통해 기존의 이론 및 실험 중심의 연구에서 데이터 중심의 연구로의 연구 패러다임이 변환되고 있다. 이와 같이 다양한 데이터를 수집하는 인프라스트럭처 환경 구축의 필요성이 커지고 있으며, 수집된 데이터의 전송·처리·분석을 위한 유·무선 통합 네트워크 환경을 위해 국가과학기술연구망 (KREONET)에서는 저전력 장거리 통신기술 LPWAN (Low Power Wide Area Network) 기반의 국가과학기술무선사물인터넷연구망 (ScienceLoRa) 프로젝트를 시작하였다. ScienceLoRa는 기존의 백본망 위주의 유선망인 KREONET를 활용하여 LoRa/LoRaWAN 기술을 활용한 무선망을 구축함으로써 과학기술 및 공공분야에서 다양한 센서들로부터 데이터를 수집하여 이를 전송, 활용 및 분석에 이용하고자 한다. 본 논문에서는 ScienceLoRa 소개, 현재 진행상황, 활용 및 발전 가능성에 대하여 살펴보기로 한다.
JSTS:Journal of Semiconductor Technology and Science
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제17권4호
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pp.524-533
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2017
This paper presents a novel reset scheme for mm-scale sensing systems with stringent volume and area constraints. In such systems, multi-layer structure is required to maximize the silicon area per volume and minimize the system size. The multi-layer structure requires wirebonding connections for power delivery and communication among layers, but the area overhead for wirebonding pads can be significant. The proposed reset scheme exploits already existing power wires and thus does not require additional wires for system-wide reset operation. To implement the proposed reset scheme, a power management unit is designed to impose reset condition, and a reset detector is designed to interpret the reset condition indicated by the power wires. The reset detector uses a coupling capacitor for the initial power-up and a feedback path to hold the developed supply voltage. The prototype reset detector is fabricated in a $180-{\mu}m$ CMOS process, and the measurement results with the prototype mm-scale system confirmed robust reset operation over a wide range of temperatures and voltages.
저전력광대역 (LPWA: Low Power Wide Area) 네트워크는 기존의 무선통신 기술들에 비해 저전력으로 장거리 통신을 가능하게 하여 사물인터넷의 여러 응용분야에서 적용될 수 있는 기술 중 하나로 고려되고 있다. 본 논문에서는 저전력광대역 네트워크의 대표적인 기술 중 하나인 LoRa (Long Range)에 대해 알아본다. 먼저 저전력광대역 네트워크의 일반적인 특징 및 관련 기술에 대해 소개한다. 그리고 LoRa의 기술개요, 특징 및 장단점을 소개한다. 마지막으로 LoRa의 성능분석 및 성능을 향상시키기 위해 필요한 기술들을 물리계층과 매체 접근제어 계층에 중점을 두고 논의한다.
In this paper, we propose a low-power all-digital phase-locked loop (ADPLL) with a wide input range and a high resolution time-to-digital converter (TDC). The resolution of the proposed TDC is improved by using a phase-interpolator and the time amplifier. The phase noise of the proposed ADPLL is improved by using a fine resolution digitally controlled oscillator (DCO) with an active inductor. In order to control the frequency of the DCO, the transconductance of the active inductor is tuned digitally. The die area of the ADPLL is 0.8 $mm^2$ using 0.13 ${\mu}m$ CMOS technology. The frequency resolution of the TDC is 1 ps. The DCO tuning range is 58% at 2.4 GHz and the effective DCO frequency resolution is 0.14 kHz. The phase noise of the ADPLL output at 2.4 GHz is -120.5 dBc/Hz with a 1 MHz offset. The total power consumption of the ADPLL is 12 mW from a 1.2 V supply voltage.
During the last three decades power electronics has gone through energetic technical evolution. The technical needs from wide area such as in industrial, commercial, consumer, aerospace and environmental applications have driven the environment favorably for the power electronics. In the future, two extreme technology-expansion trends are expected: one into low power, and the other into very high power. The former is based on the high frequency and the circuit miniature using VLSI circuit and surface mounting aiming for the system-on-chip (SOC) technology. The latter includes the application areas of power utility such as HVDC, FACTS and SVC and large science area of electrophsycal apparatus such as thermonuclear fusion, acclerators, and electric guns. This paper describes the technology status of some major elements which are available today and the key roles of the power electronics from view points of applications. The author would like to take this opportunity to raise discussions about the future technology development trend of power electronics in our country with the fellow power electronics engineers.
Journal of information and communication convergence engineering
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제18권2호
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pp.115-122
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2020
Audiovisual (AV) facilities such as TVs and signage are installed in various public places. However, audio cannot be used to prevent noise and interference from individuals, which results in a loss of concentration and understanding of AV content. To address this problem, a total technique for remotely listening to audio from audiovisual facilities with clean sound quality while maintaining video and lip-syncing through personal smart mobile devices is proposed in this paper. Through the experimental results, the proposed scheme has been verified to reduce system power consumption by 8% to 16% and provide real-time processing with a low latency of 120 ms. The system described in this paper will contribute to the activation of audio telehearing services as it is possible to provide audio remote services in various places, such as express buses, trains, wide-area and intercity buses, public waiting rooms, and various application services.
Park, Hyung-Gu;Jang, Jeong-A;Cho, Sung Hun;Lee, Juri;Kim, Sang-Yun;Tiwari, Honey Durga;Pu, Young Gun;Hwang, Keum Cheol;Yang, Youngoo;Lee, Kang-Yoon;Seo, Munkyo
JSTS:Journal of Semiconductor Technology and Science
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제14권6호
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pp.777-788
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2014
This paper presents a wide output range, high power efficiency reconfigurable charge pump for driving touch panels with the high resistances. The charge pump is composed of 4-stages and its configuration automatically changes based on the required output voltage level. In order to keep the power efficiency over the wide output voltage range, internal blocks are automatically activated or deactivated by the clock driver in the reconfigurable charge pump minimizing the switching power loss due to the On and Off operations of MOSFET. In addition, the leakage current paths in each mode are blocked to compensate for the variation of power efficiency with respect to the wide output voltage range. This chip is fabricated using $0.18{\mu}m$ BCD process with high power MOSFET options, and the die area is $1870{\mu}m{\times}1430{\mu}m$. The power consumption of the charge pump itself is 79.13 mW when the output power is 415.45 mW at the high voltage mode, while it is 20.097 mW when the output power is 89.903 mW at the low voltage mode. The measured maximum power efficiency is 84.01 %, when the output voltage is from 7.43 V to 12.23 V.
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[게시일 2004년 10월 1일]
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