• 공학교육연구
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• 제2권1호
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• pp.10-16
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• 1999

본 논문에서는 인터넷을 이용한 디지탈 논리회로 설계 및 모의실험실습을 위한 교육용 소프트웨어 패키지(DVLab)를 개발하였다. 개발된 패키지는 디지탈 조합/순차회로는 물론 마이크로콘트롤러 응용회로까지 설계하고 시뮬레이션할 수 있는 모듈, 브레드보드 시뮬레이터 모듈, 실험항목별 이론 강의를 위한 모듈, 보고서 작성 및 보고서 자동검사 모듈 등을 포함하고 있다. 개발된 모든 모듈들은 독립적인 응용 프로그램으로 뿐만 아니라 인터넷을 이용한 사용이 가능하며, 특히 시뮬레이터 모듈의 경우 실시간 클럭 제공, 설계회로도 상에서 직접 소자의 출력값 확인, 논리값 변화 기록 기능, 설계회로 복사 방지 기능, 다양한 논리회로 소자뿐만 아니라 LED, buzzer등과 같은 시각적, 청각적 소자 제공 등의 특징을 가진다. 또한 개발된 교육용 패키지를 이용한 디지탈 논리회로 실험실습 과목의 학습 모형을 제시하였다.

• 전기학회논문지
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• 제59권2호
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• pp.359-362
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• 2010

In this study, inverter logic circuits on a plastic substrate are built with two top-gate FETs in series on a single ZnO nanowire. The voltage transfer characteristics of the ZnO nanowire-based inverter logic circuit exhibit a clear inverting operation. The logic swing, gain and transition width of the inverter logic circuit is about 90 %, 1.03 and 1.2 V, respectively. The result of mechanical bending cycles of the inverter logic circuit on a plastic substrate shows that the stable performance is maintained even after many hundreds of bending cycles.

• 한국정보통신학회논문지
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• 제15권3호
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• pp.613-623
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• 2011

본 논문에서는 Perfect Shuffle에 의한 5치 논리 회로의 구성에 관한 한 가지 방법을 제시하였다. 먼저, Perfect Shuffle 기법과 Kronecker 곱에 의한 5치 논리함수의 입출력 상호연결에 대하여 논하였고, GF(5)의 가산회로와 승산회로를 이용하여 5치 Reed-Muller 전개식의 변환행렬과 역변환행렬을 실행하는 기본 셀을 설계하였다. 이 기본 셀들과 Perfect Shuffle과 Kronecker 곱에 의한 입출력 상호연결 방법을 이용하여 5치 Reed-Muller 전개식에 의한 5치 논리 회로를 구현하였다. 제시된 5치 Reed-Muller 전개식의 설계방법은 모듈구조를 기반으로 하여 행렬변환을 이용하므로 동일한 함수에 대하여 타 방법과 비교하여 간단하고 회로의 가산회로와 승산회로를 줄이는데 매우 효과적이다. 제안된 5치 논리회로의 설계방법은 회선경로 선택의 규칙성, 간단성, 배열의 모듈성과 병렬동작의 특징을 가진다.

• 한국정보통신학회논문지
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• 제12권1호
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• pp.59-64
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• 2008

본 논문에서는 디지털 논리 회로를 효과적으로 학습하기 위한 멀티미디어 콘텐츠를 개발하였다. 이 콘텐츠의 주 교육 대상은 특별한 배경지식이 없는 일반인 또는 대학 저학년이며, 여기에 초점을 맞추어 주제 구성, 난이도, 상호작용의 적절성 등을 기획하였다. 내용면에서는 디지털논리 회로뿐만 아니라, 실제 회로제작에 필수적인 전기와 회로에 대한 기본원리에 대한 내용도 다루었다. 또한 가상의 실험 회로를 플래쉬를 이용하여 제작하여 학습자가 회로의 구성과 동작 등을 쉽게 이해하고 실제 회로에 빨리 적응할 수 있도록 구성하였다. 본 논문에서 제작한 콘텐츠는 이론적인 내용뿐만 아니라, 멀티미디어를 이용한 가상의 실습실을 통해서 현실감 있는 실습이 가능하기 때문에 디지털 회로에 입문하고자하는 초보 학습자에게 유용한 콘텐츠가 될 것으로 생각된다.

• 전자공학회논문지T
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• 제36T권1호
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• pp.32-40
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• 1999

함수영역의 데이터를 스펙트럴영역 데이터로 변환시켜주는 스펙트럴 계수를 통해 논리함수의 분석을 할 수 있다. 본 논문에서는 스펙트럴 기술을 통해 MVL 회로에 대해 분석을 수행하였고, MVL회로의 고장분석 및 검출방법을 제안하였다.

• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 2008년도 추계학술대회 논문집 Vol.21
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• pp.82-82
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• 2008

One-dimensional (1D) nanowires have been received much attention due to their potential for applications in various field. Recently some logic applications fabricated on various nanowires, such as ZnO, CdS, Si, are reported. These logic circuits, which consist of two- or three field effect transistors(FETs), are basic components of computation machine such as central process unit (CPU). FETs fabricated on nanowire generally have surrounded shapes of gate structure, which improve the device performance. Highly integrated circuits can also be achieved by fabricating on nano-scaled nanowires. But the numerical and SPICE simulation about the logic circuitry have never been reported and analyses of detailed parameters related to performance, such as channel doping, gate shapes, souce/drain contact and etc., were strongly needed. In our study, NAND and NOT logic circuits were simulated and characterized using 2- and 3-dimensional numerical simulation (SILVACO ATLAS) and built-in spice module(mixed mode).

• 공학교육연구
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• 제6권1호
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• pp.5-14
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• 2003

본 논문에서는 디지털논리회로의 여러 가지 원리를 이해하고 확인해보기 위해 비주얼베이직의 ActiveX 컨트롤을 이용하여 단순화된 웹 기반 디지털 시뮬레이터를 개발하였다. 개발된 디지털시뮬레이터는 디지털 논리회로 학습에 있어 필수적인 기능만이 구현되었으며, 학습자가 스스로 구성한 디지털 회로를 직접 웹상에서 시뮬레이션 해 봄으로써 디지털시스템에 대한 설계 및 해석이 가능하도록 제작되었다. 개발된 디지털 시뮬레이터가 디지털 논리회로에 대한 멀티미디어 컨텐츠와 함께 웹에 제공된다면 교육현장에서 교육보조도구로써 활용이 가능하고 또한 학습효율의 극대화를 이를 수 있으리라 생각된다. 제안된 시뮬레이터의 유효성을 입증하기 위해 몇 가지 디지털 논리회로에 대한 시뮬레이션 결과를 제시하였다.

• 대한전기학회논문지
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• 제33권2호
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• pp.47-55
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• 1984

This paper is concerned with a computer-aided state assignment, that is, coding race-free internal states of asynchronous sequential circuits, and a method for minimizing the combinational network of asynchronous sequential circuits. The FORTRAN version of the peoposed algorithm results in race-free state assignments and reduction of the number of connections and gates with near minimal hardware cost. Some examples are designed by the proposed computer program to illustrate the algorithm in this paper. Finally, results are compared with those of the other methods.

• Progress in Superconductivity
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• 제9권2호
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• pp.157-161
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• 2008

Due to high speed operations and ultra low power consumptions RSFQ logic circuit is a very good candidate for future electronic device. The focus of the RSFQ circuit development has been on the advancement of analog-to-digital converters and microprocessors. Recent works on RSFQ ALU development showed the successful operation of an 1-bit block of ALU at 40 GHz. Recently, the study of an RSFQ analog-to-digital converter has been extended to the development of a single chip RF digital receiver. Compared to the voltage logic circuits, RSFQ circuits operate based on the pulse logic. This naturally leads the circuit structure of RSFQ circuit to be pipelined. Delay time on each pipelined stage determines the ultimate operating speed of the circuit. In simulations, a two junction Josephson transmission line's delay time was about 10 ps, a splitter's 14.5 ps, a switch's 13 ps, a half adder's 67 ps. Optimization of the 4-bit ALU circuit has been made with delay time consideration to operate comfortably at 10 GHz or above.

• 전자공학회논문지C
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• 제34C권12호
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• pp.43-53
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• 1997

In this paper, the optimal synthesis algorithm of multiple-valued logic circuits using universal logic modules (ULM) U$_{f}$ based on 3-variable ternary reed-muller expansions is presented. We check the degree of each varable for the coefficients of reed-muller expansions and determine the order of optimal control input variables that minimize the number of ULM U$_{f}$ modules. The order of optimal control input variables is utilized the realization of multiple-valued logic circuits to be constructed by ULM U$_{f}$ modules based on reed-muller expansions using the circuit cost matrix. This algorithm is performed only unit time in order to search for the optimal control input variables. Also, this algorithm is able to be programmed by computer and the run time on programming is O(p$^{n}$ ).