• 한국철도학회:학술대회논문집
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• 한국철도학회 2008년도 추계학술대회 논문집
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• pp.1988-1998
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• 2008

Performed was a survey to find the level of interest on passenger services using IT and smart sensor technology in connection with High Speed Train development in Korea. The survey respondents were sampled from the KTX passengers, KTX crews, Korail employees, IT or sensor experts, and rolling stock experts. The results of the survey were categorized as importance, urgency/necessity, importance vs urgency/necessity, improvement measure, preferable activities based on the trip length, and inconveniencies. By analyzing the results, service items that can be implemented to the High Speed Train were recognized. The results showed that a passenger tends to expect to have his/her comfort and convenience, an attendant safety and serviceability, a Korail employee information provision and serviceability, an IT/sensor expert technological implementation done, and a rolling stock expert implementation done in practical level.

• 대한전기학회논문지:전기기기및에너지변환시스템부문B
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• 제48권8호
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• pp.426-430
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• 1999

In this paper, a speed sensorless algorithm for a high-speed induction motor is proposed. The proposed algorithm simply estimates rotor speed by integrating the deviation between the command current value of a controller and the real current value of the motor. To estimate rotor speed without a speed sensor, a fuzzy speed controller and a neural network speed estimator are applied. Computer simulation and implementation of the proposed system is described.

• 한국산업정보학회논문지
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• 제19권3호
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• pp.1-7
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• 2014

본 논문은 자동시험장비 (ATE) 시스템의 측정 회로에 사용하는 비교기 설계에 관한 것이다. 이 비교기 전체 블럭은 연속 형의 고속 비교기, 차동차이증폭기, 그리고 출력 단으로 구성되어 있다. 연속 형의 고속 비교기는 높은 주파수(1~800MHz) 및 넓은 범위(0~5V)의 입력신호를 받아들이기 위해, 고속의 rail-to-rail 증폭기를 첫 단에 두었다. 또한 동작 속도를 높이기 위하여 고속의 전치증폭기와 래치를 순차적으로 구성하였다. 두 시험 소자(DUT) 간 출력 신호 차이를 검출함에 있어, 공통 신호와 차동 신호 차이를 모두 감지하기 위하여 차동차이 증폭기(DDA)를 사용하였다. 이 비교기는 $0.18{\mu}m$ BCDMOS 공정을 사용하여 칩으로 구현되었으며, 5mV의 신호 차이를, 800 MHz의 신호까지 비교가 가능하다. 구현된 칩 면적은 $620{\mu}m{\times}830{\mu}m$이다.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2000년도 추계종합학술대회 논문집(1)
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• pp.275-278
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• 2000

As the operating frequency of digital modules in network system becomes fast, integrity of signals between modules is regarded as a important factor in high speed system design. To guarantee the signal integrity, many factors that deteriorate quality of signal should be considered. In this paper, we survey many factors which be considered while in designing and imp]ementing the backplane for high speed router and analyze the simulation result and experimental result.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2003년도 하계종합학술대회 논문집 V
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• pp.2637-2640
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• 2003

In this paper, we propose a simple and efficient data input/output block with high speed between Motorola MPC8XX microprocessor and memory devices. Proposed method is capable of high speed data read and write using the address decoder and the burst cycle between Motorola PowerPC based MPC8XX microprocessor and fixed address locating memory devices such as FIFO, PCMCIA card, and so on. Experimental results are given our findings and discussions.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1997년도 추계학술대회 논문집 학회본부
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• pp.623-625
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• 1997

This paper deals with the simulator for the diagnosis systems of high speed train. The purpose of this simulator is the verification of diagnosis systems. In this paper, the configuration of high speed train is investigated and the implementation model of power car is proposed. According to the model, mathematical equation is constructed. Dynamic simulation is executed and analyzed.

• 한국통신학회논문지
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• 제33권11B호
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• pp.1020-1029
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• 2008

본 논문은 네트워크 침입 탐지 시스템에서 고속 패턴 매칭 알고리듬과 그 구조를 제안한다. 제안된 알고리듬은 실시간 입력 패킷에서 특정 패턴을 검사하며 정확한 문자열, 문자열 값의 범위, 그리고 문자열 값의 조합 등을 검색한다. 본 연구에서는 입력 패킷과 패턴은 동시에 겹치는 문자열들을 검색하기 위해 상태 전이 그래프로 모델링 하였으며 상태 전이 그래프는 구현 복잡도를 줄이기 위해 입력 임플리컨트 단위로 분할하였다. 제안된 패턴 매칭구조는 상태 전이 그래프와 입력된 문자열을 입력으로 사용한다. 제안된 패턴 매칭기는 VHDL 언어로 모델링하여 구현하였으며, 성능 분석을 통하여 제안된 기법의 적절성을 검증하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2008년도 제39회 하계학술대회
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• pp.948-949
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• 2008

In this paper, an effect on power conversion unit in next generation high-speed train by loss of contact between a contact wire and pantograph supplied electrical power to high-speed train are investigated. One of the most important needs accompanied by increasing the speed of high-speed train is reduced that arc phenomenon by loss of contact brings out EMI. To analysis of conducted EMI source on powering mode of next generation high-speed train, it is necessary electrical modeling system between the contact wire and the pantograph according with loss of contact. Therefore analytical model of a contact wire and a pantograph is constructed to simulate the behaviour of loss of contact. The reliability of the modeling system is verified by simulation implementation on loss of contact.

• Journal of electromagnetic engineering and science
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• 제6권3호
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• pp.147-154
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• 2006

In this paper, we propose and present implementation results of a high-speed turbo decoding algorithm. The latency caused by (de) interleaving and iterative decoding in a conventional maximum a posteriori(MAP) turbo decoder can be dramatically reduced with the proposed design. The source of the latency reduction is come from the combination of the radix-4, dual-path processing, parallel decoding, and rearly-stop algorithms. This reduced latency enables the use of the turbo decoder as a forward error correction scheme in real-time wireless communication services. The proposed scheme results in a slight degradation in bit-error rate(BER) performance for large block sizes because the effective interleaver size in a radix-4 implementation is reduced to half, relative to the conventional method. Fixed on the parameters of N=212, iteration=3, 8-states, 3 iterations, and QPSK modulation scheme, we designed the adaptive high-speed turbo decoder using the Xilinx chip (VIRTEX2P (XC2VP30-5FG676)) with the speed of 17.78 Mb/s. From the results, we confirmed that the decoding speed of the proposed decoder is faster than conventional algorithms by 8 times.

• 한국통신학회논문지
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• 제34권8C호
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• pp.801-805
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• 2009

컴퓨터 네트워크의 지속적인 보급과 멀티미디어에 대한 수요의 급증은 화상 회의 등의 새로운 수요에 대응 할 수 있는 초고속 근거리 통신망의 중요성을 부각시키고 있다. 이러한 초고속 근거리 통신망의 구현을 위해서는 연결된 컴퓨터들 간의 데이터 전송이 지연 없이 실시간으로 수행될 수 있도록 동기화시키는 것이 매우 중요하다. 네트워크상의 모든 컴퓨터들이 거의 같은 주기의 클럭을 사용할 경우, 데이터 정체를 최대한 줄일 수 있는 장점이 있는 반면, 송신단으로부터의 데이터를 수신단에서 받아들일 때 비동기 데이터 샘플링에 의한 준안정성 문제가 발생할 수 있기 때문에 그에 대한 해결을 위한 신축 버퍼가 필요하며, 본 논문에서는 고속 동작용 신축버퍼의 구현에 대해 논의한다.