• 방송공학회논문지
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• 제10권1호
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• pp.31-42
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• 2005

ATSC(Advanced Television Systems Committee) DTV(Digital Television) 시스템은 주파수 동기획득에 FPLL(Frequency and Phase Lock Loop)을 사용한다. FPLL은 오직 파일럿 신호만을 이용하기 때문에 파일럿 크기가 작을수록 주파수 수렴범위가 좁아지고 수렴속도가 늦어진다. 또한 파일럿 주위의 스펙트럼 모양에 따라서 양과 음의 주파수 오프셋에 대한 수렴범위에 비대칭성이 나타난다. 본 논문은 주파수 수렴범위의 비대칭성을 극복하고, 파일럿 왜곡 시에도 주파수 동기를 획득하도록 만들기 위해 VSB(Vestigial Sideband) 스펙트럼 양끝에 필터를 설치하고, 이 필터를 통과한 신호의 전력량을 이용하는 알고리즘을 제안한다. 제안한 알고리즘을 사용함으로써 비대칭적으로 좁아지는 수렴범위의 문제점과 파일럿 왜곡에 따른 성능 열화를 보완할 수 있다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2002년도 가을 학술발표논문집 Vol.29 No.2 (3)
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• pp.1-3
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• 2002

백본 라우터에서의 최장 길이 프리픽스 검색(LPM: Longest Prefix Matching) 속도를 향상시키기 위해 활발히 연구된 방식들은 계산 량과 사용 메모리 량을 교환하는 방식들이다. 이러한 방식들은 성능향상을 위해서 대용량의 포워딩 테이블(Forwarding Table)을 캐쉬(Cache)에 저장할 수 있는 소용량 인덱스 테이블(Index Table)로 압축함으로써 고속 캐쉬 접근 회수와 그 계산량은 증가하는 대신 저속 메모리 접근 회수를 줄이는 방식이다.〔1〕본논문에서는 저속 메모리 사용량이 증가하는 반면 저속 메모리의 접근 빈도와 계산량을 동시에 감소시키는 FPLL(Fixed Prefix Length Lookup) 방식을 소개한다. 이 방식은 포워딩 엔트리(Entry)들을 프리픽스의 상위 비트(Bit)에 의해 그룹으로 나누고, 각 그룹에 속하는 엔트리들을 같은 길이로 정렬한다. FPLL에서의 LPM검색은 목적지 주소가 속하는 그룹들의 길이를 계산하여 검색할 최장 프리픽스의 길이를 미리 결정하고, 결정된 프리픽스를 키(key)로 하여 해시 테이블(Hash Table)로 구성된 포워딩 테이블에서 완전 일치(Exact Matching) 검색을 한다. 완전 일치 검색을 위해 같은 그룹에 속한 엔트리들을 정렬할 필요가 있는데 이 정렬을 위해 여분의 포워딩 테이블 엔트리가 생성된다. 3만개 엔트리를 갖는 Mae-West〔2〕 경우에, FPLL방식은 12만개 정도의 여분의 엔트리가 추가로 생성되는 대신에 1번 캐쉬 접근과 O(1)의 복잡도를 갖는 해시 테이블 검색으로 LPM 검색을 수행한다.

• 한국방송∙미디어공학회:학술대회논문집
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• 한국방송공학회 2004년도 정기총회 및 학술대회
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• pp.123-127
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• 2004

지상파 디지털 TV 방식 중의 하나인 ATSC 8-VSB방식은 전송된 데이터 중 유효 데이터의 비율이 높고 채널이 좋은 경우 동기 및 등화 과정이 간단한 장점이 있지만, 실내수신이나 이동수신 환경에서는 동기 및 등차 과정이 어려운 단점이 있다. 현재 주파수 동기에는 FPLL 알고리즘을 이용하고 있는데, 파일롯의 위치에서의 좌우 스펙트럼의 비대칭 및 채널 환경에 따른 파일롯 신호의 감쇄가 발생하여 양의 주파수 옵셋이 발생했을 때에 비해 음의 주파수 옵셋이 발생했을 때의 동기획득이 어려운 단점이 있다. 본 논문은 파일롯 추출필터와 인접된 필터를 통과한 신호의 파워비율을 이용하여 얻은 제어신호를 이용하여, 기존 FPLL의 동작 범위를 넓힘과 동시에 수렴속도를 빠르게 할 수 있는 방법을 제안하였다.

• 대한전기학회논문지:시스템및제어부문D
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• 제55권12호
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• pp.526-533
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• 2006

In this paper, we presented the synchronization module between RF shower system and RFID Reader to extend interrogating range on Mobile RFID system, Costas Loop and FPLL(Frequency/phase Lock Loop) were used. We achieved compromised range of 3MHz locking frequency, 1ms locking time and figured out remarkable Hopping frequency of the Reader. The prototype of the new designed RFID system has been tested with ISO18000-6 type-B Tag. The read range between designed RFID Reader and Tag has been measured, it increased triple times by adjusting the Shower system output level.

• 전자공학회논문지S
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• 제35S권12호
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• pp.1-7
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• 1998

본 논문에서는 10Gb/s 클럭/데이터 재생회로의 설계와 제작된 특성에 대해 기술한다. 회로는 알루미나 기판 위에 고속 IC와 초고주파 회로를 이용하여 구현하였다. 주파수와 위상 잠금(frequency and phase locked loop)을 위해 quadri-correlation 방법을 이용하였다. 주파수 잠금 범위는 150MHz 였으며 발생된 rms 지터는 1.0ps 이하였다. 이러한 클럭/데이터 재생회로를 10Gb/s광수신기에 적용하여 동작특성을 확인할 수 있었다.

• 한국통신학회논문지
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• 제23권9A호
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• pp.2197-2210
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• 1998

In the grand alliance (GA) HDTV receiver, a coherent detection is empolyed for coherent demodulation of vestigial side-band (VSB) signal by using frequency and phaselocked loop(FPLL) operating on the pilot carrier. Additional phase tracking loop (PTL) employed to track out phase noise that has not been removed by the FPLL in theGA system. In this paper, we propose an algorithm for phase detection which utilizes a weighting function. The simplest implementation of the proposed algorithm using te sign of the Q channel component can be tractable by imposing a phase detection gain to the loop gain. It is obserbed that the propsoed algorithm has a robust characteristic against the performance of the digital filters used for Q channel estimation. A second goal of this paper is to introduce a gain control algorithm for the PTL in order to provide an effective implementation of the proposed phase detection algorithm. And we design the PTL through the realization of the simplified digital filter for H/W reduction. The proposed algorithms and the designed PTL are evaluated by computer simulation. In spite of using the simplified H/W structure, simulation results show that the proposed algorithms outperform the coventional PTL algorithms in the phase detection and tracking performance.

• 한국통신학회논문지
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• 제22권8호
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• pp.1774-1781
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• 1997

본 논문은 잔류 측대파(vestigial sideband; VSB) 변조를 이용한 CATV 및 HDTV에서 주파수 및 위상 동기 루프 (frequency & phase lock loop; FPLL)의 완전 디지털 구현을 위한 알고리듬과 하드웨어 구조를 제안한다. 미국의 대연합(Grand-Alliance)에서 제안된 VSB 변조를 위한 CATV 및 HDTV 수신기는 아날로그 신호처리를 통하여 반송파 복구를 수행한다. 그러므로 향후 단열 칩 ASIC 개발에 상당한 부담을 주는 구조이다. 본 논문에서는 VSB 변조 방식의 이러한 문제점을 해결하기 위하여 수신된 신호를 기저 대역 근처의 IF 신호로 떨어뜨린 후 아날로그-디지털(AD) 변환을 통하여 모든 신호처리를 디지털 영역에서 할 수 있는 FPLL 구조를 제안한다. 제안된 시스템은 주파수 풀-인(pull-in) 영역이 -200KHz- +250KHz 정도의 우수한 성능을 보여준다. 그리고 위상 잡음의 영향을 최소화 하면서 빠른 포착 성능을 유지하기 위하여 루프 필터의 대역폭을 적응적으로 가변하는 특징을 가진다.

• 한국통신학회논문지
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• 제30권9A호
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• pp.858-866
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• 2005

본 논문에서는 ATSC 지상파 DTV 시스템에서 스펙트럼 상관관계를 이용한 주파수 동기 방법을 제안한다. 파일럿 신호를 이용하는 기존 알고리즘은 다중경로와 이동수신 환경에 의해 파일럿 주변의 스펙트럼 왜곡이 심하면 주파수 옵셋 추정 오류가 발생한다. 제안하는 알고리즘은 파일럿을 사용하지 않고 기준 스펙트럼과 수신된 스펙트럼 사이의 상관관계를 이용하여 주파수 동기를 획득하기 때문에 기존의 동기 방식에 비해 빠르고 정확하게 주파수 동기를 획득할 수 있다. 또한 파일럿을 사용하지 않는 새로운 ATSC 주파수 동기 방식을 제시한다.