본 연구에서는 HVPE법으로 사파이어 기판(0001) 위에 성장시킨 GaN epilayer의 etching에 따른 표면변화 특성을 조사하였다. 주사전자 현미경(SEM) 관찰 결과, 3가지 형태를 갖는 육각형 모양의 etch pit(edge, screw, mixed) 들이 GaN epilayer의 두께 변화에 따라서 형성되었다. 이러한 관통전위들은(TDs) epilayer의 두께가 얇고, etch pit density가 높을수록 screw and mixed type TDs이 많이 관찰되었고, 두께가 증가할수록 etch pit density가 낮아지면서 edge and mixed type TDs들이 주로 존재하는 것을 관찰 할 수 있었다.
The defect structure in LiNbO3 single crystals grown by Czochralski method from the congruently melting composition were investigated. Chemical etching patterns were studied in x-plane, z-plane, and major cleavage plane, respectively, dislocation density was higher at the periphery of crystals than at the center because the thermal stress due to radial temperature gradient had a main effect on it, as compared with dislocations formed from the solid-liquid interface. Many dislocation lineages were arranged along several directions.
Influence of electrochemical etching conditions on capacitance gain of aluminium electrolytic on capacitor foil has been investigated by etching cubic textured high purity aluminum foil in dilute hydrochloric acid. Uniformly distributed etch pit tunnels on aluminum surface have been obtained by pretreatment aluminium foil in 10% NaOH solution for 5 minutes followed by electrochemical etching. Electrostatic capacitance of etched aluminium foil anodized to high voltage increased with the increase of current density, total charge, temperature and concentration of electrolyte up to maximum CV-value and then deceased. Election optical observation of the etched foil revealed that the density of etch of etch pits increased with the increase of current density and concentration of electrolyte. this increase of etch pit density enlarged of the increase of capacitance. However, abnormal high current density and high electrolyte concentration induced the local dissolution of the foil surface which resulted the decrease of foil capacitance.
수소화기상증착에피탁시로 성장된 GaN 단결정의 표면 특성을 정밀하게 측정하기 위해, 용융 KOH/NaOH 습식화학에칭법을 적용하였다. KOH/NaOH 습식화학에칭법에 에칭속도는 기존의 황산, 인산과 같은 etchant에 비해 느린데, 이는 불용성 코팅층의 형성에 의한 것이다. 따라서 이 방법으로 etch pits density를 더 효율적으로 평가할 수 있었다. 성장된 GaN 단결정을 XRD(X-Ray Diffraction), XRC(X-ray rocking curve)로 결정성을 분석하였으며, 에칭 특성과 표면 형상은 주자전자현미경을 이용하여 관찰하였다. 에칭 실험 결과 격자결함들이 독립적으로 잘 분리되어 있고 그들의 형태가 명확하게 나타나는 최적 에칭 조건은 $410^{\circ}C$, 25분이었다. 이 조건에서 얻은 결함밀도 값은 $2.45{\times}10^6cm^{-2}$이었으며, 이는 상업적으로 이용 가능 한 정도의 재료임을 확인할 수 있었다.
알루미늄의 부식에 있어서 HCI 용액내에 황산을 첨가하는 경우 황산이온의 화학적 흡착에 의한 부식억제 효과가 나타나며, CV (cyclic voltammetry) 실험결과 황산이온은 핏트내부에 보호성 산화피막을 생성함으로서 에치핏트가 핏트내부와 알루미늄 표면에 함께 생성되어 핏트의 밀도가 증가하였다. 알루미늄 교류에칭시에 핏트분포는 황산이온의 농도와 환원전류량에 의하여 크게 영향을 받으며, 환원전류인가시 $0.8mC/cm^2$ 이하의 전하량에서 핏트내부에 생성된 산화피막은 황산이온 농도의 증가에 따라 핏트발생에 대한 저항성이 중가하였으나, $0.8mC/cm^2$ 이상에서는 산화피막내에 국부적인 구조변화가 발생하며 황산이온 농도에 관계없이 산화피막의 파괴가 빠르게 진행되었다.
This study shows the effects of deionized (DI) rinse and oxide HF wet etch processes on silicon substrate during a photolithography process. We found a fail at the wafer center after DI rinse step, called Si pits, during the fabrication of a complementary metal-oxide-semiconductor (CMOS) device. We tried to find out the mechanism of the Si pits by using the silicon wafer on CMOS fabrication and analyzing the effects of the friction charge induced by the DI rinsing. The key parameters of this experiment were revolution per minute (rpm) and time. An incubation time of above 10 sec was observed for the formation of Si pits and the rinsing time was more effective than rpm on the formation of the Si pits. The formation mechanism of the Si pits and optimized rinsing process parameters were investigated by measuring the charging level using a plasma density monitor. The DI rinse could affect the oxide substrate by a friction charging phenomenon on the photolithography process. Si pits were found to be formed on the micro structural defective site on the Si substrate under acceleration by developed and accumulated charges during DI rinsing. The optimum process conditions of DI rinse time and rpm could be established through a systematic study of various rinsing conditions.
고순도의 알루미늄 호일은 전기화학적 에칭을 통해 표면적을 증가시킨 후 전해 커패시터의 양극으로 사용된다. 그러나 산화 피막의 결함 및 에치 피트의 불규칙 생성에 의해 성장된 에치 피트의 분포는 불균일하며 이러한 불균일 형태는 알루미늄 넓은 표면적 분포에도 불구하고 여러 형태의 적용을 어렵게 만든다. 본 연구에서는 알루미늄의 선택적 에칭을 위해 포토리소그래피 방법으로 제작된 패턴 마스크를 사용하여 알루미늄 표면에 균일성을 갖는 보호층을 형성시켰다. 균일한 패턴을 갖는 알루미늄을 용액의 온도 및 전류밀도 등의 조건을 변경하여 실험하였고, 알루미늄 표면에 다양한 크기($2{\sim}5{\mu}m$)의 균일성을 갖는 에치 피트의 형성을 확인할 수 있었다.
본 논문에서는 인산을 이용하여을 인산을 이용하여 nGaN을 습식식각 할때의 표면식각 진행 특성을 조사 하였다. 인산을 이용한 고온에서의 식각은 diffusion rate limited regime을 통하여 이루어짐을 확인 하였으며, 또한 초기식각은 lateral 크기가 $20{\mu}m$에서 $5{\mu}m$ 정도인 bimodal 형태의 hexagonal 모양의 hole과 pits이 형성되며, 식각이 진행됨에 따라 표면에 형성된 hexagonal hole 등이 적층구조로 형성되거나 혹은 laterally 병합되며 식각됨을 관찰 하였다. 또한 PL 분석을 통하여 표면 거칠기 증가로 인한 extraction efficiency의 향상도 관찰할 수 있었다. 이러한 결과로부터 인산을 이용한 습식식각을 통하여 GaN의 표면 texturing 공정이 이용 가능할 수 있을 것으로 예상 된다.
The InP crystals have been grown by modified synthesis solute diffusion (SSD) method and its properties have been investigated. The crystals have been grown by lowering the crucible quartz for growth in the furnace and crystal growth rate is 1.8mm/day. The lattice constant a. of the grown crystals is 5.867.angs.. Etch pits density along growth direction of crystal changes from 3.0*10.sup 3/cm$\^$-2/ of first freeze part to 6.7*10$\^$4/cm$\^$-2/ of last freeze part and the radial direction of wafer shows nearly uniform distribution. The resistivity and the carrier concentration of the grown crystals are 1.43*10$\^$-1/.ohm.-cm, 7.7*10$\^$15/cm$\^$-3/ at room temperature, respectively. In the photolurninescence at 10K, the radiation transitions are observed by the near band edge recombination, a pair recombination due to Si donor - Zn acceptor and its phonon replica in the InP. The activation energy by Zn diffusion in undoped n-InP crystals is 1.22eV.
Since sapphire single crystal is one of the materials that have excellent mechanical and optical properties, the single crystal is widely used in various fields, and the demand for the use of substrate of LED devices is increasing rapidly. However, crystal defects such as dislocations and stacking faults worsen the properties of the single crystal intensely. When sapphire wafer of single crystal is used as LED substrate, especially, crystal defects have a strong influence on the characteristics of a film deposited on the wafer. In such a case quantitative assessment of the defects is essential, and the evaluation technique is now becoming one of the most important factors in commercialization of sapphire wafer. Wet etching is comparatively easy and accurate method to estimate dislocation density of single crystal because etching reaction primarily takes place where dislocations reached crystal surface which are chemically weak points, and produces etch pit. In the present study, the formation behavior of etch pits and etching time dependence were studied systematically. Etch pit density(EPD) analysis using optical microscope was also conducted and measurement uncertainty of EPD was studied to confirm the reliability of the results. EPDs and measurement uncertainties for 4 inch sapphire wafers were analyzed in terms of 5 and 21 points EPD readings. EPDs and measurement uncertainties in terms of 5 points readings for 4 inch wafers were compared by 2 organizations. We found that the average EPD value in terms of 5 points readings for a 4 inch sapphire wafer may represent the EPD value of the wafer.
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[게시일 2004년 10월 1일]
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