이중대역에서 동작하는 브랜치 라인 커플러를 나타낸다. 새로운 설계 구조에서는 단락 스터브가 병렬로 추가된 전송선로가 2개의 주파수에서 $90^{\circ}$의 위상 천이를 구현하기 위하여 사용된다. 제안하는 브랜치 라인의 특성 임피던스와 전기적 길이는 종래의 구조와 비교하여 조정된다. ABCD 행렬 파라미터를 이용하여 설계 방정식을 유도하였다. 설계 개념을 검증하기 위하여 0.8 GHz 및 1.85 GHz에서 동작하는 마이크로스트립 커플러를 제작하고 측정하였다.
본 논문은 비선형 위상 특성을 갖고 있는 CRLH 전송선로를 이용하여 이중대역 평형 믹서를 제안한 것이다. 이 메타 재질 구조의 믹서는 이중대역에서 낮은 LO 누설 전력과 높은 RF-LO 고립도를 갖고 있어, LO와 RF 경로에 추가적인 여파기가 필요하지 않는다. 이 평형 믹서는 이중대역에서 동작하는 발룬과 윌킨슨 분배기를 이용하여 구현하였으며, 이중대역 특성은 CRLH 전송선로의 비선형 위상 특성을 이용하였다. 제안한 메타 재질을 이용한 평형 믹서는 실험을 결과를 통해서 증명하였으며, 870 MHz와 1660 MHz의 주파수에서 동작하도록 제작하여, 870 MHz에서 15.2 dB, 1660 MHz에서 21.2 dB의 변환 손실을 얻었다.
본 논문에서는 이중 대역 대역 통과 여파기 설계에 이용 가능한 가변 특성 임피던스 전송 선로의 응용을 제시하였다. 제안된 여파기는 고정된 첫 번째 통과 대역과 가변 가능한 두 번째 통과 대역을 갖는다. 스터브 부하공진기(Stub Loaded Resonator: SLR)는 직렬 공진기와 개방 단락 스터브로 구성되는데, 개방 단락 스터브를 결함 접지 구조(Defected Ground Structure: DGS) 전송 선로와 바랙터 다이오드로 구현함으로써 두 번째 통과 대역의 조정이 가능하다. 제안된 구조의 타당성을 보이기 위해 3개의 전송 영점을 갖는 2단 이중 대역 대역 통과 여파기를 설계하였고, 이론적인 예측값과 시뮬레이션 결과를 실험적으로 증명하였다.
Tangjitjesada, M.;Anantrasirichai, N.;Wakabayashi, T.
제어로봇시스템학회:학술대회논문집
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제어로봇시스템학회 2003년도 ICCAS
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pp.1668-1671
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2003
A novel dual-frequency microstrip printed-dipole antenna operating at 5 GHz and 10 GHz is presented. This antenna is designed for wireless and mobile communication. The balance step coplanar strip is used to be a transmission line at the center of dipole with matching impedance at 50 ohm. Using the conductor strip align on the other side of antenna and adjust the width of step coplanar strip line to improved input impedance matching. By modification for matching impedance of dual frequency antenna are not affected to the radiation patterns. The Finite Difference Time Domain (FDTD) technique is applying to analyze the basic characteristic properties such as $S_{11}$ , input impedance , VSWR and radiation patterns. And these parameters are discussed. The analyze problem space are $51{\times}197{\times}175$ cells and cell dimension are ${\Delta}x=0.3\;mm$ and ${\Delta}y={\Delta}z=0.15\;mm$.
The ZigBee communication method, which is the most frequently applied to the LED lighting control system, has drawbacks of low-speed and low-capacity, and the communication failure possibility due to environmental influences is on the rise. Therefore, it is important to secure the communication reliability by applying an integrated interface with a wire-wireless dual-network. This paper developed a communication module, which has a platform converging and combining the ZigBee of USN environments with the PLC of power line communication environments, to implement a dualized communication interface system supporting the wire-wireless integrated protocol, and implemented a wire-wireless networking device and a control system software technology. As a result, it was automatically switched into the PLC communication within 4.4 seconds on average when there was an access failure in the ZigBee communication network, so a reliable communication network was built.
본 논문에서는 음의 투자율(negative values permeability)을 가지는 CSRR(: Complementary split ring resonator)를 안테나의 그라운드면에 적용하여 이중대역에서 사용가능한 마이크로스트립 패치안테나를 최적설계하였다. SRR의 음각형태인 CSRR을 안테나의 급전선 뒷면에 배치하여 대역저지특성을 만들고 이를 이용해서 위성통신에 사용하는 L-band의 두주파수 f1(1.53GHz), f2(1.63GHz)에서 사용가능한 안테나를 제안하였다. 제안한 안테나는 마이크로스트립라인을 이용하여 배열이 가능하고 기존의 패치안테나에 비해 소형으로 제작이 가능하다. 제작된 안테나는 f1과 f2에서 각각 -12.5dB, -14.5dB의 입력반사계수와 2.0dB, -0.8dB의 이득을 얻을 수 있어 이중대역에서 충분한 성능을 나타내는 것을 확인하였다.
최근, 무선통신 시스템의 발전으로 다중대역을 위해 광대역에서 동작하는 회로들이 소개되었다. 하지만 광대역에서 동작하는 회로들은 필연적으로 크기가 증가하는 단점이 있다. 이중대역에서 동작하는 회로는 원하는 두 주파수에서만 동작하기 때문에 불필요한 소자들의 감소로 소형화가 가능하다. Wilkinson 전력 분배기는 무선통신시스템에서 전력분배를 위해 일반적으로 사용되는 소자로써, 이 또한 최근 이중대역이 요구되어지고 있다. 본 논문에서는 IEEE 802.11n WLAN을 위하여 2.45GHz와 5.2GHz에서 동작하는 소형화된 이중대역 Wilkinson 전력 분배기를 제안한다. 제안된 Wilkinson 전력 분배기는 일반적인 Wilkinson 전력분배기의 ${\lambda}$/4파장 부분을 ${\pi}$-형 병렬 스터브라인으로, 전기적 길이와 임피던스를 변환하여 수행되었다.
본 논문에서는 전압제어지연단(Voltage Controlled Delay Line : VCDL)을 이용하여 기존의 위상고정루프와 다른 형태의 위상 지연고정루프(Phase Delay Locked Loop)를 제안하였다. 이 구조를 이용하여 기존의 위상고정루프의 2차 또는 3차 루프필터(Loop Filter)를 단하나의 커패시터로 구현하여 칩의 크기를 크게 줄였다. 새로이 제안하는 듀얼루프 위상 자연고정루프에서는 전압제어지연단 경로의 커패시터와 전하펌프의 전류 크기를 조절함으로서 작은 이득 값을 가지는 전압제어지연단을 사용할 수 있다. 제안된 회로는 $0.18{\mu}m$ CMOS 공정의 파라미터를 이용하여 Hspice로 시뮬레이션을 수행하고 회로의 동작을 검증하였다.
본 논문은 배터리를 사용하는 휴대 기기용 LCD driver IC를 위한 전류원 스위칭에 의한 저전력 듀얼레벨 저전압 차동신호 전송(DLVDS) 회로를 제안한다. 제안된 송신기는 기존의 DLVDS 회로의 송신기의 신호생성 방법을 개선하여 기존의 전송선 감소의 장점을 유지하면서 전력소모를 현저히 감소시켰다. 또한 개선된 신호생성 방법의 개선으로 인하여 디코딩이 변경되어 수신기 회로가 더 간단해졌다. 제안된 회로는 2.5V의 전원을 갖는 $0.25{\mu}m$ CMOS 공정으로 설계 되었다. 제안된 회로의 시뮬레이션 결과는 800Mbps/2-line의 전송률, 송신기는 9mW, 수신기는 11.5mW의 전력소모를 나타내었으며, 기존의 DLVDS와 비교하여 약60% 전력소모가 감소했다.
Ninahuanca, Jose Luis Hinostroza;Tormena Jr., Osmar;Meloni, Luis Geraldo Pedroso
ETRI Journal
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제43권6호
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pp.978-990
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2021
This article presents techniques for improved estimation of symbol timing offset (STO) and carrier frequency offset (CFO) for dual-polarization (DP) orthogonal frequency division multiplex (DP-OFDM) systems. Recently, quaternion multiple-input multiple-output OFDM has been proposed for high spectral efficiency communication systems, which can flexibly explore different types of diversities such as space, time, frequency, and polarization. This article focuses on synchronization techniques for DP-OFDM systems using a cyclic prefix, where the application of quaternion algebra leads to new improved estimators. Simulations performed for DP system methods show faster reduction of STO estimator variance with a double-slope line in the logvariance line versus signal-to-noise ratio (SNR) plot compared with singlepolarization (SP) counterparts, and simulations for CFO estimates show a 3-dB gain of DP over SP estimates for same SNR values defined, respectively, for quaternion-valued or complex-valued signals. Cramer-Rao bounds for STO and CFO are derived for the synchronization methods, correlating with the observed gains of DP over SP OFDM systems.
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[게시일 2004년 10월 1일]
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