자기부유기는 전자력을 이용해서 자성재료를 공중에 떠있게 할 수 있는 장치로 고속회전기에 사용되는 자기 베어링과 자기 부상 열차의 부상원리 등에 응용될 수 있다. 하지만 자기 부유기는 근본적으로 비선형이며 불안정한 시스템으로서 제어에는 많은 어려움이 따른다. 본 논문에서는 비선형 시스템인 자기부유기를 국부적으로 선형화해서 모델링하고, 가변 위치 제어를 수행할 수 있도록 비례미분 위치제어기를 설계하였다. 또한 PWM 컨버터와 DSP기반 제어보드를 이용한 자기 부유기를 제작하고, 시뮬레이션과 실험을 통하여 위치제어 응답성능을 검증하였다.
본 논문은 시각 장애인들을 위해 영상처리 기반의 숫자-자동 점자 변환기의 설계 및 구현에 관한 내용을 기술한다. 영상처리 기반의 숫자-점자 변환 알고리즘은 카메라로 획득한 입력 영상을 이진 영상화 한 다음, 문자 영역을 팽창과 라벨링 연산을 수행하고 저장되어 있는 문자 패턴 영상과 상호 상관도를 계산하여 해당되는 점자로 변환한다. 컴퓨터 시뮬레이션을 통하여 제안한 알고리즘을 모의실험한 결과, A4 용지에 인쇄된 숫자(0-9)에 대하여 91.8% 변환 성공률을 보여 주었고, DSP 영상처리 보드에 구현한 시제품 시험을 통하여 90% 변환 성능을 확인함으로서 구현된 숫자-자동 점자 변환기의 실용화 가능성을 확인하였다.
본 연구에서는 Texas Instruments 사의 저가형 부동소수점 디지털 신호 처리기 (Digital Singnal Processor, DSP)인 TMS320C32를 이용하여 실시간 화자종속 음성인식 하 드웨어 모듈(VR32)을 개발하였다. 하드웨어 모듈의 구성은 40MHz의 TMS320C32 DSP, 14bit 코덱인 TLC32044(또는 8bit μ-law PCM 코덱), EPROM과 SRAM 등의 메모리와 호 스트 인터페이스를 위한 로직 회로로 이루어졌다. 뿐만 아니라 이 하드웨어 모듈을 PC사에 서 평가해보기 위한 PC 인터페이스용 보드 및 소프트웨어도 개발하였다. 음성인식 알고리 즘의 구성은 에너지와 ZCR을 기반으로 한 끝점검출(Endpoint Detection) 침 10차 가중 LPC 켑스터럼(Weighted LPC Cepstrum) 분석이 실시간으로 이루어지며 이후 Dynamic Time Warping(DTW)를 통하여 최고 유사 단어를 결정하고 다시 검증과정을 거쳐 최종 인식을 수행한다. 끝점검출의 경우 적응 문턱값(Adaptive threshold)을 이용하여 잡음에 강인한 끝 점검출이 가능하며 DTW 알고리즘의 경우 C 및 어셈블리를 이용한 최적화를 통하여 계산 속도를 대폭 개선하였다. 현재 인식률은 일반 사무실 환경에서 통상 단축다이얼 용도로 사 용할 수 있는 30 단어에 대하여 95% 이상으로 매우 높은 편이며, 특히 배경음악이나 자동 차 소음과 같은 잡음환경에서도 잘 동작한다.
SDR(Software Defined Radio) 기술은 RF 및 IF를 신호처리를 위한 고성능 디지털 신호처리 소자를 기반으로 하드웨어 수정 없이 모듈화 되어 있는 통신 플랫폼을 이용하여 소프트웨어 변경만으로 단일의 송수신 시스템을 통해 다수의 무선 통신 규격을 통합 수용하기 위한 무선 접속 기반 기술이다. 다양한 복합 네트워크 환경 하에서 구성될 다양한 통신 시스템은 각각의 무선 네트워크들 간의 쉽고 빠른 인터페이스를 보장하기 위해 재구성 가능한 SDR개념 기반의 통신 플랫폼이 요구된다. 본 논문은 이러한 SDR 기반의 플랫폼 구현을 위해 TMS320C6713 CPU를 이용한 DSP 보드, IF 신호처리를 위한 FPGA 보드와 무선랜 대역의 RF 송수신기가 결합된 형태의 통신 플랫폼을 설계 및 제작하였다. 또한, 제작된 플랫폼을 이용하여 다양한 통신방식(BPSK, QPSK, 16QAM)을 적용함으로서, 재구성 가능한 통신 단말 플랫폼의 구현을 확인하였다.
H.264/AVC의 스케일러블확장 표준인 SVC(Scalable Video Coding)는 하나의 비트스트림으로 다양한 공간, 시간, 화질 계층의 비디오를 제공할 수 있는 컨버전스용 코덱이다. 최근, 감시 비디오, 모바일 방송 등에 활용하기 위한 실시간 SVC 코덱 개발이 진행되고 있다. 본 논문은 임베디드 DSP 기반의 H.264/SVC 복호기의 설계 및 구현을 기술한다. 본 연구에서는 PC 환경에서 실시간 최적화된 OSD(Open SVC Decoder)의 구조와 복잡도를 분석하고, 이를 이용하여 TI사의 Davinci EVM(Evaluation Module) 보드에 실시간 SVC 복호기를 구현하였다. 구현된 H.264/SVC 복호기는 QCIF, CIF급 해상도는 50Hz 이상, SD는 15Hz까지 실시간으로 복호화할 수 있음을 확인하였다.
소형 Radio Frequency 추적레이다는 표적에 대하여 전천후 Radio Frequency 신호 처리를 통하여 표적을 식별하고 주요 표적에 대하여 표적을 탐색, 탐지하여 추적하는 Radio Frequency 센서를 보유한 추적시스템이다. 본 논문에서는 전천후 Radio Frequency를 이용하여 표적 정보를 획득하여 실시간 신호처리를 통하여 표적을 식별하기 위한 고속의 멀티코어 DSP인 TMS320C6678과 XILINX FPGA(Field Programmable Gate Array)가 탑재된 보드 개발의 내용을 설명한다. DSP, FPGA 선정과 신호처리를 위한 DSP-FPGA 결합 아키텍처에 대하여 제안하고 또한 고속의 데이터 전송을 위한 SRIO의 설계에 대하여 설명한다.
본 논문에서는 TTIB SSB 방식을 이용한 협대역 이동통신시스템에서 페이딩 보상 시스템의 설계 및 구현에 관한 연구를 수행하였다. 다중경로 페이딩 갖는 이동통신채널은 무선통신시스템의 성능을 필연적으로 제한하게 한다. 이러한 다중경로 페이딩은 TTIB SSB 방식에서 파일럿 톤을 이용하여 보상할 수 있다. DSP(digital signal processor)를 이용하여 TTIB SSB 송 ${\cdot}$ 수신기를 구현하였으며 또한 페이딩 보상은 DSP 알고리즘 형태로 수신기에 구현하였다. TTIB SSB 송 ${\cdot}$ 수신기에서 페이딩 보상 성능을 평가하기 위하여 먼저 시뮬레이션을 이용하였다. 시뮬레이션의 결과로 TTIB SSB 송 ${\cdot}$ 수신기에서 페이딩을 보상할 수 있음을 알 수 있었다. 두 번째로 DSP 보드를 이용하여 TTIB SSB 송 ${\cdot}$ 수신기 구현에 대한 실험을 하였고 다음으로 중심 주파수가 145MHz인 RF 회로를 포함하여 실험하였다. 이 실험을 통하여 TTIB SSB 송 ${\cdot}$ 수신기에서 페이딩 보상 성능은 시뮬레이션을 통하여 얻은 결과와 같은 결과를 얻을 수 있었다.
본 논문에서는 동기를 위한 별도의 정보를 송신하지 않는 OFDM 시스템에서 순수데이타만으로 동기를 취하는 알고리즘을 제안하고, OFDM 수신기의 동기회로를 설계, DSP 칩을 사용하여 하드웨어로 구현하였다. 수신시 DFT 구간의 불일치가 잡음에 의한 신호점의 퍼짐과 같이 신호점의 퍼짐으로 나타남에 따라 퍼짐의 정도로 블록의 초기동기를 이루고 이 정보로부터 보호구간을 제거한 데이터를 이용 early-late 회로를 구성하여 블록의 동기 추적을 하도록 하였고, DSP 침 TMS320C30을 사용하여 1200bps 데이터를 복원하는 복조기를 제작하여 알고리즘의 타당성을 입증하였다. 제작된 보드의 클럭은 30MHz로 한개의 샘플 구간동안 2회의 128차 복소수 FFT를 수행하여 매 샘플마다 DFT 구간의 불일치에 의한 신호점의 퍼짐을 계산하고 대부분의 일을 소프트웨어로 처리하여 수신기의 하드웨어를 간단히 할 수있다.
본 논문은 계통상의 사고나 다양한 전력변환 장치들의 사용증가로 인한 전력품질의 저하의 계측과 분석에 관한 연구이다. DSP 프로세서를 사용하여 전력품질을 분석하며 분석된 data는 특정 서버에서 관리할 수 있도록 모니터링 전용 프로그램을 구성하여 일정기간 동안의 전력품질을 분석한다. 계측센서를 이용한 data를 제작된 DSP 보드를 통해 실효값으로 계산하고, 전력품질 Indices와 비교 분석하여 특정 서버에 저장하고, 전력품질 저하 대책을 위한 분석 자료로써 활용한다.
In this thesis, we represent the study on the design and implementation of the hangul graphic board which generate bit map font data from the boundary information of korean or chines fonts. The implemented graphic board consists of a TMS34010 Graphic System Processor (GSP) and two TMS320C25 Digital Signal Processor (DSP), and there is shared memory which consists of two memory blocks with same address for which is possible parallel processing between two processors. And in using DSP, we propose an efficient algorithm for calculation of Bezier curve which require much times to calculate bit map data font from the boundary information.
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[게시일 2004년 10월 1일]
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