• 제목/요약/키워드: Clock State

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HDLC 프로토콜에서 운용되는 동기식 스트림 암호 통신에 적합한 적응 난수열 재동기 기법 (An adaptive resynchronization technique for stream cipher system in HDLC protocol)

  • 윤장홍;황찬식
    • 한국통신학회논문지
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    • 제22권9호
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    • pp.1916-1932
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    • 1997
  • 절대 클럭 동기를 요구하는 동기식 스트림 암호 통신 시스템에 사이클 슬립 현상이 발생하면 암, 복호기간에 난수 동기가 이탈된다. 난수 동기 이탈 현상이 발생하면 통신을 할 수 없을 뿐 아니라 수신 시스템을 오작동 시킬 수 있다. 이러한 위험성을 줄이기 위하여 암호문에 동기 패턴과 세션 키를 주기적으로 삽입하여 재동기를 이루는 연속 재동기 방법을 흔히 사용한다. 연속 재동기 방식을 사용하면 비교적 안정된 암호 통신을 할 수 있으나 몇가지 문제점을 갖고 있다. 본 논문에서는 OSI 7계층중 링크 계층의 프로토콜로 HDLC 방식을 사용하는 통신 체계에서 운용되는 동기식 스트림 암호 통신 시스템에 적합하고 연속 재동기 방식의 문제점들을 해결할 수 있는 적응 재동기 방식을 제안하였다. 제안된 적응 재동기 방식에서는 HDMC 프레임의 주소 체계 특성을 이용하여 난수 동기 이탈이 발생한 경우에만 재동기를 이루는 방법을 사용하였다. 즉, 각 단위 측정 시간 동안의 HDLC 프레임의 주소 영역 수신률을 측정하여 이것이 역치보다 적은 경우에만 난수 동기 이탈이 발생한 것으로 판단하여 재동기를 이루는 방법을 사용하였다. 적응 재동기 방식은 연속 재동기 방식보다 효율적이며 주기적으로 동기 패턴과 세션 키를 전송하는 것에 따른 문제점을 해결하였다. 제안된 알고리즘을 HDLC 프로토콜을 사용하는 패킷 암호 통신에서 운용되는 동기식 스트림 암호 통신 시스템에 적용하여 시험한 결과, 연속 재동기에 비해 오 복호율 R_e 오 복호된 데이터 비트수 D_e에서 훨씬 향상된 성능을 나타내는 것을 확인하였다.

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H.264/AVC 복호기의 병렬 역변환 구조 및 저면적 역양자화 구조 설계 (Parallel Inverse Transform and Small-sized Inverse Quantization Architectures Design of H.264/AVC Decoder)

  • 정홍균;차기종;박승용;김진영;류광기
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2011년도 추계학술대회
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    • pp.444-447
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    • 2011
  • 본 논문에서는 H.264/AVC 복호기의 병렬 역변환 구조와 공통연산기 구조를 갖는 역양자화 구조를 제안한다. 제안하는 역양자화 구조는 하나의 공통 연산기를 사용함으로써 하드웨어 면적 및 계산 복잡도가 감소한다. 역변환 구조는 1개의 수평 DCT 연산기와 4개의 수직 DCT 연산기를 갖는 병렬구조를 적용하여 역변환 과정을 수행하는데 4 사이클이 소요된다. 또한 역변환 및 역양자화 구조에 2단 파이프라인 구조를 적용하여 1개의 $4{\times}4$ 블록을 처리하는데 5 사이클이 소요되어 수행 사이클 수를 감소시킨다. 제안하는 역변환 및 역양자화 구조를 Magnachip 0.18um CMOS 공정 라이브러리를 이용하여 ASIC 칩으로 설계한 결과 13MHz의 동작 주파수에서 게이트 수는 14.3K이고 제안한 역양자화 구조의 면적은 기존 구조 대비 39.6% 감소되었고, 표준 참조 소프트웨어 JM 9.4에서 추출한 데이터를 이용하여 성능을 측정한 결과 제안하는 구조의 수행 사이클 수가 기존 구조 대비 49.09% 향상되었다.

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ECDSA 하드웨어 가속기가 내장된 보안 SoC (A Security SoC embedded with ECDSA Hardware Accelerator)

  • 정영수;김민주;신경욱
    • 한국정보통신학회논문지
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    • 제26권7호
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    • pp.1071-1077
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    • 2022
  • 타원곡선 암호 (elliptic curve cryptography; ECC) 기반의 공개키 기반구조 구현에 사용될 수 있는 보안 SoC(system-on-chip)를 설계하였다. 보안 SoC는 타원곡선 디지털 서명 알고리듬 (elliptic curve digital signature algorithm; ECDSA)용 하드웨어 가속기가 AXI4-Lite 버스를 통해 Cortex-A53 CPU와 인터페이스된 구조를 갖는다. ECDSA 하드웨어 가속기는 고성능 ECC 프로세서, SHA3 (secure hash algorithm 3) 해시 코어, 난수 생성기, 모듈러 곱셈기, BRAM (block random access memory), 그리고 제어 FSM (finite state machine)으로 구성되며, 최소의 CPU 제어로 ECDSA 서명 생성과 서명 검증을 고성능으로 연산할 수 있도록 설계되었다. 보안 SoC를 Zynq UltraScale+ MPSoC 디바이스에 구현하여 하드웨어-소프트웨어 통합 검증을 하였으며, 150 MHz 클록 주파수로 동작하여 초당 약 1,000번의 ECDSA 서명 생성 또는 서명 검증 연산 성능을 갖는 것으로 평가되었다. ECDSA 하드웨어 가속기는 74,630개의 LUT (look-up table)와 23,356개의 플립플롭, 32kb BRAM 그리고 36개의 DSP (digital signal processing) 블록의 하드웨어 자원이 사용되었다.

천지개벽의 역학적 사유에서 본 대순사상의 후천개벽과 선험주의적 세계 (The Great Opening of the Later World in Daesoon Thought and the World of Pre-experientialism from the Reordering Works of Heaven and Earth as Understood in Yi-Jing Studies)

  • 김연재
    • 대순사상논총
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    • 제47집
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    • pp.1-37
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    • 2023
  • 본고에서는 한국근대의 신종교를 어떻게 이해할 것인가 하는 문제의식에서 출발한다. 신종교는 민족종교 혹은 민중종교의 성격을 지닌다. 그것은 조선사회가 근대의 역사적 전환기를 맞이하여 고취시킨 민족의식의 산물이다. 당시에 조선은 중국처럼 사회진화론의 발전사관속에 전통의 중건(重建)과 근대의 전환(轉換)과 같은 양단의 칼날에 직면해있었다. 전통의 중건은 반제국주의에 따른 민족의 계몽을 고양하는 역사적 사명감에 달려있다면 근대의 전환은 반봉건주의에 따른 민생의 계도와 민중의 교화를 도모하는 시대적 절박감에 달려있다. 본고에서는 이러한 역사적 전환기에 등장했던 신종교에 주목하고 특히 대순사상의 세계관을 집중적으로 조명한다. 그 중심적 논제 중의 하나로서 개벽의 선험주의적(先驗主義的) 문제를 집중적으로 논의한다. 대순사상의 진리는 민생을 계도하고 민중을 교화하는 현실적 인식의 종교적 차원을 지닌다. 개벽의 과정은 대순의 진리를 향해 천하대순(天下大巡)의 존재론적 시계를 확보하고 천지공사(天地公事)의 인식론적 세계를 설정하며 후천개벽(後天開闢)의 가치론적 경계에 도달하는 과정이다. 이들 삼중의 영역의 연결고리는 우주의 무궁무한적(無窮無限的) 시공간성을 천지의 틀 속에 후천의 시공간적 개벽으로 경험하는 선험주의적 노선을 특징으로 한다. 그 속에서 인간은 자신의 유한한 생명력에서 우주의 무한한 생명력을 만끽하고자 하였다. 따라서 대순사상은 후천의 개벽과 같은 선험주의적 통로를 통해 현실적 삶을 극복하고 선경과 같은 자각의식의 경계를 지향할 수 있는 것이다. 이는 초월적 관념의 세계를 추구하기보다는 현실적 세계에 참여하여 실천하려는 것이며, 따라서 소극적인 출세주의적(出世主義的) 경향보다는 적극적인 입세주의적(入世主義的) 경향을 지닌다. 결론적으로 말해, 후천의 개벽으로 특징짓는 대순사상의 진리에는 유토피아(Utopia)의 이상적 염원이나 디스토피아(Dystopia)의 현실적 혐오보다는 앞으로 희망과 기대를 갈구하는 넥스토피아(Nextopia)의 미래적 조망이 담겨있다.