• 한국통신학회논문지
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• 제22권7호
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• pp.1403-1410
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• 1997

Because streaming mode connection server suitable to wide area ATM networks performs transmission, reception and lookup with time restriction for the transmission time of a cell, it has demerits of large cell loss incase that burst traffic occurs. Therefore, in this paper to decrease cell loss we propose a high speed CAM (Content Addressable Memory) which is capable of processing data of streaming mode connections server at a high speed. the proposed CAM is applied to forwarding table VPC map which performs function to output connection numbers about input VPI(Virtual Path Identifier)/VCI(Virtual Channel Identifier). The designed high speed CAM consist of DBL(Dual Bit Line) CAM structure performed independently write operation and match operation and two-port SRAM structure. Also, its simulation verification and full-custom layout is performed by Hspice and Composs tools in 0.8 .$\mu$m design rule.

• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2002년도 ITC-CSCC -3
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• pp.2059-2062
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• 2002

For detection of digitally modulated signals, the receiver must be provide with accurate carrier phase and symbol timing estimates. So far, tots of algorithms have been suggested for those purposes. In general, a interpolation filter with TED(Timing Error Detection) like Gardner algorithm is popularly used for symbol timing estimate of digital communication receiver. Apart from the performance point of view, a multiplicative operation of any interpolation filter limits the symbol rate of the system. Hence, we suggest a new symbol timing estimate algorithm for high speed burst-mode fixed wireless communication system and analyze its performance in the AWGN channel.

• 한국항공우주학회지
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• 제43권5호
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• pp.466-471
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• 2015

본 논문에서는 광역 관측을 위하여 새롭게 제안되고 있는 TOPS SAR 운용기법에 대한 모드 설계 및 성능 분석을 수행하였다. TOPS 모드는 기존 ScanSAR 모드의 단점인 scalloping을 개선하기 위하여 새롭게 제안된 모드로서, SAR 진행방향으로 안테나 빔을 조향하면서 영상 데이터를 획득하는 새로운 SAR 영상 획득 기술이다. 본 논문에서는 TOPS 모드에 대한 기술적 운용 개념을 소개하고, SAR 운용 변수를 추출하기 위한 모드 설계 결과를 제시한다. 또한 설계된 모드 변수를 이용하여 SAR 주요 성능인 IRF, NESZ, 및 DTAR을 분석하여 제시한다.

• 전기전자학회논문지
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• 제24권1호
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• pp.319-325
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• 2020

본 논문에서 모바일 기기에 적용하는 DCM DC-DC 벅 변환기를 설계하였다. 이 변환기는 안정된 동작을 위한 보상기, PWM 로직과 파워 스위치로 구성되어 있다. 작은 하드웨어 폼-팩터를 얻기 위하여 칩 외부에서 사용하는 소자의 갯수를 최소화하여야 하며 이는 효율적인 주파수 보상과 디지털 스타트-업 회로로 구현하였다. 매우 작은 부하 전류에서 효율의 감소를 막기 위하여 버스트-모드 동작도 구현하였다. DCM 벅 변환기는 0.18um BCDMOS 공정으로 제작되었다. 2.8~5V의 입력 전압 범위에 대하여 출력 전압 값은 외부 저항 소자를 사용하여 1.8V로 프로그램 되었다. 1MHz의 스위칭 주파수 및 100mA의 부하 전류에서 측정된 최대 효율은 92.6%이다.

• 대한전자공학회논문지SD
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• 제45권5호
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• pp.71-81
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• 2008

본 논문에서는 새로운 On-Chip 버스로 다중처리 기반의 GALDS 버스 구조를 제안하였고 성능을 검증하였다. 제안된 GALDS 버스 구조는 멀티 마스터 멀티 슬레이브의 다중 처리를 지원하는 세그먼트(segment) 기반의 고성능의 양방향 다중처리 버스 구조(bi-direction multitasking bus architecture)이다. 또한, 시스템의 태스크(task) 분석에 의해서, 버스는 버스 동작 주파수의 배수 값을 갖는 주파수 사이에서 각각의 IP에 최적화된 동작 주파수를 선택하기 때문에 전체 전력 소모를 줄일 수 있다. 서로 다른 동작 주파수를 입력받은 IP들 간의 효율적인 데이터 통신을 위하여, 본 구조에서는 비동기 양방향 FIFO를 기반으로 하는 비동기 Wrapper 설계하였다. 또한, 버스 세그먼트의 추가만으로 시스템의 쉬운 확장이 가능하기 때문에, 제안된 구조는 IP 재사용 및 구조적 변경이 용이한 장점을 갖는다. 제안된 버스의 검증을 위해 4-마스터/4-슬레이브를 가지는 4-세그먼트의 버스와 비동기 Wrapper를 Verilog HDL을 이용하여 구현하였다. 버스의 다중처리동작 검증은 버스와 IP의 동작 주파수 비가 1:1, 1:2, 1:4, 1:8인 경우를 기준으로 시뮬레이션을 통해 마스터 IP에서 슬레이브 IP 사이의 데이터 읽기 및 쓰기 전송 동작을 확인하였다. 데이터 전송은 Advanced Microcontroller Bus Architecture(AMBA)과 호환 가능한 16 Burst Increment 모드로 하였다. 제한된 GALDS 버스의 최대 동작 지연시간은 쓰기 동작 시 22 클럭, 읽기 동작 시 44 클럭으로 확인되었다.

• Journal of Power Electronics
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• 제18권4호
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• pp.1223-1234
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• 2018

In this paper, a new three-port multidirectional DC-DC converter is proposed for integrating an energy storage system (ESS) to a bipolar DC microgrid (BPDCMG). The proposed converter provides a voltage-balancing function for the BPDCMG and adjusts the charge of the ESS. Thanks to the multi-functional operation of the proposed converter, the conversion stages of the system are reduced. In addition, the efficiency and weight of the system are improved. Therefore, this converter has a significant capability when it comes to use in portable BPDCMGs such as electric DC ships. The converter modes are analyzed and small-signal models of the converter in each of the independent modes are extracted. Finally, comprehensive simulation studies are carried out and a BPDCMG laboratory prototype is implemented in order to verify the performance of the proposed voltage balancer using the burst mode control scheme.

• 한국컴퓨터정보학회논문지
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• 제4권4호
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• pp.140-147
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• 1999

ABR(Available Bit Rate) 서비스는 ATM(Asynchronous Transfer Mode)망에서 guranteed 서비스에 의해 사용되고 있지 않는 여분의망 자원을 보다 효율적으로 사용키 위해 최대 전송률이 높고 burst한 특성을 지닌 응용들을 best effort 형태로 지원해주는 서비스이다. ATM 망에서 ABR 흐름제어를 위해 사용되는 스위치는 폭주상태 정보만 제공하는 EFCI(Explicit Forward Congestion Indication)스위치와 fair rate를 source에게 제공하는 ER(Explicit Rate)스위치로 구분할 수 있다. 본 논문에서는 ATM망에서 ABR 서비스를 위하여 EFCI 스위치와 ER 스위치가 ATM망에서 혼용되어 사용될 경우 ABR트래픽을 효율적으로 처리하기 위한 스위칭운용기술에 대해서 분석하였다.

• 한국통신학회논문지
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• 제29권7A호
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• pp.735-740
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• 2004

E-PON 시스템의 ONU 출력 광신호 크기가 가입자에 따라 많은 차이를 보이는 경우 OLT 수신단의 규격이 까다로워지고, 전체 PON 시스템의 안정된 동작을 보장할 수 없게 된다. 이러한 문제를 해결하기 위해 OLT 수신단에서 ONU 각 채널의 송신 광신호 크기를 검출하고 이로부터 제어신호를 이용해 등록된 ONU 채널들의 크기를 일정하게 조절하는 방식을 제안하고 실험을 통해 이를 확인하였다. 또한 ONU 송신단에는 디지털 APC 회로를 이용하여 전송 신호 존재 시 수 bit 이내에 LD를 동작하고, 전송 신호가 없을 경우 LD 구동전류를 차단함으로써 다른 ONU의 전송을 보장하며, 소비전력을 감소할 수 있도록 하였다.

• 전력전자학회논문지
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• 제14권6호
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• pp.504-513
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• 2009

본 논문에서는 조명용 LED 구동 장치를 위한 새로운 방식의 LED 구동 모듈화 방법을 제안한다. 제안된 LED 구동 회로는 플라이백 컨버터를 이용하여 교류 입력 전원의 핫 접지와 LED 구동부의 콜드 접지를 절연한다. LED 전류 제어를 용이하게 하기위해 플라이백 컨버터를 동특성이 뛰어난 불연속 모드로 동작시키고, KIA2431을 이용하여 귀환 루프 제어를 한 후, 그에 대한 특성을 파악한다. 제안된 LED 구동 모듈은 폭넓은 교류 전원 입력 범위와 PWM 제어 IC를 직접 제어하여 버스트 디밍을 구현하고 넓은 범위의 LED 밝기 조절이 가능하게 하였다. 본 논문에서는 제안된 LED 구동 모듈에 대한 동작 원리를 설명하고 LED 구동 모듈을 실제로 구현 및 적용하여 제안된 구동 모듈의 유용성을 입증하였다. 또한, 소형화와 모듈화 된 LED 구동 모듈을 병렬로 연결한 다 채널 LED 구동 장치를 제안하고 그 타당성을 검증하였다.

• 조명전기설비학회논문지
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• 제25권2호
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• pp.53-60
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• 2011

The available power generated from the FC power plant may not be sufficient to meet sustained load demand, peak demand or transient events. An supercapacitor bank(SCB) can supply a large burst of power, but it cannot store a significant amount of energy. The combined use of FC and SCB has the potential for the better energy efficiency, reducing the cost of FC technology and improved dynamic response. In this paper, A single PEMFC and PEMFC operated in parallel with a SC bank are presented, A new dynamic model of PEMFC system, the converter and controller has been developed for stand-alone applications. The simulation results are presented using Matlab/Simulink, and SimPowerSystems environments. It is confirmed that the results show a good performance and stable DC-link voltage for proposed dynamic and mathematical models developed for the combined FC/SCB.