A hysteresis control is widely used to control output current of inverter. A hysteresis bandwidth is affected by system parameters such as source voltage, device on/off time, load inductance and resistance. The frequency limiter is used to protect switching devices overload. In the conventional hysteresis controller, a lock-out circuit with D-latch and timer is used to device protection circuit. But switching delay time and harmonic components are appeared in output current. In this paper the performance of lock-out circuit is tested, and new circuit for switching device fault protection is proposed ad it's performance is simulated.
광 디스크를 재생하려면 광 신호를 아날로그 전기신호로 변환하는 광 픽업을 거치고 난 뒤 신호 간 간섭을 없애기 위해 아날로그적으로 등화를 하고, 등화된 아날로그 신호를 AD 변환하여 디지털적으로 동기화된 데이터와 클록을 추출해야 한다. BD와 같은 고용량의 광 디스크를 저속으로 재생하여 동기화된 데이터와 클록을 추출하는데 었어서 추출 데이터 BER을 최소화하는 알고리즘은 다양하게 개발되어 적용되고 있다. 그러나 고용량의 광 디스크를 고속으로 재생 할 때 저속에서 적용된 알고리즘을 동일한 혼성 데이터 PLL과 PRML 하드웨어 구조에 적용하려면 800MHz 이상의 신호 처리가 이루어져야 한다. 일반적으로 사용되는 0.13-${\mu}m$ CMOS 공정에서 기존 방식의 구조를 가지고 800MHz의 이상의 신호처리를 위해서는 고속으로 동작해야하는 아날로그 코어 등이 필요하고 많은 시간과 노력의 레이아웃이 수반되어야 하는 등의 문제점이 제기된다. 본 논문에서는 고용량 광 디스크의 최고 배속인 BD 8x까지 동작 가능한 데이터 및 클록 추출 회로로서 병렬 데이터 PLL 및 PRML 구조를 제안하였다. 제안한 구조를 가지고 실험한 결과 BD 8x 에 해당하는 속도에서 오류 없이 동작함을 확인하였다.
심전도 감시장치(electro-cardiography monitoring system)에 대한 연구는 국내외적으로 활발하게 이루어지고 있으나, 국내의 경우 환자 상태를 감시하는데 있어 중요한 요소인 호흡(respiration)에 관한 연구는 다소 미흡한 민이 있었다. 이번 연구는 환자의 상태를 감시하는데 있어 심전도, 혈압(brood pressure), 체온(temperature)과 더불어 중요한 요소로 여겨지는 호흡에 대한 감시장치로, 호흡 시 신체의 임피던스 변화를 이용하여 시스템을 구현함으로써, 심전도 측정과 병행하여 사용할 수 있는 장점이 있다. 특히, 임피던스를 이용한 환자감시장치의 경우 중추신경 마비 둥의 원인에 의한 무호흡 감지에 효과적으로 응급실 등에서 유용하게 사용된다. 구현된 시스템은 아날로그 부와 디지털 부의 잡음간섭 린 환자의 안전을 도모하기 위해 회로를 전기적으로 분리하여 설계하였다. 아날로그 부의 구성은 고주파 신호를 발생하는 정현파 발생부, 반송파로부터 인체의 임피던스 변화성분을 추출하고 증폭하는 증폭부, 기저대역으로 변환하기 위한 복조 및 아날로그 필터부로 구성되어 있다. 디지털 부는 아날로그-디지탈 변환기 및 디지털 필터, 생체정보 추출부로 구성되어있다. 본 연구에서 구현된 시스템은 심전도 감시장치의 전극을 공용으로 사용할 수 있도록 구성되었으며, 호흡 감시장치에 대한 기반기술 획득을 통해 다기능환자감시장치의 개발에 바로 응용 될 수 있다.
A thin-film multijunction thermal converter was fabricated through the process using 6 inch silicon wafer semiconductor process and bulk micromachining. Evanohm R alloy and chromel-constantan were used as a heater and thermocouple materials, respectively. The temperature coefficient of resistance of Evanohm R heater was about 75.12 ppm/$^{\circ}C$ and the voltage sensitivity of the thermal converter indicated about 5.75 mV/mW in air. The transfer differences, measured by FRDC-DC method in the frequency range from 20 Hz to 10 kHz, showed the value under about 1.36 ppm, 0.83 ppm for the film thickness of 500, 200 nm, respectively. And in case of a 200 nm-thick thermal converter, the AC-DC transfer differences seems to be stabilized below the value of 1 ppm in the frequency range from 1 kHz to 500 kHz.
본 연구에서는 개인용 컴퓨터와 신호변환기를 사용한 데이터 취득 및 분석 시스템을 개발하였다. 선박의 속력시운전시 계측되는 축마력, 축회전수, 선속등의 데이터는 여러가지 요인에 의해 변동폭이 크기 때문에 시운전이 수행되는 동안의 어느 한 순간의 값을 대표값으로 할 수가 없다. 변동폭이 큰 데이터의 대표값을 얻기 위하여 본 고에서는 이동평균 개념을 도입하였으며 이동평균값이 변하는 추이도 실시간 그래프로 보여준다. 현재는 8 채널 데이터를 동시에 처리할 수 있고, 분석된 데이터의 저장 및 프린트도 가능하다. 프로그램은 윈도우 환경에서 개발되어 사용자의 편리를 도모하고 향후의 확장이 쉽도록 하였다. 개발된 시스템은 속력시운전 뿐만 아니라 다른 분야-선박의 조종시험시 주요 데이터의 변하는 추이를 기록, 엔진의 헌팅문제의 검사, 진동의 스펙트럼 분석 등-에도 유용하며 이들 분야에 대한 실선에서의 적용 예를 보였다.
고속 flash ADC를 위하여, Successive Selection Encoder (SSE)라고 명명된 새로운 형태의 TC-to-BC encoder를 제안한다. 기존의 fat tree encoder가 OR 논리에 의하여 동작되는데 반하여, 제안된 SSE는 MUX 논리에 의하여 입력 TC 신호 들 중에서 직접 출력 BC 신호를 선택한다. 제안한 SSE의 구현을 위하여, Logical Effort 방법과 Hynix 0.25um 제조 공정에 의한 실험을 바탕으로 효율적인 SSE의 구현 구조를 정하였다. 이론적 모델과 실험 결과를 보면, SSE가 fat tree encoder에 비하여 (1) one-out-of-n 신호를 발생할 필요가 없고, (2) 사용되는 게이트 수는 약 1/3로 감소하며, (3) 동작속도는 2배 이상 빨라진다. 제안된 SSE는 고속 ADC에 적합한 TC-to-BC encoder로 사용될 수 있다.
본 논문에서는 저 전력, 고속 동작을 위하여 트랜지스터 차동쌍 폴딩 회로를 사용하는 CMOS 폴딩 ADC를 설계하였다. 본 논문에서는 제안한 트랜지스터 차동쌍 폴딩 회로에 대한 동작원리와 기존의 폴딩 회로에 비해 어떤 장점을 가지고 있는지 설명한다. 이 회로를 적용하여 설계한 ADC에서는 폴딩신호를 처리하기 위하여 16 개의 정밀한 전압비교기와 32 개의 인터폴레이션 저항을 사용하므로 저 전력, 고속동작이 가능하고, 작은 칩 면적으로 제작할 수 있다. 설계공정은 0.25㎛ double-poly 2metal n-well CMOS 공정을 사용하였다. 모의실험결과 2.5V 전원전압을 인가하고 250MHz의 클럭 주파수에서 45mW의 전력을 소비하였으며 측정값을 통하여 계산된 INL은 ±0.15LSB, DNL은 ±0.15LSB, SNDR은 10MHz 입력신호에서 50dB로 측정되었다.
오버샘플링 방식을 기본으로 하는 시그마-델타 ADC는 고해상도를 구현할 수 있는 반면 고속 동작 시에는 높은 Signal to Noise and Distortion Ratio (SNDR) 성능을 달성하기 어려운 특성이 있다. 본 논문에서는 고속 동작 시에도 시그마-델타 ADC의 높은 SNDR 제공을 위한 데시메이션 필터의 설계 및 구현을 보인다. 이 데시메이션 필터는 통과 대역 내에서 신호의 왜곡을 최소화하기 위해 Butterworth 구조로 구성 하였다. 성능을 검증하기 위해 1-bit, 3차, OSR=64인 시그마-델타 모듈레이터에 제안된 데시메이션 필터를 적용하여 실험을 하였다. 시뮬레이션 실험을 통해 기존에 널리 쓰이던 CIC(cascaded integrator-comb) 방식의 데시메이션 필터 대비 제안된 Butterworth 구조의 데시메이션 필터가 매우 낮은 통과대역 왜곡을 가지며 따라서 높은 SNDR을 제공한다는 결과를 보인다.
본 논문에서는 매우 짧은 전류펄스에 의해 구동되는 반도체 발광소자의 파장특성을 측정하기 위한 장치를 고안하였다. 이 장치는 600grooves/mm의 회절격자에 초점거리가 275mm인 분광기와 X-Y recorder 그리고 아날로그 분석을 위한 scanning motor와 최대값 검출기가 결합된 증폭기로 구성하였다. 특히, 최대값 검출기는 짧은 펄스 신호를 연속적인 값으로 변환하기 위하여 사용되었다. 이 장치를 이용하여 상용화된 발광다이오드와 AlGaAs/GaAs LD 및 InGaAsP/InP BH-LD를 duty cycle이 0.01인 전류펄스로 구동하면서 그 파장특성을 분석한 결과 약 1$\AA$ 정도의 분해능과 10$\mu$W 정도의 수신감도를 감지는 것을 확인하였다.
제품 계열 공학에서 제품의 공통성 및 가변성 분석을 결정짓게 하는 기준인 휘처 (feature) 분석에 대한 기존 연구는 개발자의 직관이나 도메인 전문가의 경험에 근간으로 분석 기준이 객관적이지 못하며, 비정형적인 휘처 분석으로 인한 이해 당사자 (stakeholder)의 공통된 휘처의 이해 부족 및 불명확한 휘처를 추출하는 문제점이 있었고, 기 개발된 소프트웨어에서 사용된 휘처의 재사용 개념이 부족했었다. 본 논문에서는 특정 도메인의 휘처 모델을 온톨로지로 변환하여 의미 기반 유사성 분석 기준에 의해 휘처의 공통성과 가변성을 추출하는 기법을 제시한다. 이를 위해, 먼저 공통된 휘처 중심의 메타 휘처 모델 기반으로 휘처의 속성을 정립하고, 메타 모텔에 준거하여 휘처 모델을 생성하여 온톨로지로 변환 후, 휘처 온톨로지 리포지토리 (Repository)에 저장한다. 이후, 동일 제품 계열 도메인의 휘처 모델 구축 시, 기 존 생성 모델과 온톨로지의 의미 기반 유사성 비교 분석 기법을 통해 휘처의 공통성과 가변성을 추출하는 것이다 또한 유사성 비교 알고리즘을 툴로 구현하였으며, 전자 결재 시스템 도메인의 실험 및 평가를 통 해 효과성을 보인다. 본 기법을 통해 메타 휘처 모델의 구문적 정립으로 이해성과 정확성을 제고시켜 고품질의 휘처 모델을 구축할 수 있으며, 온톨로지의 의미 기반 매핑으로 휘처의 공통성 및 가변성 추출을 정형화할 수 있고, 재사용성을 향상시킬 수 있다.
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[게시일 2004년 10월 1일]
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