• Title/Summary/Keyword: 하드웨어 테스트

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SDTS Conversion System (SDTS 변환 시스템)

  • Lee, Kang-Jun;Kim, Jun-Jong;Sul, Young-Min;Han, Ki-Joon
    • 한국공간정보시스템학회:학술대회논문집
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    • 1998.07a
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    • pp.181-195
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    • 1998
  • 지리 정보 시스템(GIS)은 그 특성상 대용량의 GIS 데이타를 사용하며, 다양한 운영체제와 하드웨어 상에서 구현된다. 이렇게 상이한 운영체제와 하드웨어상의 공간데이타들은 일반적으로 서로 다른 GIS 데이타 포맷을 갖고 있기 때문에 효율적인 자료 교환이 불가능하다면 데이타 공유가 매우 어려울 뿐만 아니라 공통 데이터의 중복 보관 및 관리로 인해 막대한 경제적 손실을 가져온다. 이와 같은 문제점을 해결하기 위해 국외에서는 이미 GIS 데이타 교환을 위한 방안으로 공통 교환 표준 포맷 작업이 10여년 전부터 진행되어왔으며, 국내의 경우도 국가 차원에서 지리 정보시스템의 국가 표준을 설정하고, 기본 공간 데이타베이스를 구축하고 있다. 그리하여, 국가 기본 포맷과 공통 데이타 교환 포맷의 표준으로 SDTS(Spatial Data Transfer Standard)를 채택하였다. 본 논문에서는 범용의 SDTS 변환 시스템의 구현에 필요한 공간 데이타 분석, 논리적 설계, 물리적 설계 등의 전반적인 SDTS 변환과정, 테스트 검증 사항, 그리고 반드시 지켜야 할 규칙들을 제시한다. 마지막으로, 실제 공간 데이타인 GOTHIC과 SDTS 간의 변환 시스템의 설계와 구현에 대해서 언급한다.

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Hardware Design and Implementation of IPsec Protocol for IPv6 (IPv6용 IPsec 프로토콜의 하드웨어 설계 및 구현)

  • 김경태;류준우;이정태
    • Proceedings of the Korean Information Science Society Conference
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    • 2002.10e
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    • pp.385-387
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    • 2002
  • 인터넷 상에서 IP 주소의 부족 문제를 해결하기 위해 IPv6 프로토콜이 제안되었고 현재 실용화 단계에 접어들었다. IPv6에서는 보안기능의 강화를 위해 IPsec 프로토콜을 기본 요구사항으로 채택하였고, 본 논문에서는 이러한 IPsec 프로토콜을 하드웨어로 설계하고 구현하였다. 이를 위해 IPv6에서 보안기능을 담당하는 헤더와 IPsec의 기간 암호화 알고리즘을 설계하여 각각 VHDL로 구현하였고, 전용 FPGA 보드와 IPv6 테스트망에서 그 기능과 성능을 검증하였다. 구현된 IPsec 프로토콜 칩은 TCP/IPv6와 IPsec 프로토콜을 하나의 칩으로 구현함으로써 별도의 프로세서 없이 인터넷 접속 기능과 보안기능을 동시에 제공하며 소프트웨어 모듈보다 뛰어난 성능을 나타낸다.

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Implementation of Error Simulator with NANDSim (NANDSim 기반의 오류 발생 시뮬레이터의 구현)

  • Kim, Ki-Jin;Lim, Seung-Ho
    • Annual Conference of KIPS
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    • 2016.04a
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    • pp.31-32
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    • 2016
  • 최근 소형 임베디드 시스템에서 고사양 컴퓨터 시스템까지 저장매체로 낸드 플래시 메모리를 채택하고 있다. 낸드 플래시는 물리적 성질로 인해 비트 오류가 발생하며 저장매체로써의 신뢰성이 부각되고 있다. 낸드 플래시 연구를 위해 낸드 플래시 하드웨어로 실험 환경을 구성할 경우 다른 종류의 낸드 플래시 하드웨어를 테스트하려면 전체 실험 환경을 수정해야 하는 번거로움이 발생한다. 본 논문은 실제 낸드 플래시의 비트 오류율(Bit Error Rate : BER)을 수집하여 비트 오류 발생 모델을 구축하였고 리눅스 커널의 낸드 플래시 시뮬레이터인 NANDSim에서 가상으로 생성한 낸드 플래시 종류에 따라 비트 오류율을 적용하여 소프트웨어적 실험 환경을 구성하였다.

Embedded System Network of P2P Using (P2P이용한 임베디드 시스템 네트웍)

  • Yun, Chan-Ho;Kim, Chul-Young;Kim, Dong-Hyun
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • v.9 no.1
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    • pp.884-887
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    • 2005
  • 정보화 사회로 진행되어 감에 따라 임베디드 시스템에 관한 연구는 날로 발전해 가고 있다. 개인과 개인간의 정보공유 모델인 P2P의 중앙서버가 필요 없이 다른 사용자들과 정보를 주고받을 수 있는 장점을 활용 하여 기존 임베디드 시스템의 각각의 센서들은 게이트웨이에 연결하여 서버와 클라이언트 구성이 었다면 각 센서 끼리 통신이 가능하도록 설계하여 클라이언트 끼리 네트웍을 구성하고자 한다. 최적화 저전력 초소형 임베디드 웹서버를 제안하고 각각 센서(균열센서, 열감지 센서등등) 설계 하여 빌딩의 붕괴, 산재 등등의 예상치 못한 사고가 발생시 건물 정보를 수집하는 센서 상호간에 네트웍으로 연결시키며 웹포팅 및 웹에서 하드웨어 제어 및 포팅 및 부트로더에서 하드웨어 테스트 과정을 걸쳐 최종으로 결과를 얻는다.

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Analysis of CNN Inference Using Xilinx DPU (Xilinx DPU를 사용한 CNN 추론 분석)

  • Kim, Chaeyoung;Suh, Taeweon
    • Annual Conference of KIPS
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    • 2019.10a
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    • pp.60-62
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    • 2019
  • 지능형 IoT 애플리케이션들을 효과적으로 사용하기 위해서는 추론 엔진을 Edge device로 포팅하는 것이 필수적이다. 그러나 컴퓨팅 자원이 제한적인 Edge 환경에서 computational cost가 상당히 큰 CNN 추론을 실시간으로 하는 것은 쉽지 않다. 이에, CNN 추론의 하드웨어 가속화의 필요성이 제기되어 활발한 연구가 진행되고 있으며, Xilinx, Intel 등에서도 하드웨어 가속화를 도와주는 툴을 개발하여 지속적으로 업그레이드하고 있다. 본 연구에서는 CIFAR-10 데이터베이스의 테스트 이미지 10,000개를 Xilinx 사의 CNN 추론 엔진인 DPU를 사용하여 Zynq UltraScale+ 보드에서 추론해보고, DPU 아키텍처에 따른 결과를 비교·분석했다. 병렬처리 수준을 높게 한 DPU는 그렇지 않은 DPU보다 소비전력 및 자원 사용량이 3배 이상 높았지만, 1.65배 좋은 성능을 보여 Trade-off 관계를 확인할 수 있었다.

복합 알고리즘을 이용한 실시간 얼굴 검출 및 SVM 인식 기술

  • 박정선;이상웅;정영아;양희덕;유명현
    • Review of KIISC
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    • v.12 no.2
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    • pp.18-24
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    • 2002
  • 얼굴인식 기술은 접촉에 대한 거부감이나 불편함이 없이 친숙하고 편리하게 사용자를 식별하고 인식할 수 있으며, 부가적인 센서 장비가 필요없다는 측면에서 개인 인증 및 보안 시스템으로서의 활용성이 매우 높다. 본 고에서는 여러 가지 장점들을 지닌 얼굴 인식 시스템의 구현 사례를 실시간 얼굴 검출 기술과 특징 추출 기술, 인식 기술로 구분하여 소개한다. 개발된 시스템은 얼굴 검출을 위해서 색상과 에지 성분을 이용하는 복합 알고리즘을 적용하여 실시간 얼굴 탐지를 가능하게 하였고, 추출된 사용자의 고유 얼굴 정보는 최신 인식 기법의 하나인 Support Vector Machine으로 분류, 인식된다. 또한 시스템의 성능을 테스트하고, 실용화 가능성을 모색하기 위하여 하드웨어 임베디드 시스템의 설계 및 구현 과정에 대하여 소개한다. 조명 및 환경 변화에 따른 시스템의 성능 변화를 객관적으로 검증하기 위하여 다양한 변화 조건을 고려한 한국인 표준 얼굴 데이터베이스를 구축하였고, 이 데이터베이스를 기반으로 체계적인 시스템의 성능 테스트를 수행하였다.

Implementation of Embedded System and Finger Print Identification using ART2 (ART2를 이용한 지문인식 및 임베디드 시스템의 구현)

  • Kim Jae-Wan;Lee Chang-Gyu;Kim Yeong-Tak;Lee Sang-Bae
    • Proceedings of the Korean Institute of Intelligent Systems Conference
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    • 2006.05a
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    • pp.90-93
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    • 2006
  • 본 논문에서는 자율신경망 중 ART2(Adaptive Resonance Theory 2)를 이용하여 지문의 매칭알고리즘에 적용하였다. 지문의 영상을 센서로부터 입력 받아, 전 처리와 후처리 과정을 거친 후 각각의 지문에 대한 특징값을 구하고, 지문 영상을 분류 및 매칭 할 수 있도록 하였다. 다음으로 제시한 알고리즘을 바탕으로 PC(Personal Computer) 없이 독립적으로 사용 할 수 있는 실시간 임베디드 지문 인식 시스템을 구현 하였다. 실시간 임베디드 지문 인식 시스템 설계에 있어 크기와 기능면을 고려해 메인 모듈의 프로세서로 최근 신호 처리에 많이 사용되고 있는 DSP(Digital Signal Processor)를 사용 하였으며, 지문을 입력 받기 위한 센서로는 반도체 지문 센서를 사용하였다. 메인 모듈과 센서를 가지고 간단한 디스플레이 및 통신 테스트를 위해 PIC Micro-Processor를 사용해 컨트롤 보드를 제작하여 간단한 인식 테스트를 하였다. 제작한 보드를 가지고 다양한 어플리케이션이 가능하나, 본 논문에서는 하드웨어나 소프트웨어 개발에 사용 가능한 RDK(Reference Design Kit)를 최종으로 구현하였다.

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Reference Implementation of OpenVG for Embedded System (임베디드 시스템용 OpenVG 참조 구현)

  • Lee, Sang-Yun;Lee, Kyung-Hee;Kim, Sung-Hwan;Chung, Ji-Hoon;Choi, Byung-Uk
    • Proceedings of the Korean Information Science Society Conference
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    • 2007.06b
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    • pp.161-166
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    • 2007
  • 본 논문에서는 크로노스 그룹에서 제정한 스케일러블 벡터 그래픽 하드웨어 가속을 위한 표준인 OpenVG를 소프트웨어 렌더링 방식으로 구현한 참조 구현을 제안한다. EGL과 OpenVG 엔진이 다양한 임베디드 환경에 쉽게 이식이 가능하도록 설계한 방식을 제시한다 또한 성능 개선을 위해, 채택한 수학 함수와 알고리즘의 선택 배경을 기술하고 최적의 렌더링 방법을 제안한다. 소프트웨어 렌더링 방법으로 구현한 OpenVG를 통해 벡터 이미지를 화면에 출력하는 모습을 보인다. 또한 호환성 테스트 툴인 CTS의 테스트 결과를 제시하며 기존 참조 구현인 Hybrid 사의 참조 구현과 성능 비교 실험 결과를 보인다.

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Use Case Oriented Requirements Engineering for improving the previous ViRE's Process (기존 ViRE 프로세스 개선을 위한 Use Case 지향 요구공학)

  • Park, Bokyung;Moon, Soyoung;Kim, Kidu;Kim, Boyeon;Kim, R. Youngchul
    • Annual Conference of KIPS
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    • 2012.11a
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    • pp.1497-1499
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    • 2012
  • 전통적인 소프트웨어 개발에서는 초기 요구사항을 정확히 판단하고 분석하는 것이 중요하다. 이를 위해 B.Boehm은 가치혁신 요구공학을 제안하지만, 이는 기존의 개발 방법 기반이다. 본 논문에서는 가치 혁신 요구공학 개선을 위해, 유스케이스 기반의 요구공학 방법을 제시와, 요구사항과 유스케이스의 우선순위 도출 방법을 제안한다. 이를 위해 어려운 시스템 요소(하드웨어와 소프트웨어)를 기본 단위인 유스케이스 요소와, 유스케이스 점수(Use Case Point) 개념을 적용하여 유스케이스 중요도를 도출한다. 그 기본 단위 내의 분석을 통해 쉽게 요구사항 추출 및 우선순위화를 한다. 이는 테스트 단계에서 우선순위화된 테스트 케이스를 적용이 가능한다고 본다.

Simulation Test Board Implementation of Digital Signal Processor for Marine Radar (선박용 레이더 신호처리부를 위한 시뮬레이션 테스트보드 구현)

  • Son, Gye-Joon;Kim, Yu-Hwan;Yang, Hoon-Gee
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • 2014.10a
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    • pp.890-893
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    • 2014
  • In this paper, we present a signal processing algorithm for a marine radar system, in which the evaluation of probability of collision as well as target detection and tracking are performed. Moreover, the digital signal processor that implements the algorithm is proposed. As simulation environment, a mechanically scanning antenna utilizing FMCW signal is used, conducting the beamforming operation with 1 degrees intervals. Test board consists of DSP chips and FPGA, which enable the implemented system to operate in real-time.

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