• Proceedings of the Korean Information Science Society Conference
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• 1998.10a
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• pp.697-699
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• 1998

본 논문은 프로세서 알제브라의 하나인 ACSR을 이용하여 파이프라인 비순차 슈퍼스칼라 프로세서의 타이밍 특성과 자원 제한을 묘사하기 위한 정형기법을 제시한다. ACSR의 두드러진 특징은 시간, 자원, 우선 순위의 개념이 알제브라에서 직접적으로 제공되어 진다는 것이다. 여기서의 접근 방식은 슈퍼스칼라 프로세서의 레지스터를 ACSR 자원으로, 명령어를 ACSR 프로세서로의 모델링하는 것이다. 결과적으로 얻어지는 ACSR식에서 각각의 클럭 주기에서 어떻게 명령어가 실행되고 레지스트들이 이용되는지 확인할 수 있으며 이 모델링을 이용해서 비순차 슈퍼스칼라 프로세서 구조를 검증하거나 분석하는 것이 가능하다.

• Proceedings of the Korean Information Science Society Conference
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• 1998.10a
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• pp.15-17
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• 1998

마이크로 프로세서의 개발과정에서 성능평가의 중요성이 점차 증가하고 있다. 이것은 사용자에게 보다 설득력있는 데이터를 제공하는 의미를 가진다는 것과 함께 개발된 마이크로 프로세서의 성능향상요인을 분석해내고 또한 시스템의 설계에 프로세서의 특성을 보다 효율적으로 반영한다는 점에서 중요하다고 하겠다. 본 논문에서는 ARM 7 프로세서의 성능을 측정하기 위한 도구(시뮬레이터)의 개발에 관해 설명한다.

• Proceedings of the Korean Information Science Society Conference
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• 1998.10a
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• pp.107-109
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• 1998

효율적인 스케줄링 알고리즘은 적은 문맥교환 횟수를 가지면서 동시에 잘 정의된 임의의 태스크 집합에 대해 높은 스케줄링 성공률을 갖고 있어야 한다. 기존의 단일 프로세서 스케줄링 알고리즘들은 멀티프로세서 스케줄링 알고리즘들에 비해 시간 복잡도가 낮지만 멀티프로세서 환경에서 그대로 적용시킬 경우 스케줄링 성공률이 많이 떨어진다. 본 논문에서는 비슷한 시간 복잡도를 가지면서도 멀티프로세서 환경에서 높은 성공률을 얻을 수 있는 EDF-ZLP와 LLF-RP 알고리즘을 제안하고 이 알고리즘들의 추가적인 성능 향상 방안을 제안한다.

• ETRI Journal
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• v.8 no.2
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• pp.100-108
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• 1986

본고에서는 TDX-1의 유지보수 기능으로서 개발된 각 기능별 개요 및 특성에 대하여 기술함으로써 TDX-1의 기능을 이해하거나 타 교환기와의 특성을 비교하는데 도움을 줄수 있도록 하였다. TDX-1의 유지보수 기능은 그 수행대상에 따라 프로세서계와 텔리포니계 유지보수 기능으로 구분된다. 프로세서계의 유지보수 기능에는 시스팀 시동, 프로세서 상태처리, 프로세서 시험, 시스팀 클럭관리와 프로세서 장애처리 기능 등이 있으며 텔리포니계 유지보수 기능에는 시스팀 장애 처리, 네트워크 상태 처리, 네트워크 시험과 시스팀 경보처리 기능 등이 속한다.

• Proceedings of the Korean Information Science Society Conference
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• 2008.06b
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• pp.405-410
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• 2008

성능 / 에너지를 강조하는 현재의 멀티코어 추세에서 임베디드 시스템에 사용되는 대부분의 프로세서들은 단일 프로세서와 메모리를 버스 형태로 연결하여 구현하였다. 하지만 칩 내부의 프로세서 코어 수가 증가 하게 되면, 기존 버스 형태의 구조는 제한된 대역폭으로 인하여 확장성이 제약된다. 본 논문에서는 멀티코어 프로세서에서 사용 가능한 기존 연결 망 구조들을 분석하고, 기존 계층적 링 구조에서의 지연 시간 문제를 극복하여 성능을 개선할 수 있는 새로운 이중 광역 계층 링 구조를 제안한다.

• Proceedings of the Korean Information Science Society Conference
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• 2001.10c
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• pp.13-15
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• 2001

최근에 이르러 프로세서의 병렬성을 분석적 기법으로 예측하기 위한 연구가 활발해지면서 프로세서의 성능 예측 모델에 대한중요성이 대두되고 있다. 그러나 기존의 연구는 현재 광범위하게 사용되고 있는 다중 분기 예측법을 이용하는 프로세서에 대하여 분기 차수와 관계없는 재귀적 성능 모델을 제공해주지 않는다. 본 논문에서는 이것을 해결하기 위하여, 매 싸이클마다 명령어 종속 트리를 구성하고 종속인 명령어 간에 상대적인 병렬도 갓을 부여하여 성능 예측 모델 입력 데이타를 측정하였다. 그 곁과, 다중 분기 예측법을 사용하는 프로세서에서 정수형 프로그램에 대한 성능을 기존의 성능모델보다 작은 상대 오차로 예측할 수 있다.

• Information and Communications Magazine
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• v.23 no.5
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• pp.19-27
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• 2006

셀룰러 폰, PDA 등의 사용이 보편화됨에 따라 임베디드 프로세서의 사용이 급격히 증가하고 있다. 유저에게 다양한 서비스를 제공하기 위하여 임베디드 프로세서는 데스크톱이나 노트북 못지않은 고성능을 가져야하는 동시에 이동성을 확보하기 위하여 저 전력을 소비할 수 있도록 개발되어야 한다. 또한, 통신과 컴퓨팅이 통합하는 컨버젼스(convergence)의 요구에 부합하기 위하여 임베디드 프로세서는 듀얼 코어 구조를 가지게 된다. 본 지는 상기 요구들에 부합하기 위한 인텔 임베디디 프로세서들을 소개하고, 멀티미디어 응용 수행 시 요구되는 프로세싱 능력을 수용하는 동시에 저 전력을 소비하게 하는 구체적인 적용 기술들을 살펴본다.

• Proceedings of the Korean Institute of Intelligent Systems Conference
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• 2003.05a
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• pp.51-54
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• 2003

진화하드웨어는 하드웨어 스스로 진화하여 필요한 회로를 구성한다 회로를 재구성하기 위해서 유전자 알고리즘을 사용한다. 유전자 알고리즘(Genetic Algorithm)은 전역적 탐색을 통하여 해를 구한다. 하지만 유전자 알고리즘은 많은 개체의 평가를 통하여 이루어지기 때문에 수행하는데 시간이 많이 소요된다. 이전의 연구에서 유전자 알고리즘 프로세서를 이용하여 진화하드웨어를 구성했다. 유전자 알고리즘 프로세서는 유연성이 떨어지고 범용적으로 사용하기 어렵다. 본 논문에서는 CPU를 이용하여 유전자 알고리즘 프로세서를 소프트웨어로 제어하는 방법을 제안한다 소프트웨어로 합성한 신호로 GAP의 동작을 제어하기 때문에 유연성을 가질 수 있다 FPGA에 CPU와 유전자 알고리즘 프로세서를 구현하여 one-chip 하드웨어를 구현한다.

• Proceedings of the Korean Information Science Society Conference
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• 2003.10c
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• pp.676-678
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• 2003

최근에 2.5G나 3G 이동 단말 장치를 위한 프로세서로, 다양한 멀티미디어가 가미된 응용구현이 가능하도록 RISC 프로세서와 DSP를 포함하는 단일 칩 프로세서 기술이 등장하고 있다. 이에 따라 듀얼 프로세서 구조에서 비디오 인코딩/디코딩의 처리 속도를 향상시키기 위안 비디오의 인코더/디코더 구조를 제안한다. 기존의 연구에서는 비디오의 인코딩/디코딩의 전 과정을 DSP가 담당하도록 설계하였으나 많은 비트 연산이 필요한 부분에서는 RISC 칩보다 효율성이 낮게 된다. 이러한 문제점을 해결하기 위하여 본 논문에서는 비디오 신호 처리의 인코딩/디코딩을 구성하는 모듈들을 DSP와 RISC의 특성에 맞도록 분리해 수행시킴으로써 효율성을 높이고자 한다.

• Review of KIISC
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• v.13 no.4
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• pp.15-24
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• 2003

네트워크 보안 시장이 급성장하고 다양한 보안 기능들이 요구되면서, 점차 통합된 보안 시스템 제품들이 시장을 주도하고 있다. 즉, 기존의 라우터나 스위치 상에 보안 기능을 탑제함으로서 하나의 솔루션으로 네트워크와 보안을 모두 해결할 수 있는 제품들이 각광을 받게 되었다. 반면에 이러한 보안기능의 처리와 관련된 네트워크 장비의 성능저하를 해결하기 위해 다수의 장비업체들은 보안 프로세서를 사용하고 있다. 본 고에서는 네트워크 보안 시장 및 이와 관련한 보안 프로세서의 최근의 제품 동향과 각 프로세서 업체들에 의해 제공되는 보안 프로세서들의 특징을 비교한다.