최근 컴퓨팅 환경은 통합되는 개방형 시스템으로 변모하고 있다. 기존 시스템에서는 다양한 개발 환경을 지원하지 못하고 있으며, 다양한 산출물(클래스 부품, 다이어그램, 양식, 컴포넌트)에 대한 효율적인 관리를 못하는 단점이 있다. 또한 산출물레 있어서 연결관계를 서로 관련성 있는 사항을 참조 못하고 있으며 객체 내부와 관계를 정의할 수 없어서 산출물에 대한 이해도가 부족으로 객체지향 프로그램에 필요한 코드로 생성하지 못하고 있다. 따라서 본 논문에서는 산출물 객체의 효율적인 관리를 위한 통합 관리 모델을 이용한 객체 관리 저장소 설계기법을 제시하고, 버전 관리와 연결관계 상호관련기를 두어 객체내부 관계와 서로 관련성을 개발자가 쉽게 파악하여 재사용함으로서 개발자는 어플리케이션에 관련된 부분만을 개발할 수 있도록 지원한다. 객체 관리 저장소를 네 가지 단계로 설계함으로서 단점을 보완하고 클래스이해와 산출물 정보를 쉽게 표현할 수 있어 클래스를 생성할 수 있도록 하여 재사용의 효율성을 향상시켰다. 또한 새로운 소프트웨어 개발에 생산성을 향상시키기 위한 것이 본 연구의 목적이다. 향후 시스템의 통합에 잇점인 소프트웨어의 재사용성을 극대화하여 생산성을 향상시키는 프로토타이핑을 지원할 것으로 기대된다.
정보기술의 발달과 인터넷의 보편화에 따라 지리정보의 활용분야가 다양해지고 지리 정보를 효율적으로 관리하기 위해 다양한 지리정보 시스템(GIS : Geographic Information System)이 구축되었다. 하지만 다양한 형태의 지리정보 데이터는 서로 표준화 되지 않아 다양한 형태의 그래픽 저작도구에 의존하고 있다. 이에 OGC(Open Geospatial Consortium)는 상호운용 가능한 표준화된 지리정보 데이터를 기술하는 GML(Geography Markup Language)을 제안하였고 W3C에서는 벡터 기반의 SVG(Scalable Vector Graphics)를 제안하였다. 본 논문에서는 지리정보 데이터처리를 위한 XML 기반의 GML 데이터를 벡터 그래픽 객체로 생성하고 그래픽 객체들을 통해 GML 문서를 생성하는 코드 변환기를 정의하여 벡터 그래픽을 XML 기반의 논리구조로 변환하는 GML 문서 편집 및 변환 시스템을 설계 및 구현하였다.
안드로이드 플랫폼에서 다양한 모바일 애플리케이션이 개발/배포되면서 편리함과 유용성이 더욱 증가하고 있으나 지속적으로 악성 모바일 애플리케이션(Malicious Mobile Application) 또한 급증하고 있어 스마트폰 사용자도 모르게 단말 내 중요 정보 등이 외부로 유출되고 있다. 악성앱 검출을 위해 안드로이드 플랫폼을 대상으로 다양한 모바일 백신이 개발되었지만 최근에 발견된 서버 기반 다형상 모바일 악성앱인 경우 은닉 우회 기법을 포함하고 있으며, C&C 서버 기반 다형상 생성기에 의해서 각 사용자 단말에 매번 조금씩 다른 형태의 악성앱이 생성 및 설치되기 때문에 기존 모바일 백신에 손쉽게 검출되지 않는다는 문제점이 있다. 이에 본 논문에서는 서버 기반 다형상 모바일 악성앱에 대한 APK 역컴파일 과정을 통해 핵심 악성 코드를 구성하는 DEX 파일내 메소드에 대한 유사도와 접근권한 유사도 측정을 통해 상관관계를 분석하여 SSP 악성앱을 판별하는 기법을 제시하였다. DEX 메소드 유사도와 퍼미션 유사도 분석 결과 SSP 악성앱에 대한 동작 방식의 특징을 추출할 수 있었으며 정상앱과 구별 가능한 차이점을 발견할 수 있었다.
정보기술의 발달과 인터넷의 보편화에 따라 지리정보의 활용분야가 다양해지고 지리 정보를 효율적으로 관리하기 위해 다양한 지리정보 시스템(GIS : Geographic Information System)이 구축되었다. 하지만 다양한 형태의 지리정보 데이터는 서로 표준화 되지 않아 다양한 형태의 그래픽 저작도구에 의존하고 있다. 이에 OGC(Open Geospatial Consortium)는 상호운용 가능한 표준화된 지리정보 데이터를 기술하는 GML(Geography Markup Language)을 제안하였고 W3C에서는 벡터 기반의 SVG(Scalable Vector Graphics)를 제안하였다. 본 논문에서는 지리정보 데이터처리를 위한 XML 기반의 GML 데이터를 벡터 그래픽 객체로 생성하고 그래픽 객체들을 통해 GML 문서를 생성하는 코드 변환기를 정의하여 벡터 그래픽을 XML 기반의 논리구조로 변환하는 GML 문서 편집 및 변환 시스템을 설계 및 구현하였다.
본 연구는 요구되는 전압효율이 83% 이상인 풍량 10,000 ㎥/min급의 장수명 송풍기를 개발하기 위하여 송풍기 침식 현상을 조사하고, 수치해석을 통하여 송풍기 성능과 송풍기 침식을 예측하였다. 송풍기 해석에 주로 많이 사용되는 검증된 상용코드인 ANSYS CFX 13.0을 사용하여 수치해석을 수행하였다. 수치해석에 사용된 조건은 풍량 16,200 ㎥/min, 회전수 893 rpm, 온도 330 ℃이다. 분진의 비중은 3.15이고, 입도는 90㎛~212㎛이며, 양은 265kg/min으로 하였다. 송풍기로 유입되는 분진으로 인한 송풍기의 침식현상을 정확히 해석하기 위하여 수직복원계수의 변화에 따른 침식 현상을 실제 침식현상과 비교하였다. Finne 모델을 적용하여 수치해석을 수행한 결과 평형복원계수는 1, 수직복원계수는 0.1인 경우가 실제 침식현상과 유사하게 나타났다. Duct deflector가 침식에 관하여 미치는 영향을 살펴보기 위하여 Duct deflector가 있는 모델과 없는 모델을 비교하여 침식해석을 수행하였다. 수치해석의 결과, Duct deflector를 설치한 경우 Impeller에서 평균 167% 감소하고, Boss에서는 평균 133% 증가하는 경향으로 나타났다. Dust deflector의 길이에 따라 총 5가지 모델을 생성하고, 이에 대하여 침식 수치해석을 수행하였으며, 길이가 가장 긴 Case 5가 침식성능이 가장 우수한 것으로 나타났다. Case 5의 송풍기 성능은 회전수 880 rpm, 풍량 16,200 ㎥/min일 경우, 전압 691.7 mmAq와 전압효율 83.3%로 나타났다.
분산 비디오 부호화(DVC: Distributed Video Coding)는 움직임 추정과 같은 복잡한 연산을 복호기측에서 처리함으로써 경량화 된 영상 부호화를 가능하게 하는 기술로 최근 많은 연구가 진행되고 있다. 분산 비디오 부호화의 부호화 성능을 개선하기 위한 기존의 연구는 주로 우수한 보조정보(SI: Side Information) 생성 또는 채널 특성을 잘 기술할 수 있는 채널 잡음 모델링에 집중되었다. 본 논문에서는 화소영역 Wyner-Ziv(Pixel Domain WZ: PDWZ) 코덱의 성능을 개선하기 위해 부호기에서 높은 복잡도를 도입하지 않고 간단한 비트 연산을 통하여 구현될 수 있는 성능 개선 방법을 제안한다. 즉, WZ 프레임과 보조정보 간에 존재하는 높은 상관성을 이용하고, 특정 영역에 집중하여 나타나는 가상채널 잡음을 줄임으로써 부호화 성능을 개선하는 방식을 제안한다. 이를 위해, 본 논문에서는 코드할당 및 그레이코드(Gray Code)를 사용하여 통계적 중복성을 효과적으로 이용하고, 더불어 비트 인터리버를 통하여 가상 채널 잡음의 영향을 줄이는 PDWZ 코덱을 제안한다. 모의실험을 통하여 제안한 방법은 최대 약 0.5 dB의 화질 개선을 제공할 수 있음을 보인다.
본 논문에서는 전류 모드 동작에 기반한 IEEE 802.15.4 규격을 만족하는 2.4GHz 저전력 직접 변환 송신기를 제안하고 $0.13{\mu}m$ CMOS 공정을 이용하여 구현하였다. 제안된 송신기는 디지털-아날로그 변환기, 저역통과 필터, 가변 이득 I/Q 상향 혼합기, 구동 증폭기 및 LO 버퍼를 포함하는 주파수 나누기 2회로로 구성되어 있다. 디지털-아날로그 변환기와 저역통과 필터(LPF), 가변이득 I/Q 상향 혼합기의 트랜스컨덕터 단을 하나의 전류 미러 회로로 합친 간단한 구조를 제안하여 전력 소모를 줄이면서 선형성을 향상할 수 있도록 하였다. 구동 증폭기는 캐스코드 타입의 증폭기로 제어 신호를 이용하여 이득을 조절할 수 있게 하였고, 외부 4.8GHz 신호를 받아 주파수 나누기 2 전류 모드 로직 (CML) 회로를 사용하여 2.4GHz I/Q 차동 LO 신호를 생성하도록 설계하였다. 구현한 송신기는 30dB의 이득 조정 범위를 가지면서 0dBm의 최대 출력 신호에서 33dBc의 LO 누설 성분, 40dBc의 3차 하모닉 성분의 특성을 보이며, 구현한 칩의 면적은 $1.76mm{\times}1.26mm$으로 전력소모는 1.2V 단일 전원 전압으로부터 10.2mW이다.
최근 핀테크 활성화로 인한 금융 거래 및 결제 관련하여 많은 연구 개발이 활발하게 진행되고 있다. 상품을 구매하고 대금을 지급하는 방법에는 현금, 카드 등 여러 가지 방법으로 결제를 진행하고 있으며, 최근 모바일 카드를 통한 결제 및 휴대폰 간편 결제 등 결제 방식이 빠르고 간편화 되고 있다. 제안하는 모바일 전자결제 방식은 기존 카드 리더기 또는 카드 단말기 없이 사용자의 휴대폰을 이용하여 결제할 수 있는 방법을 제안한다. 결제 시 스마트폰에 내장된 지문인식기를 통해 사용자의 생체정보를 입력받아 본인인증이 먼저 수행되며, 결제 이전 두 사용자의 확인을 위해 인증된 기관에서 부여 받은 인증 코드를 전송하여 이를 검증하고 결제가 이루어진다. 사용자의 생체정보와 결제관련 정보는 스마트폰 내의 안전한 FIDO TEE영역에 저장되어 악의적인 사용자로부터 안전성을 확보하였다. 키의 안전성 측면에서는 모든 키 생성은 FIDO TEE 영역에서 이루어지게 하여 안전성을 확보하였으며, 스니핑, 중간자 공격 등 다양한 공격 방식에 대한 무력화를 통해 안전한 모바일 전자결제 서비스를 제공한다.
본 논문에서는 M-ary 직교 변조를 사용하는 직접 확산 코드 분할 다중 접속 (DS/CDMA: Direct Sequence/Code Division Multiple Access) 시스템을 위한 최대 근사 (Maximum Lkelihood : ML) 결정 궤환 채널 추정(Decision Feedback Channel Estimation : DFCE) 시스템을 제안한다. 제안된 시스템은 결정 궤환 정보로서 RAKE 수신기의 최대 결합 출력을 사용한다. 제안된 시스템으로부터 추정된 채널 값을 이용하면 파일럿의 삽입없이 RAKE 수신기에서 동기 검파 (coherent demodulation)를 할 수 있고, 동시에 최대 비 결합(Maximum Ration Combining : MRC) 기법을 사용할 수 있다. 그러나 제안된 DFCE 다중 사용자 환경에서 다중 사용자 간섭 (Multiple Access Interference: MAI)으로 인해 심각한 성능의 저하가 발생한다. 이런 문제를 해결하기 위해 다단 병렬 간섭 제거기(Multistage Parallel Interference Cancellation : PIC)를 제안된 시스템과 결합해 본다. 제안된 DFCE에서 추정된 정확한 채널 값은 동기식 검파뿐 아니라 PIC에서 다중 사용자 간섭 신호의 재 생성(regeneration)을 위해서도 쓰인다. 이럴 경우 PIC와 EFCF간에 서로 도움을 주는 이중 효과를 얻게 된다. 실험결과에 의하면 제안된 시스템은 기존의 비동기 검파(noncoherent demodulation) 방식에 비해 다단 PIC를 쓰지 않는 동기 검파의 경우 IE-02의 E$_{b}$/N$_{0}$에서 수용 가능한 사용자 수가 5명에서 약 10으로 2배 증가함을 확인할 수 있었으며, 다단 PIC를 사용한 동기 검파의 경우 약 30명으로 6배 정도가 증가함을 확인할 수 있었다.
본 논문에서는 멀티미디어 SoC 플랫폼의 ASIC 설계에 대해 기술한다. 구현된 플랫폼은 32비트 OpenRISC1200 마이크로프로세서, WISHBONE 온 칩 버스, VGA 제어기, 디버그 인터페이스, SRAM 인터페이스 및 UART로 구성된다. 32 비트 OpenRISC1200 프로세서는 명령어 버스와 데이터 버스가 분리된 하버드 구조와 5단 파이프라인 구조를 가지고 VGA 제어기는 메모리로부터 읽은 이미지 파일에 대한 데이터를 RGB 값으로 CRT 혹은 LCD에 출력한다. 디버그 인터페이스는 플랫폼에 대한 디버깅 기능을 지원하고 SRAM 인터페이스는 18비트 어드레스 버스와 32비트 데이터 버스를 지원한다. UART는 RS232 프로토콜을 지원하는 시리얼 통신 기능을 제공한다. 본 플랫폼은 Xilinx VIRTEX-4 XC4VLX80 FPGA에 설계 및 검증되었다. 테스트 코드는 크로스 컴파일러로 생성되었고 JTAG 유틸리티 소프트웨어와 gdb를 이용하여 패러럴 케이블을 통해 FPGA 보드로 다운로드 하였다. 이 플랫폼은 최종적으로 Chartered 0.18um 공정을 이용하여 단일 ASIC 칩으로 구현 되었으며 100MHz 클록에서 동작함을 확인하였다.
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[게시일 2004년 10월 1일]
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