• Title/Summary/Keyword: 코드생성기

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The Development of QR-ID Card based on Biometric Data (바이오메트릭 데이터를 이용한 QR-ID 카드 개발)

  • Song, Kyu-hyun;Kim, Dong-hee;Yun, Sung-hyun
    • Proceedings of the Korean Society of Computer Information Conference
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    • 2014.07a
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    • pp.371-374
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    • 2014
  • 현재 국내에서 사용되고 있는 신분 인증 시스템은 주민등록번호와 같은 개인 정보를 기반으로 인증을 수행하여, 프라이버시 침해 위협이 존재한다. 그 해결 방안으로 가상 ID를 이용하는 I-PIN과 e-ID 카드가 제안되었지만, 문제점은 ID와 패스워드만 알고 있다면 누구나 도용이 가능하고 오프라인에서 사용하는 플라스틱 카드의 경우 위 변조가 가능하다는 한계를 갖는다. 본 논문에서는 주민등록번호를 대체할 식별 데이터인 QR-ID를 생성하고, 이에 기반을 둔 QR-ID 카드를 제안한다. QR 코드는 인식기에 대한 제약이 적고 일부 데이터 조작만으로 새로운 QR 코드 생성이 가능하여 노출 시 새로운 ID로 갱신할 수 있으며, QR-ID는 소유자의 바이오메트릭 데이터로 암호화되어 타인이 복호화 할 수 없다.

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An automated Classification System of Standard Industry and Occupation Codes by Using Information Retrieval Techniques (정보검색 기법을 이용한 산업/직업 코드 자동 분류 시스템)

  • Lim, Heui Seok
    • The Journal of Korean Association of Computer Education
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    • v.7 no.4
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    • pp.51-60
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    • 2004
  • This paper proposes an automated coding system of Korean standard industry/occupation for census which reduces a lot of cost and labor for manual coding. The proposed system converts natural language responses on survey questionnaires into corresponding numeric codes using information retrieval techniques and document classification algorithm. The system was experimented with 46,762 industry records and occupation 36,286 records using 10-fold cross -validation evaluation method. As experimental results, the system show 87.08% and 66.08% production rates when classifying industry records into level 2 and level 5 codes respectively. The system shows slightly lower performances on occupation code classification. We expect that the system is enough to be used as a semi-automate coding system which can minimize manual coding task or as a verification tool for manual coding results though it has much room to be improved as an automated coding system.

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Skeleton Code Generation for Transforming an XML Document with DTD using Metadata Interface (메타데이터 인터페이스를 이용한 DTD 기반 XML 문서 변환기의 골격 원시 코드 생성)

  • Choe Gui-Ja;Nam Young-Kwang
    • The KIPS Transactions:PartD
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    • v.13D no.4 s.107
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    • pp.549-556
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    • 2006
  • In this paper, we propose a system for generating skeleton programs for directly transforming an XML document to another document, whose structure is defined in the target DTD with GUI environment. With the generated code, the users can easily update or insert their own codes into the program so that they can convert the document as the way that they want and can be connected with other classes or library files. Since most of the currently available code generation systems or methods for transforming XML documents use XSLT or XQuery, it is very difficult or impossible for users to manipulate the source code for further updates or refinements. As the generated code in this paper reveals the code along the XPaths of the target DTD, the result code is quite readable. The code generating procedure is simple; once the user maps the related elements represented as trees in the GUI interface, the source document is transformed into the target document and its corresponding Java source program is generated, where DTD is given or extracted from XML documents automatically by parsing it. The mapping is classified 1:1, 1:N, and N:1, according to the structure and semantics of elements of the DTD. The functions for changing the structure of elements designated by the user are amalgamated into the metadata interface. A real world example of transforming articles written in XML file into a bibliographical XML document is shown with the transformed result and its code.

Motor control by using MATLAB/SIMULINK Auto Code Generation (MATLAB/SIMULINK의 Auto Code Generation을 이용한 전동기 제어)

  • Lee, Seul-Ki;Jeong, Hyeon-Woo;Oh, Hyoung-Lok;Lee, Jun-young
    • Proceedings of the KIPE Conference
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    • 2012.07a
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    • pp.77-78
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    • 2012
  • 본 논문에서는 모터와 인버터 그리고 제어기를 모델로 작성하여 시뮬레이션하고, 제어기 모델로부터 자동코드생성을 하여 작성한 코드를 실제 제어기에 탑재하여 모터모델의 시뮬레이션 및 실제 모터를 구동하였다. 제어기와 모터 그리고 인버터 모델은 MATLAB/SIMULINK를 이용하여 작성하였다. 모터 모델과 실제 모터의 동작을 통해 제어기의 성능을 검증하였다. PWM은 10[kHz]로 동작하며, 이를 검증하기 위해 400[W] 표면부착형 동기모터 다이나모 장치와 3상 모터 드라이버를 이용하여 시험을 수행 하였다.

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A Study on Design of F77/J++ Auto-Generator for Based Integration Object-oriented Manager (통합 객체지향 관리기 중점을 둔 F77/J++ 생성기 설계)

  • 선수균;송영재
    • Proceedings of the Korean Information Science Society Conference
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    • 1999.10a
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    • pp.617-619
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    • 1999
  • 웹 환경하에서 소프트웨어 개발을 통합하는 방법과 기존의 Legacy code를 새로운 소프트웨어로 자동생성하는 연구가 집중되고 있고, 새로운 소프트웨어의 단 시간에 습득하려는 노력이 가중되고 있다. 따라서, 본 논문에서는 Legacy code를 통합하고, 호환성, 완전성이고, 적응성이 있는 효율적인 유지보수를 관리해 주는 기능을 담당하는 통합 객체지향 관리기를 제안하고, 제안한 통합 객체지향 관리기를 중점을 둔 F77/J++ 코드 생성기(FORTRAN-7/Java Code generator)를 설계한다. 이는 향후 시스템의 통합에 잇점인 소프트웨어의 재사용성을 극대화하여 생산성을 향상시키는 프로토타이핑을 지원할 것으로 기대된다.

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Performance Improvement of GPS Receiver TTFF for high-speed vehicles using Multiple Correlator (다중 상관기를 이용한 고속 항체용 GPS 수신기의 TTFF 성능 향상)

  • Shin, Dae-Sik;Kim, Jeong-Won;Hwang, Dong-Hwan;Lee, Sang-Jeong
    • Proceedings of the KIEE Conference
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    • 2006.07d
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    • pp.1759-1760
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    • 2006
  • GPS 수신기에서 항법을 수행하기 위해서 신호탐색, 신호추적, 데이터 동기, 데이터 복조, 측정치 생성 및 위치 계산의 과정을 거쳐야 한다. TTFF(Time To First Fix)는 이러한 시간의 합으로 수신기의 성능을 나타내는 중요 평가지수 중의 하나이다. 일반적인 수신기의 TTFF는 80~90초인 것으로 알려져 있으며, 고속으로 운동하는 항체의 경우, 빠른 TTFF를 필요로 하므로 가장 긴 시간이 소비하는 신호탐색 과정의 시간을 줄여야 한다. 본 논문에서는 고속으로 운동하는 항체에서 GPS 신호의 코드 탐색 시간을 줄이기 위하여 다중 상관기 구조를 가지는 수신기를 설계 하고자한다. 설계한 수신기는 수신된 신호의 코드위상을 여러 개의 상관기에서 동시에 탐색하도록 다중 상관기를 구성하여 코드위상 검색에 소요되는 시간을 단축시킨다. 이를 검증하기 위하여 GPS 모의 신호 발생기를 이용하여 실험을 수행하였다. GPS 신호는 IF 데이터 수집 장치로부터 수집된 신호를 이용하며, 실험 수행 결과 다중 상관기를 이용하였을 때 TTFF가 단축되는 것을 확인하였다.

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A Study of Coding Scheme for DC-free RLL Sequence and a Comparison of its DC Suppression Performance (DC억압능력을 갖는 변조방식과 DC억압 성능비교에 관한 연구)

  • Shim, Jae-Seong;Won, Yong-Kwang;Seo, Joong-Eom;Park, In-Sik;Shin, Dong-Ho
    • Proceedings of the KIEE Conference
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    • 1999.07g
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    • pp.3123-3125
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    • 1999
  • 광기록 저장매체의 기록밀도가 더욱 올라가면서 현재 콤팩트디스크나 DVD(Digital Versatile Disc)에 사용되고 있는 d=2인 코드보다는 검출성능이 좋은 d=1인 코드에 대한 관심이 점점 높아지고 있다. 광기록 저장매체에 사용할 수 있는 코드가 갖추어야할 중요한 제한조건으로는 코드열의 전력밀도가 저주파에서 충분히 억압될 수 있어야 한다는 것이다. 광자기디스크나 하드디스크에서 사용된 적이 있는 (1.7)코드는 코드자체로서 DC억압능력을 갖고있지 않다. DC를 억압시키기 위해 보통 부가비트를 일정간격으로 삽입하거나 싱크를 이용하게 되는데 이와 같은 방법으로는 충분한 DC억압이 어렵거나 기록밀도를 올리는데 불리한 원인이 된다. 본 논문에서는 코드열 자체로서 DC억압능력을 갖고 있는 코드워드의 생성방식과 변조 알고리즘을 RLL(1,8)인 경우를 예로 제시하였다. 또한 본 논문에서 제시한 코드의 성능에 대한 검증으로 기존의 RLL(1,8)코드(1)와 본 논문에서 제시한 코드에 4%이하의 부가비트를 삽입하여 DC억압을 수행한 뒤 동일한 기록밀도에서 DC억압성능을 비교하였을 때 저주파 대역에서 $1^{\sim}5dB$이상의 개선효과가 있었음을 확인하였다.

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Design of Mutant-based Practical Test Problem Generator for Programming Education (프로그래밍 학습을 위한 뮤턴트 기반의 실습 문항 생성기의 구조 설계)

  • Kwak, Yong-Sub;Lee, Sunghee;Lee, Woo Jin
    • Proceedings of the Korea Information Processing Society Conference
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    • 2017.04a
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    • pp.649-652
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    • 2017
  • 프로그래밍 교육에서 실습교육은 소스 코드를 직접 작성해보는 과정을 통해 이론적인 지식을 보완할 수 있는 매우 중요한 과정이다. 따라서 대부분의 프로그래밍 교과과정은 실습교육을 포함하고 있다. 그러나 실습교육을 통해 학습 성취도를 평가하는 일은 시간과 비용이 많이 소모되는 작업이다. 그래서 많은 교육기관에서는 평가를 효율적으로 하기 위해 자동 평가 시스템을 운용하고 있다. 자동 평가 시스템은 학생들의 실습 결과를 정확하고 신속하게 평가하는데 효과적이다. 그러나 실습교육에 필요한 실습문항은 대부분의 경우 교사가 수작업으로 생성하며 이 과정에서 많은 인적 시간적 비용이 발생하게 된다. 이러한 문제를 해결하기 위해서 문항 생성을 자동화하려는 연구가 진행되고 있으나 아직까지 초기 단계이며 새로운 문항을 생성하지 못하는 등의 제약 사항이 많아 적용하기에 무리가 있다. 따라서 본 논문에서는 하나의 문항으로부터 다양한 문항들을 변형하여 생성할 수 있는 방법을 제안하고 이를 지원하는 프로그래밍 실습용 문항 생성기의 구조를 설계한다.

A design and implementation of VHDL-to-C mapping in the VHDL compiler back-end (VHDL 컴파일러 후반부의 VHDL-to-C 사상에 관한 설계 및 구현)

  • 공진흥;고형일
    • Journal of the Korean Institute of Telematics and Electronics C
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    • v.35C no.12
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    • pp.1-12
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    • 1998
  • In this paper, a design and implementation of VHDL-to-C mapping in the VHDL compiler back-end is described. The analyzed data in an intermediate format(IF), produced by the compiler front-end, is transformed into a C-code model of VHDL semantics by the VHDL-to-C mapper. The C-code model for VHDL semantics is based on a functional template, including declaration, elaboration, initialization and execution parts. The mapping is carried out by utilizing C mapping templates of 129 types classified by mapping units and functional semantics, and iterative algorithms, which are combined with terminal information, to produce C codes. In order to generate the C program, the C codes are output to the functional template either directly or by combining the higher mapping result with intermediate mapping codes in the data queue. In experiments, it is shown that the VHDL-to-C mapper could completely deal with the VHDL analyzed programs from the compiler front-end, which deal with about 96% of major VHDL syntactic programs in the Validation Suite. As for the performance, it is found that the code size of VHDL-to-C is less than that of interpreter and worse than direct code compiler of which generated code is increased more rapidly with the size of VHDL design, and that the VHDL-to-C timing overhead is needed to be improved by the optimized implementation of mapping mechanism.

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Design and Implementation of EJB Wrapper Component Supporting Cobol Code Analyzer for Legacy System (레거시 시스템을 위한 EJB 레퍼 컴포넌트 지원 코볼 코드 분석기 설계 및 구현)

  • Joo, Sang-Hyun;Im, Dong-Ki;Jung, Min-Soo
    • Proceedings of the Korea Information Processing Society Conference
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    • 2003.11c
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    • pp.1559-1562
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    • 2003
  • 최근에 기존 레거시 시스템의 새로운 컴퓨팅 환경으로의 전환을 위해, 재개발, 변환, 래핑 등의 방법을 사용하고 있으며, 이러한 경향은 레거시 시스템의 현대화를 촉진시키고 있다. 레거시 시스템을 컴포넌트화 함으로써 기존의 시스템을 재사용하고 개발기간의 단축 및 시스템의 유지 보수가 용이하도록 한다. 본 논문에서는 레거시 시스템에서 사용되는 시스템의 핵심 변수와 패턴 식별에 사용되는 정보 저장소를 생성하여 레거시 시스템을 컴포넌트 기반 시스템으로 변환하는데 용이하도록 하였다. 정보 저장소의 보다 효율적인 구성을 위해서 코볼 코드의 릴레이션간의 릴레이션 중복을 방지하는 최적화된 코볼 코드 분석기를 설계하고 구현함으로써 보다 효율적인 정보 저장소를 구성할 수 있도록 하였다.

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