• 제목/요약/키워드: 칩 제어

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2차원 절삭 칩 모델에 의한 응력분포 해석에 관한 연구 (A Study on the Analysis of Stress Distribution by Orthogonal Cutting Chip Model)

  • 김정두;이은상;현동훈
    • 대한기계학회논문집
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    • 제17권12호
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    • pp.2926-2935
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    • 1993
  • Chip breaker selection analysis, only being possible through experimental process, was obtained by a applied equation which used an orthogonal cutting model and a basic chip deformation. This equation could present an analysis of the chip breaking phenomena without the use of an actual experimetal method, and it was applied to computer simulation and proved the validity of theory through actual experiments. From these results, an efficient method for finding the optimum conditions of chip breaking was found through an optimized theory being applied to basic program. A finite element model for simulating chip breaking in orthogonal cutting was developed and discussed. By simulation the animation of chip breaking is observed in process on the computer screen.

Demodulator를 탑재한 Full-Duplex RFID칩 설계 (Design of a Full-Duplex RFID chip with Demodulator)

  • 김도균;이광엽
    • 한국정보처리학회:학술대회논문집
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    • 한국정보처리학회 2000년도 추계학술발표논문집 (상)
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    • pp.465-468
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    • 2000
  • 본 논문에서는 인식코드를 전송할 수 있는 modulator 뿐만 아니라 Reader system으로부터 코드 전송제어 명령어를 수신할 수 있고 향후 EEPROM과 더불어 인식코드를 수정할 수 있는 RFID (Radio Frequency IDentification) Transponder 칩 설계에 관한 내용을 다룬다. RFID칩은 배터리를 사용하지 않고 명령어와 함께 형성되는 Field로부터 전원을 생성하고 동시에 코드를 제공하는 Full-Duplex 구조로 설계하였다. Transponder IC는 power-generation 회로, clock generation 회로, digital block, modulator, overvoltage protection 회로로 구성된다. 설계된 칩은 저전력 회로를 적용하여 원거리 transponder칩을 구현할 수 있도록 하였다. 설계된 회로는 $0.6{\mu}m$ 현대 CMOS 공정으로 레이아웃 하였으며 제작중에 있다.

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단일 칩 전력선 모뎀을 이용한 가정에서의 전력선 통신 (Power Line Communications with a Single-Chip Power Line Modem in Household)

  • 박종연;최승지
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2002년도 하계학술대회 논문집 D
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    • pp.2605-2607
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    • 2002
  • 전력선 통신의 경우 X-10, LonWorks, CEBus, iCAL PLX 등의 가정자동화 네트워크를 위한 프로토콜이 있으며 이와 함께 Philips사(社)의 TDA5051AT, ST사(社)의 ST7537HS1 그리고 National Semiconductor사(社)의 LM1893/LM2893의 단일 칩 전력선 모뎀이 있다. 이러한 단일 칩 전력선 모뎀은 간단한 주변회로 및 컨트롤러만으로 가정기기의 제어 시스템을 구성할 수 있으므로 개발이 용이하고 비용이 저렴하다는 등의 장점을 가지고 있다. 본 논문에서는 이러한 단일 칩 전력선 모델의 중에서 ST사(社)의 ST7S37HS1, Philips사(社)의 TDAS051AT를 선정하여 가정 내에서의 통신에 대하여 성능을 비교, 검토하였다. 성능의 비교, 검토는 가정 내의 AC 220V, 60Hz 전원 전압의 영 전위 및 최대 전위 지점에서 데이터를 전송할 경우에 나타나는 에러의 수로 확인하였다.

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TMS320F240 DSP 컨트롤러를 이용한 서보모터 드라이브 개발 (Development of Servo Motor Drive System Using TMS320F240 DSP controller)

  • 구본관;김준하;남광희
    • 전력전자학회:학술대회논문집
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    • 전력전자학회 1998년도 전력전자학술대회 논문집
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    • pp.357-360
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    • 1998
  • 본 논문에서는 TI(Texas Instruments)사의 DSP칩 TMS320F240을 이용한 벡터드라이브 설계를 한다. TMS320F240은 서보모터드 라이브에 적합하게 상품화 된 칩으로 산업용 로봇제어에 필요한 대부분의 주변회로를 포함하고 있다. 이를 이용해서 제어기를 구성하면 적은 비용으로 신뢰성 높은 제어기를 구성할 수 있다. 드라이브는 크게 제어회로부와 파워회로부로 나누어서 설계했으며, AC서보모터에 벡터제어로 실제적용을 했다.

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실시간 이차원 웨이블릿 변환의 FPGA 구현을 위한 효율적인 메모리 사상 (The Efficient Memory Mapping of FPGA Implementation for Real-Time 2-D Discrete Wavelet Transform)

  • 김왕현;서영호;김종현;김동욱
    • 한국통신학회논문지
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    • 제26권8B호
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    • pp.1119-1128
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    • 2001
  • 본 논문에서는 이차원(2-D) 이산 웨이블릿 면환(Discrete Wavelet Transform, DWT)을 이용한 연상압축기를 FPGA 칩에서 실시간으로 동작 가능하도록 하는 효율적인 메모리 스케줄링 방법(E$^2$M$^2$)을 제안하였다. S/W적으로 위의 메모리 사상 방법을 검증한 후, 실제로 상용화된 SFRAM을 선정하여 메모리 제어기를 구현하였다. 본 논문에서는 Mallet-tree를 이용한 2-D DWT 영상압축 칩을 구현할 경우를 가정하였다. 이 알고리즘은 연산 과정에서 많은 데이터를 정장하여야 하는데, FPGA는 많은 데이터를 저장할 수 있는 메모리가 내장되어 있지 않으므로 외부 메모리를 사용하여야 한다. 외부메모리는 열(row)에 대해서만 연속(burst) 읽기, 쓰기 동작이 가능하기 때문에 Mallet-tree 알고리즘의 데이터 입출력을 그대로 적용할 경우 실시간 동작을 수행하는 DWT 압축 칩을 구현할 수 없다. 본 논문에서는 데이터 쓰기를 수행할 경우에는 메모리 셀(cell)의 수직 방향을 저장시키고 읽기를 수행할 때는 수평으로 데이터의 연속 읽기를 수행함으로써 필터가 항상 수평 방향에 위치하게 하는 방법을 제안하였다. 입방법을 C-언어로 DWT 커넬(Kernel)과 메모리의 에뮬레이터(emulator)를 구현하여 실험한 결과, Mallat-tree 이론을 그대로 적용시켰을 때와 동일한 필터링을 수행할 수 있음을 검증하였다. 또한, 상용화된 SDRAM의 메모리 제어기를 H/W로 구현하여 시뮬레이션 함으로써 본 논문에서 제안한 방법이 실제적인 하드웨어로 실시간 동작을 할 수 있음을 보였다.

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FPGA 기반 실용적 마이크로프로세서의 구현 (FPGA-Based Implementation of a Practical 8-Bit Microprocessor)

  • 안정일;박성환;권성재
    • 한국산업정보학회:학술대회논문집
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    • 한국산업정보학회 2006년도 춘계 국제학술대회 논문집
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    • pp.119-123
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    • 2006
  • 본 논문에서는 마이크로프로세서의 기능을 수행하는 데 필수적이며 사용빈도가 높은 총 64개의 명령어를 정의한 후 이를 처리할 데이터패스를 구성해 스테이트 머쉰으로 제어하는 방식으로 실용적 8비트 마이크로프로세서를 VHDL로 설계를 하고 FPGA로 구현했다. 통상 마이크로프로세서 관련 논문에서는 기능적 시뮬레이션까지만 했거나, 인터럽트 기능이 없든지, 하드웨어로 구현을 하지 않았거나, 또는 개발 관련 내용이 자세히 제시되지 않았었다. 본 논문에서는 데이터 이동, 논리, 가산 연산뿐만 아니라 분기, 점프 연산도 실행할 수 있도록 해 연산 및 제어용도에 적합하도록 하였고, 스택, 외부 인터럽트 기능까지도 지원하도록 해 그 자체로서 완전한 실용적 마이크로프로세서가 되도록 하였다. 또한 프로그램 ROM까지도 칩 안에 넣어 전체 마이크로프로세서를 단일 칩으로 구현하였다. 타이밍 시뮬레이션으로 검증 후 제작 과정을 통해, 설계된 마이크로프로세서가 정상적으로 동작함을 확인하였다. Altera MAX+.PLUS II 통합개발환경 하에서 EP1K50TC144-3 FPGA 칩으로 구현을 하였고 최대 동작주파수는 9.39MHz까지 가능했고 사용한 로직 엘리먼트의 개수는 2813개로서 논리 사용률은 97%이었다.

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AE신호에 의한 칩 절단성 예측 (Chip Breaking Prediction Using AE Signal)

  • 최원식
    • 한국생산제조학회지
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    • 제8권4호
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    • pp.61-67
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    • 1999
  • In turning the chip may be produced in the form of continuous chip or discontinuous one. Continuous chips produced at high speed machining may hit the newly cut workpiece surface and adversely affect the appearance of the surface finish and may interfere with tool and sometimes induce tool fracture. In this study relationship between AE signal and chip form was experimentally investigated, The experimental results show that types of chip form are possible to be classified from the AE signal using fuzzy logic.

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홈 게이트웨이용 칩셋 및 스위치 구조 설계 (Korea Electronics Technology Institute)

  • 최광순;정광모
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2002년도 가을 학술발표논문집 Vol.29 No.2 (3)
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    • pp.619-621
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    • 2002
  • 최근에 인터넷의 보급이 확산되어지면서, 사용자들의 VOD, 홈 네트워킹과 같은 고품질의 서비스 요구도 증가하게 있는 추세이다. 특히 홈 네트워킹 시스템에서는 인터넷을 통해 댁내의 가전제품과의 상호연결 및 제어까지 할 수 서비스의 개발에 박차를 가하고 있다. 이는 즉, 이기종 프로토콜을 수용하면서도 이들 간의 통신이 가능하게 하는 새로운 구조의 공통 프로토콜과 새로운 시스템 구조가 필요함을 의미한다. 본 논문에서는 이러한 공통프로토콜과 새로운 칩의 구조 및 칩 내부의 패킷 스위칭을 위한 새로운 스위치 구조를 제안한다.

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ATM망에서의 UPC 알고리즘 구현 (Implementation of UPC algorithm in ATM network)

  • 이요섭;조태경;최명렬
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2002년도 가을 학술발표논문집 Vol.29 No.2 (3)
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    • pp.88-90
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    • 2002
  • 본 논문에서는 ATM 망의 트래픽 제어 기능 중의 하나인 UPC(Usage Parameter Control) 알고리즘을 제안하고 VHDL을 이용하여 칩(chip)을 구현하였다. 제안한 알고리즘은 우선순위가 높은 셀의 손실을 최소로 하고, 트래픽의 다중화 및 역다중화 과정에서 발생되는 트래픽의 군집성을 해소할 수 있다는 장점을 갖고 있다. 구현한 칩은 입력 모듈과 UPC 모듈, 출력 모듈의 3부분으로 이루어지며, 편의상, UPC 모듈에서는 커넥션 테이블의 index를 VCI(Virtual channel Identifier)와 동일하게 할당하였다. 또한 UPC 모듈의VSA(Virtual Scheduling Algorithm)블럭에서 셀의 도착시간을 계수하는 카운터가 랩-어라운드(wrap-around)할 때 생기는 VSA의 오류를 보정하여 구현하였다.

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24-GHz 응용을 위한 저전력 전압제어발진기 설계 (Design of Low-Power Voltage-Controlled Oscillator for 24-GHz Applications)

  • 최근호;성명우;김신곤;;;;최승우;;류지열;노석호;길근필
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2015년도 추계학술대회
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    • pp.852-853
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    • 2015
  • 본 논문에서는 차량 추돌 방지 레이더용 24GHz 전압제어발진기를 제안한다. 제안한 회로는 TSMC $0.13-{\mu}m$ 고주파 CMOS 공정 ($f_T/f_{MAX}=120/140GHz$)으로 구현되어 있고, 1.5 볼트 전원전압에서 동작한다. 전체 칩 면적과 소비전력을 줄이기 위해 수동형 인덕터 대신 트랜지스터와 전류원으로 구성된 능동형 인덕터부를 사용하였다. 제작된 전압제어발진기는 기존 연구 결과에 비해 동작주파수에서 6.1mW의 낮은 소비전력 특성과 $0.06mm^2$의 매우 작은 칩 면적 특성을 보였다.

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