VLSI칩 내부애서 길이가 긴 도선을 통해서 데이터를 보낼 메, 누화(crosstalk)의 영향으로 데이터 값에 따라 지연시간이 변한다. 그리고 지연시간의 변화폭도 CMOS공정이 초미세화됨에 따라서 더욱 커진다. 본 논문에서는 지연시간을 줄이기 위해서, 데이터 코딩을 이용하여 가장 긴 지연시간을 피하는 데이터 초기화에 기반한 단일선 4-위상 프로토롤을 제안한다. 제안된 프로토콜을 긴 도선에 적용함으로써 도선에서의 최대 지연시간을 최대 49% 감소시킨다.
본 논문은 다수의 사용자에 대한 실시간 멀티미디어 서비스에서 문제가 되는 초기 지연시간을 최소화하는 새로운 동적 스트림 합병 기법을 제안한다. 제안된 기법은 멀티미디어 서비스, 특히 비디오 서비스의 경우 약간의 QoS 변화가 서비스의 질에 큰 영향을 미치는 않는 점을 이용하여, 시간적으로 서로 인접한 여러 개의 스트림을 점차적으로 합병하여 서비스함으로써 짧은 초기 지연시간 유지를 위한 버퍼의 양을 최소화 할 수 있다. 성능분석 결과에서 제안된 기법은 기존의 방법들에 비하여 버퍼 활용면에서 우수한 성능을 나타냄을 보인다.
디지털 사이니지란 멀티미디어 기반의 정보와 광고를 소비자에게 전달하는 스마트 전자 디스플레이 시스템을 일컫는다. 대부분의 디지털 사이니지는 일련의 멀티미디어 콘텐츠를 원격 네트워크 스토리지로부터 로컬 디스크로 다운로드 한 후에 재생을 시작한다. 하지만 모든 콘텐츠를 다운로드 한 후 재생할 경우에 긴 초기 지연시간을 초래한다. 본 논문에서는 디지털 사이니지에서 이러한 초기 지연시간 문제를 정의하고, 주어진 네트워크 대역폭 및 멀티미디어 콘텐츠의 품질과 크기에 따라서 최소한으로 필요한 초기 지연시간을 계산하는 방법을 제시한다. 또한, 디지털 사이니지 상의 다양한 멀티미디어 콘텐츠들을 이용하여 본 제안 기법의 성능을 분석한다.
테크놀로지 매핑의 효율성은 매핑된 회로의 지연시간과 회로의 면적에 의해서 평가되어진다. 특히 순차회로에서는 레지스터 사이의 조합회로의 최대지연시간에 의해서 전체회로의 지연시간이 결정된다. 본 논문에서는 순차회로에 대한, 건설적인(Constructive) 단계와 반복적인(Iterative) 단계의 리타이밍 기술과 퍼지 논리에 의해 향상된 FPGA 매핑 알고리즘을 소개한다. 주어진 초기회로는 건설적인 방법에 의하여 FPGA회로로 초기매핑되어진후 반복적인 리타이밍에 의하여 매핑회로의 효율을 높이게된다. 초기회로에 주어진 여러 가지 기준들은 결정 함수(Decision Making)에 대한 퍼지 이론 법칙의 계층적인 구조에 의해 연결되어져 있다. 제안된 매퍼는 MCNC 밴치마커의 실험을 통해 지연시각과 면적에서 기존 매핑시스템의 성능을 능가함을 보여준다.
AE와 DRA를 이용한 초기응력 측정법은 실험실 시험을 통해 초기응력을 측정하는 방법 중의 하나이다. 이 방법은 시추와 실험실 시험간에 지연시간이 발생하며 시료에 축방향 반복하중을 가하여 초기응력을 결정하기 때문에 지하 암반의 응력 상태와는 다른 결과를 얻을 수도 있다. 이 연구에서는 지연시간을 다르게 하여 지연시간이 선행응력 결정에 미치는 영향을 살펴보았다. 그리고 축방향 선행응력만을 가한 시료와 축방향 선행응력과 봉압을 모두 가한 시료에 대해 AE와 DRA를 이용하여 선행응력을 결정하여 봉압이 축방향 선행응력 결정에 미치는 영향을 살펴보았다. 지연시간이 길어질수록 오차가 약간씩 증가하는 경향이 나타났으나 지연시간이 1개월인 시료라 할지라도 AE와 DRA를 이용한 경우 각각 16%와 12%의 오차범위 내에서 선행응력을 결정할 수 있었다. 축방향 선행응력만을 가한 경우 AE를 이용하면 9%, DRA를 이용하면 4%의 오차범위 내에서 축방향 선행응력을 결정할 수 있었으나 축방향 선행응력과 봉압을 모두 가한 경우는 각각 17%와 14%의 오차범위 내에서 축방향 선행응력을 결정할 수 있었다. 터널현장에서 시추한 코어를 이용하여 초기응력을 측정한 결과 AE와 DRA는 유사한 결과를 나타내었으나 수압파쇄법에 의한 결과보다는 작은 값을 갖는 것으로 나타났다.
고속의 동작 주파수를 갖는 메모리 제어기를 설계하여 PCB에서 고속 메모리와 통신을 할 경우 연결선의 길이와 배치에 따라 데이터가 전달되는 시간이 달라진다. 따라서 메모리 제어기를 설계한 뒤 PCB 상에서 메모리와 연결하여 동작시킬 때마다 이러한 지연시간이 달라져 제어기의 입출력 회로를 다시 설계하거나 초기화시 내부 설정을 바꾸어 주어야 한다. 본 논문에서는 이러한 문제를 해결하기 위해 제어기 내부에 초기화 단계에서 메모리에 테스트 패턴을 쓰고 읽으며 지연시간을 측정하고 적응적으로 지연시간을 고려한 입출력 회로를 구성하는 학습 방법을 제안한다. 제안한 학습 방법에서는 테스트 패턴을 쓰고 최소 시간 단위로 데이터를 읽는 타이밍을 바꾸어 가며 차례로 읽기를 시도하여 테스트 패턴이 정확히 읽히는 타이밍을 기억하여 초기화가 끝난 뒤 정상 동작을 시작하였을 때 학습 결과를 반영하여 메모리 접근을 시도한다. 제안한 학습 방법을 이용하면 PCB에 새로운 시스템을 구성하여도 초기화시 지연시간을 새로 설정하므로 제어기와 메모리의 통신 지연 문제를 해결할 수 있다. 제안한 방식은 고속의 SRAM, DRAM, 플래시 메모리 등에 사용 가능하다.
리튬 전지(Li/SOCl2)는 오랜기간 방치후 부하를 인가하였을 때 순간적으로 전압이 하강하여 정상적인 작동전압을 회복하는데 까지 일정 시간이 경과해야만 하는 단점이 있는데, 이를 리튬전지의 초기전압지연이라 한다. 리튬 전지에서 필연적으로 발생하는 초기전압지연으로 인해 장비를 즉시 사용할 수 없는 단점이 있으므로, 초기전압지연 시간을 단축하는 것은 Li/SOCl2 시스템에서 극복해야 할 근본적인 과제이다. 본 논문에서는 전해액에 첨가제를 투입하거나, 리튬 음극에 PVC를 도포하는 등의 직접적인 방법으로 리튬 표면에 염화리튬 성장을 억제하는 것이 아니라, 양극의 성형밀도를 조절하여 양극 내에서 이온의 이동을 원활하게 유도함으로써, 용액저항을 감소시켜. 초기전압지연을 개선한 연구결과를 수행하였고, 특히 용액의 저항이 증가하는 저온에서 리튬전지의 초기전압지연 감소방안을 실험적 연구를 통해 개선하였다.
IEEE 802.15.4는 전송된 프레임의 초기 충돌을 피하기 위해 대부분의 다른 무선 네트워크 프로토콜들처럼 프레임을 전송하기 전 임의의 시간을 지연하는 CA(Collision A voidance) 알고리즘을 사용한다. IEEE 802.15.4의 CA 방식은 현재의 네트워크 상황에 관계없이 고정된 초기 백오프 선택 구간에서 임의의 백오프 지연 시간을 선택하기 때문에, 긴 시간 동안 높은 통신 부하를 유지하는 네트워크에서는 현재 상황에 알맞은 백오프 지연 시간을 선택하기까지 여러 번의 백오프 지연 과정을 반복하게 된다. 본 논문에서는 네트워크의 혼잡 상황에 따른 충돌 확률을 고려하여 초기 백오프 지연 시간을 적응적으로 선택할 수 있는 ACA(Adaptive Collision Avoidance) 알고리즘을 제안한다. ACA 알고리즘의 성능을 측정하기 위해 수학적 모델을 제시하며, ns-2를 이용한 시뮬레이션을 통해 모델의 정확성을 검증하고 네트워크 혼잡 상황에 따른 최적의 초기 백오프 지연 시간을 제시한다. 분석 결과, ACA알고리즘을 사용할 때 표준에 비해 처리량이 최대 41% 이상 증가하고 평균 서비스 지연 시간은 기존보다 더욱 짧게 나타났다.
MPEG-4 파일 포맷은 사용자에게 다양한 기능을 제공하고 다수의 데이터를 유연성있게 제어하기 위해 많은 양의 메타데이터를 정의하고 있고, 이에 접근하는 서버와 로컬 시스템은 이들 메타데이터를 분석하는데 오랜 시간을 소비해야 한다. 본 논문은 이런 분석 지연을 없애기 위해 MPEG-4 파일에서 메타데이타를 실시간으로 분석하여 초기 지연 시간을 줄이는 방법을 제시하며, 그 결과를 보인다.
모바일폰, MP3 플레이어, PDA와 같은 개인 휴대용 임베디드 기기가 다양해지면서, 각 기기의 부팅 시간은 제품 경쟁력을 위해 개발자가 고려해야할 중요한 이슈가 되었다. 이를 위해 Disable Console[1], Kernel XIP[2], IDENoProbe[3] 등의 기술이 제안되었지만, 부팅 시간의 80%를 차지하는 디바이스 초기화와 드라이버 등록에 대한 고려가 부족하다는 점에서 한계를 가진다. 본 연구에서는 부팅 시에 불필요한 IDE나 다른 인터페이스 채널의 초기화 과정 및 디바이스 드라이버의 등록과정을 생략하고, 그 과정을 부팅이 완료된 후로 지연시킴으로써 부팅 시간을 단축시키는 방법을 제안한다. 본 연구를 이용할 경우 부팅 시에 불필요한 IDE 인터페이스 채널의 초기화를 생략함으로써 기존 시스템의 부팅 시간에 비해 약 7초 정도 (일반 리눅스 부팅 시간의 약 14.15% 개선)의 성능 향상을 기대할 수 있으며, 나아가 부팅 과정의 80% 정도를 차지하는 디바이스 드라이버의 등록 과정의 일부를 생략하여 부팅 성능을 개선할 수 있는 실험적 근거를 제시하였다.
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[게시일 2004년 10월 1일]
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