• Journal of the Korean Institute of Telematics and Electronics C
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• v.36C no.11
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• pp.55-63
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• 1999

A new CMOS If Package design methodology is presented, analyzing the electrical characteristics of a package and its effects on the CMOS digital circuits. An analytical investigation of the package noise effects due to the simultaneous switching of the gates within a chip, i.e., simultaneous switching noise (SSN) is performed. Then not only are novel design formula to meet electrical constraints of the Package derived, but also package design methodology based on the formula is proposed. Further, in order to demonstrate the Proposed design methodology, the design results are compared with HSPICE (a general purpose circuit simulator) simulation for $0.3\mu\textrm{m}$-based CMOS circuits. According to the proposed design procedures, it is shown that the results have excellent agreements with those of HSPICE simulation.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.39 no.4
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• pp.84-92
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• 2002

As today's field programmable gate arrays have very large logic capacity as well as relatively fast operation speed, they're widely used in many application areas. However, debugging the design implemented in FPGA's is very time-consuming and painful as the internal signal probing usually requires large number of FPGA re-compilations, which take tremendously long time. In this paper, we analyze the problems in FPGA debugging and propose a new powerful debugging solution. With the proposed FPGA debugging solution, we can guarantee not only to provide 100% internal signal visibility without FPGA re-compilation for the design in FPGA's, but also to identify at least one design bug per FPGA compilation. An experimental result has clearly shown the proposed approach to FPGA debugging very powerful and practical.

• The Korean Journal of Applied Statistics
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• v.17 no.1
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• pp.13-26
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• 2004

According to economic growth theory, location configuration of business enterprises engaged in specific industries has spatial affinity. In this research we defined industrial concentration index to measure industry agglomeration using the characteristics of dispersion parameter of negative binomial distribution, and used the industrial concentration index to examine aspect of spatial configuration change. We utilized Census on Basic Characteristics of Establishments of 1995 and 2000 to deduce industrral concentration indices of 7 knowledge-based industries and 9 strategy-based industries of Choongbuk Province and analyzed the aspect of spatial configuration change.

• The Journal of Korean Institute of Communications and Information Sciences
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• v.18 no.2
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• pp.250-260
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• 1993

Packet Reservation Multiple Access(PRMA) protocol provides a very efficient mechanism for many number of voice and data terminals with bursty traffic characteristics to share efficiently a common transmission channel. This protocol, however, cannot operate in high load conditions. That is, there occurs a instability problem, since the reservation channel is allowed to shrink to zero. In this paper, a more stable PRMA protocol which can avoid such problems and integrates voice and data traffic efficiently is proposed. Also, the performance of the proposed protocol is analyzed by a computer simulation. According to the simulation results, it can be shown that the proposed protocol provides a more efficient mechanism for voice/data integration and ensures a more stable operation than conventional PRMA protocol in high load conditions.

• Proceedings of the Korean Vacuum Society Conference
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• 2012.02a
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• pp.145-145
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• 2012

반도체 집적회로의 집적도가 증가함에 따라 RC delay가 증가하며, 금속 배선의 spiking, electromigration 등의 문제로 인해 기존의 알루미늄 금속을 대체하기 위하여 구리를 배선재료로 사용하게 되었다. 하지만 구리는 실리콘 및 산화물 내에서 매우 빠른 확산도를 가지고 있으므로, 구리의 확산을 막아 줄 확산방지막이 필요로 하다. 이러한 확산방지막의 증착은, 소자의 크기가 작아짐에 따라 via/contact과 같은 고단차 구조에도 적용이 가능하도록 기존의 sputtering 증착 방법에서 이를 개선한 collimated sputter, long-throw sputter, ion-metal plasma 등의 방법으로 물리적인 증착법이 지속되어 왔지만, 근본적인 증착방법을 바꾸지 않는 한 한계에 도달하게 될 것이다. 원자층 증착법(ALD)은 CVD 증착법의 하나로, 소스와 반응물질을 주입하는 시간을 분리함으로써 증착하고자 하는 표면에서의 반응을 유도하여 원자층 단위로 원하는 박막을 얻을 수 있는 증착방법이다. 이를 이용하여 물리적 증기 증착법(PVD)보다 우수한 단차피복성과 함께 정교하게 증착두께를 컨트롤을 할 수 있다. 본 연구에서는 이러한 원자층 증착법을 이용하여 구리 배선을 위한 확산방지막으로 텅스텐질화막을 형성하였다. 텅스텐 질화막을 형성하기 위하여 금속-유기물 전구체와 함께 할라이드 계열인 WF6를 텅스텐 소스로 이용하였으며, 이에 대한 원자층 증착방법으로 이루어진 박막의 물성을 비교 평가하여 분석하였다.

• Proceedings of the Korean Vacuum Society Conference
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• 2011.02a
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• pp.109-109
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• 2011

1T-1C로 구성되는 기존의 DRAM(Dynamic Random Access Memory)은 데이터를 저장하기 위한 적절한 capacitance를 확보해야 한다. 따라서 캐패시터 면적으로 인한 집적도에 한계에 직면해있다. 따라서 이를 대체하기 위한 새로운 DRAM인 1T (Transistor) DRAM이 각광받고 있다. 기존의 DRAM과 달리 SOI (Silicon On Insulator)기술을 이용한 1T-DRAM은 데이터 저장을 위한 캐패시터가 필요없다. Impact Ionization 또는 GIDL을 이용해 발생한 정공을 채널영역에 가둠으로 서 발생하는 포텐셜 변화를 이용한다. 이로서 드레인 전류가 변화하며, 이를 이용해 '0'과 '1'을 구분한다. 기존의 1T-DRAM은 단결정 실리콘을 이용하여 개발되었으나 좀더 광범위한 디바이스로의 적용을 위해서는 다결정 실리콘 박막의 형태로 제작이 필수적이다. 단결정 실리콘을 이용할 경우 3차원 집적이나 기판재료선택에 제한적이지만 다결정 실리콘을 이용할 경우, 기판결정이 자유로우며 실리콘 박막이나 매몰 산화층의 형성 및 두께 조절이 용이하다. 때문에 3차원 적층에 유리하여 다결정 실리콘 박막 형태의 1T-DRAM 제작이 요구되고 있다. 따라서 이번연구에서는 엑시머 레이저 어닐링 및 고상결정화 방법을 이용하여 결정화 시킨 다결정 실리콘을 이용하여 1T-DRAM을 제작하였으며 메모리 특성을 확인하였다. 기판은 상부실리콘 100 nm, buried oxide 200 nm로 구성된 SOI구조의 기판을 사용하였다. 엑시머 레이저 어닐링의 경우 400 mJ/cm2의 에너지를 가지는 KrF 248 nm 엑시머 레이저 이용하여 결정화시켰으며, 고상결정화 방법은 $400^{\circ}C$ 질소 분위기에서 24시간 열처리하여 결정화 시켰다. 두가지 결정화 방법을 사용하여 제작되어진 박막트랜지스터 1T-DRAM 모두 kink 현상을 확인할 수 있었으며 메모리 특성 역시 확인할 수 있었다.

• Proceedings of the Korean Institute of Surface Engineering Conference
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• 2018.06a
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• pp.34-34
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• 2018

레이저를 통한 플라스틱 일체형 회로형성 기술은 레이저 직접 성형 (Laser Direct Structuring, LDS) 기술과 도금기술을 이용하여 기판 표면에 전도성 회로 패턴을 형성하고 소자를 집적하여 부품을 제작하는 기술이다. 종래에는 PCB 기반의 평면기판을 기반으로 하여 제작된 소자와 부품이 전자제품의 주를 이루었으나, 최근 소자의 집적화와 제품 디자인의 유연화(flexible)로 굽힘(bendable) 형태의 스마트 시계와 같은 웨어러블(wearable) 전자 제품이 출시되었으며, 레이저를 통한 플라스틱 일체형 회로형성 기술은 미래 사회의 주를 이룰 웨어러블 형태의 제품의 상용화를 가능하게 할 뿐만 아니라 회로 집적이 가능하여 제품 혁신을 주도할 기술로 주목 받고 있다. 본 연구에서는 LDS 부품의 미세 회로 구현을 위한 공정 기술 개발에 있어서 고생산성 무전해 동도금액 및 부품 실장을 위한 표면처리 기술 개발에 대한 결과를 보고한다. 미세 회로 패터닝 기술의 상용화를 위해서는 도금액의 안정성뿐만 아니라 고속 공정기술이 필요하다, 현재 국내 무전해 동 도금의 석출 속도는 시간 당 $4{\sim}5{\mu}m$ 내외이기 때문에, 생산성을 향상시키기 위해서는 시간 당 $10{\mu}m$ 정도의 고속 무전해 동 도금 공정 개발 필요하다.

• Korean Journal of Materials Research
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• v.11 no.5
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• pp.385-392
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• 2001

There have been many investigations and researches on PLC type of optical amplifiers because they are convenient for mass production and also can integrate multi-functional devices into a single chip. In this research. the fabrication of optical waveguide made of Si/$Sio_2$ by FHD(Flame Hydrolysis Deposition) for passive integrated optical devices and $1.5\mu\textrm{m}$ optical amplifier by Solution Doping method, which is one of the method doping $Er^{3+}$ into the thin film, are mainly discussed.

• Journal of the Institute of Electronics Engineers of Korea TC
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• v.45 no.12
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• pp.66-73
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• 2008

At MANET, Broadcasting message transmission makes throughput decrease because all of MANET nodes are participated at retransmitting broadcasting messages. Especially, burst RREQ transmission causes broadcasting message congestion and inter-RREQ transmission delay. In this paper, we propose a RREQ aggregation method applied to the sender node and intermediate node for solving the problem caused by burst RREQ generation. And we analysis performance of the proposed method by examining at the real testbed.

• Korean Journal of Agricultural Science
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• v.7 no.1
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• pp.44-51
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• 1980

The population of indole-forming thermophile was obtained for the first time several samples of soil and compost manure. The population was highly enriched by successive transfer in the tryptophan liquid medium treated with antibiotics and dilution subculture cloning. Both indole-forming thermophile might be a Gram-negative bacterium hitherto unknown, but its pure culture has not yet been established due to the inability to grow on the solid media.