• 제목/요약/키워드: 주파수 분배

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능동 위상 배열 SAR 안테나를 위한 X-대역 송수신 모듈의 설계 및 제작 (A Design and Fabrication of the X-Band Transmit/Receive Module for Active Phased Array SAR Antennas)

  • 정민길;김상근;나형기;이종환;이동우;백승훈
    • 한국전자파학회논문지
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    • 제20권10호
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    • pp.1050-1060
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    • 2009
  • 본 논문에서는 능동 위상 배열 안테나를 가지는 SAR(Synthetic Aperture Radar)용 X-대역 T/R(Transmit/Receive) 모듈을 설계, 제작하였다. T/R 모듈은 X-대역에서 800 MHz 이상 대역폭을 가지며 이중 편파 운용이 가능하다. 송신 출력 7 W 이상에 잡음지수 3.9 dB 이하를 가진다. 위상과 이득은 6비트 위상변위기와 6비트 디지털 감쇠기에 의해 각각 제어된다. 게다가 제작된 T/R 모듈은 방향성 결합기와 전력분배기로 연결되는 성능 점검/보정 포트를 가진다. LTCC 다층 기판을 사용하여 고직접화 T/R 모듈이 가능하게 하였다. 모든 동작 주파수 대역에서 수신시 RMS 이득 오차는 최대 0.8 dB 이하이고, 송/수신시 RMS 위상 오차는 최대 $4^{\circ}$ 이하로 측정되었고, 또한 시험 결과 T/R 모듈은 요구되는 전기적인 성능을 만족하였다. 이 구조는 능동 위상 배열 SAR용 안테나에 적용될 수 있음을 확인하였다.

매트랩 시뮬링크를 이용한 플랜트 유닛마스터 제어로직 시뮬레이션 기법 개발 (Simulation Methods Development for a Plant Unit Master Control Logic Using Simulink in MATLAB)

  • 윤창선;홍연찬
    • 한국산학기술학회논문지
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    • 제18권2호
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    • pp.324-334
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    • 2017
  • 발전소 유닛마스터제어(UMC)용 시뮬레이터는 국내 및 해외에서 운전원 훈련 목적으로 개발되어 왔다. 일반적으로 UMC 시뮬레이터는 발전소 건설 마지막에 구축되는데, UMC 로직은 발전설비 내에 있는 많은 신호들 간의 간섭사항들을 사전에 확인하기 위해 시뮬레이션이 필수적으로 필요하지만 공정 일정 차이로 인하여 플랜트 로직 설계자나 시운전 엔지니어들이 UMC 로직을 시뮬레이션 하기는 쉽지 않다. 이러한 배경으로 본 논문에서는 발전소 로직 설계자와 운전원들이 매틀랩에서 제공하는 시뮬링크 환경에서 손쉽게 구현할 수 있는 시뮬레이션 방법을 제안한다. UMC의 핵심기능이 수학적 분석과 기능 블록 조합이 기본으로 구성된 독특한 시뮬레이션 알고리즘을 통해 구현된다. 또한, 로직 내 설비 목표값 제어를 위해 정수기반 구성도가 제안된다. 이러한 시뮬레이션 기법들을 통해 부하 분배, 상 하한치 제한, 주파수 보상 등의 기능들이 시뮬링크 내에서 성공적으로 구현될 수 있음을 보이고, 결과적으로 우리는 UMC 로직을 플랜트 시뮬레이터 없이도 시뮬링크에서 구현할 수 있음을 보인다. 본 논문에서 제시한 다양한 시뮬레이션 기법들은 발전소 건설 기간 중 플랜트 로직 설계자 또는 시운전 엔지니어들을 위한 시뮬링크 기반의 시뮬레이션 설계 관련한 양질의 정보를 제공할 수 있을 것으로 사료된다.

웨이블릿 OFDM 시스템과 FD-OFDM 시스템 성능 비교 분석 (Comparison and Performance analysis of Wavelet OFDM system and FD-OFDM)

  • 이준서;김지훈;김환우
    • 전자공학회논문지
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    • 제50권7호
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    • pp.34-42
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    • 2013
  • 본 논문에서는 웨이블릿 OFDM (Orthogonal Frequency Division Multiplexing) 및 FD-OFDM(Frequency Diversity OFDM) 시스템과 일반 OFDM 시스템의 성능을 비교 분석 한다. 푸리에 변환에 기반하는 일반 OFDM방식과는 달리 웨이블릿 OFDM 방식은 웨이블릿 변환을 사용하며, CDM (Code Division Multiplexing)과 OFDM의 중간적인 특성을 통해 심볼간 간섭을 효과적으로 제거할 수 있으며 채널간 간섭 역시 최소화 할 수 있다. FD-OFDM 방식의 경우, 각 병렬 브랜치에 입력된 심볼들이 직교 시퀀스로 곱해진 뒤 모든 부반송파에 분배되고, 각 부반송파는 주어진 프레임에서 각 병렬 브랜치의 심볼 조각들의 합의형태로 이루어진 정보를 전달한다. FD-OFDM의 한 부반송파 내에 포함된 모든 심볼들은 직교 시퀀스에 의해 구별되며, 간섭에 강하며 주파수 다이버시티 특성을 가진다는 장점을 지닌다. 협대역 간섭과 하모닉 잡음 환경에서 BER (Bit Error Rate) 성능을 통해 시스템 간 성능 비교 분석을 진행하였으며, 이를 통해 웨이블릿 OFDM과 FD-OFDM의 성능이 일반 OFDM보다 간섭에 대해 강건하고 특히 하모닉 노이즈 환경에서는 웨이블릿 OFDM이 가장 강건한 특성을 보이는 것을 알 수 있다.

OFDMA 시스템에서 비율적 전송률 분배를 위한 자원 할당 (A New Resource Allocation with Rate Proportionality Constraints in OFDMA Systems)

  • 한승엽;오은성;한명수;홍대식
    • 대한전자공학회논문지TC
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    • 제45권1호
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    • pp.59-65
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    • 2008
  • 본 논문에서는 직교 주파수 분할 다중 접속 방식(OFDMA, Orthogonal frequency Division Multiple Access)에서 전송률의 비율적 제한 조건(Constraint)이 고려된 자원 할당 방식에 대해 논의한다. 제안된 자원 할당 방식은 비트 오율, 전송 전력 및 전송 비율 등에 관한 제한 조건 하에서 사용자들이 요구하는 다양한 서비스를 만족하면서 최대의 시스템 전송률을 얻기 위한 최적화 문제를 다룬다. 본 문제에 관한 최적의 해(optimal solution)는 상당히 복잡하므로 부 채널 할당과 전력 할당을 나누어 복잡도를 낮춘 부 최적 해(Suboptimal solution)를 제안한다. 먼저, 각 사용자에게 할당될 부 채널의 수를 사용자들의 평균 신호 대 잡음비와 전송률 비율을 기반으로 결정한다. 이어서 사용자에게 할당될 부 채널은 변형된 max-min 알고리즘에 따라 결정되고 이를 기반으로 최적화 문제에 대한 Lagrange dual 문제의 해를 구하는 최적의 전력 할당 방식을 제안한다. 또한 보다 낮은 복잡도를 갖는 전력 할당을 위해 반복적 전송 비율 검출 알고리즘을 제안한다. 마지막으로 모의실험을 통해 본 논문에서는 제안하는 알고리즘이 사용자 간의 전송률에 관한 공평성(fairness)을 정확히 만족하면서 시스템의 전송률을 극대화할 수 있음을 분석한다.

격자형 광파이버필터의 설계에 관한 연구 (A design method for optical fiber filter of lattice structure)

  • 이채욱;문병현;김신환
    • 한국통신학회논문지
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    • 제18권9호
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    • pp.1248-1256
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    • 1993
  • 디지탈 신호처리기술 및 종래의 아날로그 신호처리기술로는 저주파수의 신호를 처리하는데는 아주 효과적이지만, 주파수 대역폭이 GHz단위일 경우에는 많은 손실이 있기 때문에 지연매체로서 광파이버가 많이 사용된다. 광파이버는 저손실 그리고 극히 작은 지연도 정확하게 얻을 수 있기 때문에 채널분리 필터 등과 같은 고주파, 광대역신호의 고속처리 특히 수십GHz 단위의 채널을 광FDM다중화하는 분야등에 많은 주목을 받고 있다. 본 논문에서는 광파이버를 이용한 지연소자와 방향성결합기(directional coupler)를 구성 단위로 하고 코히런트 광원을 이용한 격자형 광파이버필터에 대하여 논한다. 코히런트 광원을 이용한 광파이태 필터는, 기본 구성요소인 방향성결합기의 특성 때문에 1)입력신호는 광강도에 의해 처리되기 때문에 방향성결합기의 결합계 수(=a)는 0과 1 사이의 값만 취할 수 있다. 2)광신호의 전계강도를 E라 했을때 그 분기점에서 신호광은 Jae와 J1-ae로 분배된다. 본 논문에서는 방향성 결합기의 제약조건을 고려하고, 간단한 구성 및 설계를 위하여 가산소자와 분기소자가 동일한 결합계수를 가지는 격자형 광파이버필터플 제안하였다. 설계방침으로는 주어진 전달함수에 대해 광신호의 Energy를 최대한 유효하게 사용하는 설계법으로 그때의 설계공식 및 실험조건등을 유도하였다.

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로컬 클록 스큐 보상을 위한 낮은 지터 성능의 지연 고정 루프 (A Low Jitter Delay-Locked Loop for Local Clock Skew Compensation)

  • 정채영;이원영
    • 한국전자통신학회논문지
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    • 제14권2호
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    • pp.309-316
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    • 2019
  • 본 논문은 로컬 클록 왜곡을 보상하는 낮은 지터 성능의 지연 고정 루프를 제시한다. 제안된 DLL은 위상 스플리터, 위상 검출기(PD), 차지 펌프, 바이어스 생성기, 전압 제어 지연 라인(Voltage Controlled Delay Line) 및 레벨 변환기로 구성된다. VCDL(: Voltage Controlled Delay Line)은 CML(: Current Mode Logic)을 사용하는 자체 바이어스 지연 셀을 사용하여 온도에 민감하지 않고 잡음을 공급한다. 위상 스플리터는 VCDL의 차동 입력으로 사용되는 두 개의 기준 클록을 생성한다. 제안된 회로의 PD는 CML에 비해 적은 전력을 소비하는 CMOS 로직을 사용하기 때문에 PD는 위상 스플리터의 유일한 단일 클록을 사용한다. 따라서 VCDL의 출력은 로컬 클록 분배 회로뿐만 아니라 PD에 사용되므로 레벨 변환기에 의해 레일-투-레일 신호로 변환된다. 제안된 회로는 $0.13{\mu}m\;CMOS$ 공정으로 설계되었으며, 주파수가 1GHz인 클록이 외부에서 인가된다. 약 19 사이클 후에 제안된 DLL은 잠금이 되며, 클록의 지터는 1.05ps이다.