• Title/Summary/Keyword: 전고조파왜율

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두 가지 영전류 검출 방법을 이용한 임계 도통 모드(CRM) 역률 보상(PFC) 부스트 컨버터의 전고조파왜율 개선

  • Im, Jun-Hyeok;Sin, Jong-Won;Jo, Bo-Hyeong
    • Proceedings of the KIPE Conference
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    • 2013.07a
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    • pp.186-187
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    • 2013
  • 역률 보상(Power Factor Correction) 회로의 입력 전압은 정현파이다. 부스트 역률 보상 회로의 경우, 정현파인 입력 전압의 크기가 충분히 작을 때 다이오드가 도통하지 않는 구간이 생긴다. 이 구간에서는 입력 전류 파형의 왜곡이 일어나고, 입력 전류의 전고조파왜율(Total Harmonic Distortion)이 증가하게 된다. 본 논문에서는 임계 도통 모드(Critical Conduction Mode) 역률 보상 부스트 컨버터에 한하여 두 가지 영전류 검출 방법을 사용하여 전고조파왜율을 개선하는 방법을 제안하고, 모의실험으로써 성능을 검증하였다.

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Diagnostic Methode of the Fuel Cell Stack (연료전지 스택 진단 기술)

  • Park, Hyunseok;Kim, Ucksoo;Eom, Jeongyong
    • 한국신재생에너지학회:학술대회논문집
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    • 2010.11a
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    • pp.79.1-79.1
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    • 2010
  • 현재까지의 연료전지 스택 고장 진단 방법은 스택의 전류와 각 셀 전압값을 측정하고 그 측정된 값을 계산함으로써 스택의 고장 여부를 판단하는 것이었다. 이러한 방법은 수백개 이상의 스택의 셀 전압을 2~4개 단위로 측정하기 때문에 백개 이상의 측정 채널이 필요하다. 또한, 스택 진단 시스템을 복잡하게 하여 신뢰성을 저하시킬 뿐만 아니라 가격 상승을 유발한다. 본 논문에서는 이러한 문제점을 해결하기 위해 THDA(전고조파왜율 분석) 방법을 제안하였다. THDA는 스택에 교류 전류를 주입하고 스택 양단의 전압을 측정하여 주입된 교류 전류의 THD를 구함으로써 연료전지 스택의 상태를 진단하는 방법이다.

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4kW Class Inverter Design for Portable ESS (Portable ESS를 위한 4kW급 인버터 설계)

  • Kwon, Hyeon-Jun;Chai, Yong-Woong
    • The Journal of the Korea institute of electronic communication sciences
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    • v.16 no.3
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    • pp.477-484
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    • 2021
  • The 4kW class inverter for portable ESS designed through this study achieves lightweight and high power density by reducing the volume of passive devices (capacitors, inductors, etc.) suitable for portable use, and minimizes heat loss of the MOSFET through the low on resistance of the MOSFET. So that high efficiency can be achieved. In addition, in order to deliver high quality energy, it is designed to have a low THDV in accordance with the current KEPCO business handling guidelines, and is designed to output a sine wave with low distortion.

A Study on Circuit Design Method for Linearity and Range Improvement of CMOS Analog Current-Mode Multiplier (CMOS 아날로그 전류모드 곱셈기의 선형성과 동적범위 향상을 위한 회로설계 기법에 관한 연구)

  • Lee, Daniel Juhun;Kim, Hyung-Min;Park, So-Youn;Nho, Tae-Min;Kim, Seong-Kweon
    • The Journal of the Korea institute of electronic communication sciences
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    • v.15 no.3
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    • pp.479-486
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    • 2020
  • In this paper, we present a design method for improving the linearity and dynamic range of the analog current mode multiplier circuit, which is one of the key devices in an analog current mode AI processor. The proposed circuit consists of 4 quadrant translinear loops made up of NMOS transistors only, which minimizes physical mismatches of the transistors. The proposed circuit can be implemented at 117㎛ × 109㎛ in 0.35㎛ CMOS process and has a total harmonic distortion of 0.3%. The proposed analog current mode multiplier is expected to be useful as the core circuit of a current mode AI processor.