• 한국재료학회:학술대회논문집
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• 한국재료학회 2011년도 춘계학술발표대회
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• pp.27.2-27.2
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• 2011

본 연구에서는 저저항/고투과 플렉시블 투명 전극 개발을 위해 금속 그리드가 적용된 투명 전극을 개발하였다. Lift off 공정을 도입하여 플렉시블 PET 기판 위에 Ag grid를 성막하고 이후 연속 공정이 가능한 Roll-to-Roll sputtering system을 이용하여 최적화된 ITO(40nm)/Ag(12nm)/ITO(40nm) 다층 투명 전극을 성막하였다. 제작된 플렉시블 투명 전극의 전기적, 광학적, 구조적 특성 및 기계적/전기적 안정성 평가를 위해 four-point probe measurement, Hall effect measurement, UV/Vis spectrometer, scanning electron microscopy 및 bending tester를 이용하여 각각의 특성을 분석하였다. Ag grid가 적용된 ITO/Ag/ITO 투명 전극에서 Ag의 배선 간격이 0.75 mm일 때 0.18 ohm/sq. 의 낮은 면 저항과 가시광선 영역에서 80% 이상의 높은 투과율을 나타내었으며, 이러한 저저항 및 고투과율 특성으로 인해 최적화된 배선 간격 0.75 mm에서 $538.11{\times}10^{-3}\;ohm^{-1}$의 매우 높은 figure of merit ($T^{10}/R_{sh}$) 값을 확보할 수 있었다. 기계적 응력에 따른 전기적 안정성 특성 분석 결과 5,000회 이상의 bending cycle 에서도 초기 저항 값과 유사한 전기적 특성을 나타냄으로써 Ag grid가 적용된 ITO/Ag/ITO 플렉시블 투명 전극의 기계적 응력에 따른 전기적 안정성을 확인할 수 있었다. Ag grid가 적용된 ITO/Ag/ITO 투명 전극의 투명 안테나 적용 가능성을 타진하기 위해 low band 및 high band 영역에서의 안테나 효율을 측정하였으며, 모든 영역에서 상용화된 copper 안테나와 유사한 효율을 나타내었다. Ag grid를 이용한 플렉시블 투명 전극의 저저항/고투과율 특성은 플렉시블 광전소자의 투명 안테나로의 적용 가능성을 나타낸다.

• 한국신뢰성학회지:신뢰성응용연구
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• 제13권2호
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• pp.109-116
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• 2013

The solder is any of various fusible alloys, usually tin and lead, used to join metallic parts that provide the contact between the chip package and the printed circuit board. Solder plays an important role of electrical signals to communicate between the two components. In this study, two kinds of Ag-free solder as sample is made to conduct the thermal shock test and the high humidity temperature test. Low resistance is measured to estimate crack size of solder, using daisy chain. The low speed shear test is also performed to analyze strength of solder. The appropriate degradation model is estimated using the result data. Depending on the composition of solder, lifetime estimation is conducted by adopted degradation model. The lifetime estimated two kinds of Ag-free solder is compared with expected lifetime of Sn-Ag-Cu solder. The result is that both Ag-free composition are more reliable than Sn-Ag-Cu solder.

• 한국인터넷방송통신학회논문지
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• 제11권6호
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• pp.9-14
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• 2011

$AlO_x$ 박막 소자를 제작하여 전기적 특성을 조사하였다. 소자는 Electrode를 Top-bottom구조로 제작하였으며 스위칭 특성을 연구하기 위해 전극간의 $AlO_x$ 박막의 전도특성이 측정되었다. 박막소자의 저항변화는 전압을 선형적으로 인가하여 측정하였다. 제작된 소자는 MIM구조로써 외부에서 인가하는 전기적 신호에 의하여 전기전도도가 큰 On-state와 전기전도도가 낮은 Off-state로 바뀌는 특성을 나타내었다. 본 연구에 사용된 $AlO_x$ 박막은 초기 저항 상태가 저저항 On 상태였으며, 전압을 인가함에 따라 저저항 On 상태와 고저항 Off 상태의 가역적 저항 변화 특성을 나타내었다. 본 연구를 통하여 $AlO_x$ 박막소자는 차세대 비휘발성 메모리로는 물론 다른 전기적 응용도 기대되는 물질임을 확인하게 되었다.

• 대한전기학회논문지:전기물성ㆍ응용부문C
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• 제54권9호
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• pp.403-406
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• 2005

Precise measurement of extremely low resistance shunt is important for characterization and calibration of high current instruments. We tested resistance measurement method for extremely high current shunt (up to 140 kA), where resistance is determined by precise measurement of voltage drop at 10 A test current in the frequency range of 40 Hz to 10 kHz. For the extremely low ac voltage to be precisely measured, a verification of the measurement method was also carried, where the inherent noise is systematically evaluated. The measurement uncertainty was estimated to be $1\;\%\;at\;95\;\%$ confidence level (k=2) for about 50 $\mu\Omega$.

• 한국정보전자통신기술학회논문지
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• 제12권3호
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• pp.218-223
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• 2019

높은 CVD 그래핀저항으로 인한 낮은 발열효과를 해결하기 위해 다층으로 그래핀을 적층하여, 저저항의 광학특성이 우수한 투명 면상 발열시스템을 구현하였다. 제작한 CVD 그래핀의 발열필름으로 $300{\times}400{\times}5mm$ 발열체를 제작하고, 효율적인 전력을 구동하기 위해 PWM 제어를 통한 회로를 구성하여 시스템을 구현하였다. 발열체로 사용한 4층의 CVD 그래핀 필름의 평균 면 저항 측정값은 $85.5{\Omega}/sq$이다. 따라서 저 저항의 CVD 그래핀의 구현 방법으로 열전사의 적층의 방법은 타당하다. 발열시험 결과, CVD 그래핀을 이용한 저저항 투명 면상 발열 시스템의 평균 발열상승은 $10^{\circ}C/min$ 이고, 86.44%의 CVD 그래핀 필름의 광투과율을 갖음을 보여준다. 따라서 제시한 발열 시스템은 대형창 유리 및 자동차 발열유리로서 적용가능하다.

• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 2009년도 하계학술대회 논문집
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• pp.190-190
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• 2009

전자산업에의 필수인 커패시터는 소형화, 저저항, 고전압을 향한 추세가 늘고 있으며, 이외에도 고전압 전원, 고전압 회로 등 중전기기에 필요한 고전압, 고용량 커패시터가 사용되고 있다. 중전기기에 사용되는 커패시터는 기기에 따라 틀리지만 내전압이 보통 10kV 이상이고 정전용량이 500pF 안팎이며, 대부분 외국에서 수입에 의존하고 있는 실정이다. 본 연구에서는 $Nb_2O_5$를 2mol% 첨가한 $BaTiO_3$를 일반적인 고상 소결법으로 제조하고 성형 시 crack을 방지하기 위해 binder 및 plasticizer를 사용하였으며, binder 첨가량에 따른 성형밀도를 측정하여 최적의 binder양을 선택하였다. 성형 밀도가 떨어짐에 따라 절연파괴강도가 낮아지기 때문에 성형 밀도를 높이기 위해 CIP를 하였으며, 소결후 capacitance와 d-factor를 측정하여 수치가 허용 범위에 들어 올 경우 전극을 형성하고 표면파괴를 방지하기 위하여 epoxy로 표면코팅을 하였다. DC 60kV용 Hi-pot tester를 사용하여 15kV까지 선형적으로 증가시켜 내전압 테스트를 실시하였으며, 제조 된 커패시터 중 몇 개의 sample을 SEM 및 XRD를 사용하여 미세구조와 결정상을 조사하였다.

• 한국전기전자재료학회:학술대회논문집
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• 한국전기전자재료학회 1999년도 춘계학술대회 논문집
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• pp.493-496
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• 1999

Ni/3C-SiC 옴믹 접합에 대한 미세구조적-접합 특성과의 상관관계를 규명하였다. 3C-SiC 웨이퍼 위에 저저항 전면 옴믹 적합층을 형성하기 위하여 Ni(t=300$\AA$)을 thermal evaporator를 사용하여 증착하고, 50$0^{\circ}C$, 80$0^{\circ}C$, 103$0^{\circ}C$ 온도에서 30분간(Ar 분위기) 열처리 한 후, scratch test를 실행하여 Ni/3C-SiC의 접착력 특성을 조사하였다. 여러 다른 온도에 따른 Ni/3C-SiC 층의 표면과 계면의 미세구조는 X-ray scattering 법을 사용하였다. 50$0^{\circ}C$ 에서 열처리된 Ni/3C-SiC 층은 가장 낮은 계면 평활도와 가장 높은 표면 평활도를 나타내었다. Ni/3C-SiC 접착력 분석에서 500 $^{\circ}C$ 열처리된 시편의 측정된 임계하중 값은 As-deposited 시편(12 N~ 13 N)보다 훨씬 낮은 2 N~3 N 범위의 값을 보였으나, 열처리 온도가 증가함에 따라 다시 높아지는 경향을 보였다. 미세구조 특성에서는 열처리 온도가 500 $^{\circ}C$ 이상에서는 NiSi$_2$silicides의 domain size는 결정성의 향상에 따라 증가되었다. 결정성 향상이 3C-SiC와 silicides 사이의 격자상수의 낮은 불일치를 완화시키는데 기여 하였 다.

• 마이크로전자및패키징학회지
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• 제25권2호
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• pp.19-23
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• 2018

광전소자용 투명전극으로 적용하기 위한 초박형 Al 박막에 대한 기초연구를 수행하였다. 유리 기판 상에 3-12 nm의 두께를 가지는 Al 박막을 형성하였으며, 박막의 두께가 7 nm 이상일 때부터 면저항이 측정되었으며 두께가 증가할 때 면저항이 점진적으로 감소하였다. 박막 내 그레인 크기(Grain size)는 두께가 증가할수록 비례하여 증가하였다. 광 투과도의 경우 가시광선영역(380~770 nm) 파장 기준으로, 3 nm 박막 두께에서 평균 85%의 투과도가 측정된 데 반하여, 4, 5 nm 두께에서 평균 50, 60%로 급격하게 감소되기 시작하며 그 이후 두께 증가에 따라 투과도가 점진적으로 감소하였다. 본 연구결과는 향후 Oxide/Metal/Oxide(OMO) 구조의 고투과, 저저항 투명전극 적용을 위한 기초 결과로 활용될 것으로 기대된다.

• 한국진공학회:학술대회논문집
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• 한국진공학회 2013년도 제44회 동계 정기학술대회 초록집
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• pp.438-439
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• 2013

Microelectronic devices의 접촉저항의 향상을 위해 Metal silicides의 형성 mechanism과 전기적 특성에 대한 연구가 많이 이루어지고 있다. 지난 수십년에 걸쳐, Ti silicide, Co silicide, Ni silicide 등에 대한 개발이 이루어져 왔으나, 계속적인 저저항 접촉 소재에 대한 요구에 의해 최근에는 Rare earth silicide에 관한 연구가 시작되고 있다. Rare-earth silicide는 저온에서 silicides를 형성하고, n-type Si과 낮은 schottky barrier contact (~0.3 eV)를 이룬다. 또한, 비교적 낮은 resistivity와 hexagonal AlB2 crystal structure에 의해 Si과 좋은 lattice match를 가져 Si wafer에서 high quality silicide thin film을 성장시킬 수 있다. Rare earth silicides 중에서 ytterbium silicide는 가장 낮은 electric work function을 갖고 있어 낮은 schottky barrier 응용에서 쓰이고 있다. 이로 인해, n-channel schottky barrier MOSFETs의 source/drain으로써 주목받고 있다. 특히 ytterbium과 molybdenum co-deposition을 하여 증착할 경우 thin film 형성에 있어 안정적인 morphology를 나타낸다. 또한, ytterbium silicide와 마찬가지로 낮은 면저항과 electric work function을 갖는다. 그러나 ytterbium silicide에 molybdenum을 화합물로써 높은 농도로 포함할 경우 높은 schottky barrier를 형성하고 epitaxial growth를 방해하여 silicide film의 quality 저하를 야기할 수 있다. 본 연구에서는 ytterbium과 molybdenum의 co-deposition에 따른 silicide 형성과 전기적 특성 변화에 대한 자세한 분석을 TEM, 4-probe point 등의 다양한 분석 도구를 이용하여 진행하였다. Ytterbium과 molybdenum을 co-deposition하기 위하여 기판으로 $1{\sim}0{\Omega}{\cdot}cm$의 비저항을 갖는 low doped n-type Si (100) bulk wafer를 사용하였다. Native oxide layer를 제거하기 위해 1%의 hydrofluoric (HF) acid solution에 wafer를 세정하였다. 그리고 고진공에서 RF sputtering 법을 이용하여 Ytterbium과 molybdenum을 동시에 증착하였다. RE metal의 경우 oxygen과 높은 반응성을 가지므로 oxidation을 막기 위해 그 위에 capping layer로 100 nm 두께의 TiN을 증착하였다. 증착 후, 진공 분위기에서 rapid thermal anneal(RTA)을 이용하여 $300{\sim}700^{\circ}C$에서 각각 1분간 열처리하여 ytterbium silicides를 형성하였다. 전기적 특성 평가를 위한 sheet resistance 측정은 4-point probe를 사용하였고, Mo doped ytterbium silicide와 Si interface의 atomic scale의 미세 구조를 통한 Mo doped ytterbium silicide의 형성 mechanism 분석을 위하여 trasmission electron microscopy (JEM-2100F)를 이용하였다.