천연가스 저류층의 부존 특성을 파악하는데 주로 이용되고 있는 AVO 및 복소분석법을 파쇄대와 같은 지반환경의 주요 불연속면에 적용하는데 그 초점을 두었다. 연구에 이용된 시험자료는 수평 파쇄구조에 대하여 일반화된 맥스웰체 근사법을 적용한 점탄성매질에서의 수치모형자료이다. 수평 파쇄구조에 대한 AVO분석에서 반사 P파의 특성은 지하매질의 음향 임피던스 차이와 기하학적 계수인 오프셋에 따라 다양하게 나타나며 구배중합 단면도 및 오프셋조절 중합단면도에서 효과적으로 해석되는데, 입사각이 커질수록 진폭이 감쇠되는 특성을 보인다. 중합자료에 대한 복소트레이스 플롯(순간진폭, 순간주파수, 순간위상)에서 파쇄대의 상$\cdot$하부 경계는 강한 진폭과 동일한 위상으로 특징 지워지며, 파쇄대 구간 및 직하부는 저주파 특성을 보인다. 파쇄대와 주위 매질의 Q-대비에 따라 다르게 나타나는 진폭감쇠와 파형분산은 역 Q-필터링으로 효과적으로 보상되었다.
OFDM(Orthogonal Frequency Division Multiplexing) 시스템은 고속의 데이터 전송에 유리한 통신 방식이다. 하지만 OFDM 시스템은 높은 PAPR(Peak to Average Power Ratio)이 문제이다. PAPR 저감을 위한 방법으로 DFT(Discrete Fourier Transform)-spread 방식의 SC-FDMA(Single-Carrier Frequency Division Multiple Access) 기술이 제안되었으며, 큰 관심을 받고 있다. 본 논문에서는 재머나 의도적인 간섭에 취약한 OFDM 방식의 단점을 보안하기 위해 스펙트럼 확산 방식 중 하나인 FH(Frequency Hopping)방식을 도입하였고, 부분 대역 재밍과 톤 재밍이 있는 채널 환경에서는 FH 방식의 SC-FDMA 시스템의 성능을 비교 분석한다. 그리고, SC-FDMA 방식은 ICI(Inter sub-Carrier Interference)에 민감한데, 특히 주파수 오프셋이나 위상 잡음에 의해 발생하는 ICI는 시스템 성능을 열화시킨다. 본 논문에서는 OFT-spread OFDM을 기반으로 하는 SC-FDMA 기술에 PNFS(Phase Noise and Frequency offset Suppression) 알고리즘을 적용한 등화기를 사용하여 위상 잡음이나 주파수 오프셋 등에 의해 발생하는 ICI의 영향을 분석하고, 보상한다. 컴퓨터 시뮬레이션을 통하여 성능 개선을 확인하였다.
본 논문에서는 DisplayPort용 전자기기 또는 클록 발생을 요구하는 다양한 회로에서 발생 할 수 있는 전자방해(EMI) 현상을 줄일 수 있는 위상 동기 루프와 확산 대역 클록 발생기를 구현 하였다. 이 시스템은 기본적으로 송신용 위상 동기 루프와 확산 대역 클록 발생기 구현을 위한 전하펌프2 와 기준주파수 분주기 등으로 구성된다. 본 논문에서는 2.7Gbps/1.62Gbps DisplayPort 응용 회로에 적합 하도록 10개의 다중 위상 신호를 출력 할 수 있는 270MHz/162MHz 듀얼 모드 위상 동기 루프를 설계 하였고 추가적으로 1.35GHz/810MHz의 위상 동기 루프를 설계하여 지터를 크게 감소시킬 수 있는 구조를 제안하였다. 270MHz/162MHz 위상 동기 루프와 5:1 시리얼라이저 2개, 그리고 1.35GHz 위상 동기 루프와 2:1 시리얼라이저를 연동함으로써 지터 성분을 크게 줄일 수 있다. 위상 동기 루프에서 사용 된 주파수 전환 다중위상 전압제어 발진기와 더불어 DisplayPort 규격에 맞는 주파수 전환이 가능 하도록 분주기를 공유하고 50% duty ratio를 보장할 수 있는 주파수 분주기 구조를 제안 하였다. 또한, 지터를 줄이기 위해서 출력전류 오차를 크게 줄일 수 있는 전하펌프 구조를 제안 하였다. 0.13 um CMOS 공정을 사용하여 설계 하였으며, 270MHz/162MHz PLL의 칩 면적은 $650um\;{\times}\;500um$ 이고, 1.35GHz/810MHz PLL의 칩 면적은 $600um\;{\times}\;500um$ 이다. 270MHz/162MHz 위상 동기 루프 전압제어 발진기의 조절 범위는 330MHz이고, 위상 잡음은 1MHz 오프셋에서 -114cBc/Hz, 확산대역 클록 발생기의 확산 진폭도 는 0.5%이고, 변조 주파수는 31kHz이다. 전체 전력 소모는 48mW이다.
본 연구는 1V 미만의 전원 전압에서 저 위상잡음 동작에 적합한 혼성 평형 전압제어 발진기 회로를 제안한다. 제안한 회로의 개별 반 회로에서는 바렉터 통합형 궤환 커패시터를 사용한다. 바렉터 통합형 궤환 커패시터의 사용으로 인해 발진기 탱크회로내의 부성저항이 더욱 증가되며 이는 1V 미만 전원전압에서도 발진기의 안정된 발진시동을 보장한다. 또한, 본 연구에서는 이러한 부성저항의 증가 현상을 이론적으로 해석한다. $0.18{\mu}m$ RF CMOS 기술을 사용한 시뮬레이션 결과는 발진 주파수 4.87GHz의 1MHz 오프셋에서 0.6 V에서 0.9 V 사이의 전원 전압에 걸쳐 -122.4 dBc/Hz에서 -125,5 dBc/Hz까지의 위상잡음을 나타냄을 보여준다.
본 논문에서는 Ka 대역 소형 레이다용 주파수합성기를 제안하였다. 제작된 주파수합성기는 시스템에서 요구하는 다양한 파형을 생성하고 고속의 파형 및 주파수 전환을 위해 DDS를 적용하였다. 소형화를 위해 Ku 대역에는 MMIC를 최대한 적용하여 Ka 대역 회로를 소형 집적화 하였고 파형발생부 과 주파수 상향 변환부를 하나의 모듈로하여 설계 제작하였다. 제안된 주파수합성기는 선형 주파수 변조 파형과 위상변조 가능한 주파수 변조 연속 파형 등 발생이 가능하고, 대역폭 1GHz, 주파수 전환 속도 $0.191{\mu}sec$, 1 kHz 오프셋(offset)에서 -89.16 dBc/Hz의 위상잡음, 불요파 -50.9 dBc가 측정되었다.
본 논문에서는 LMDS(Local Multipoint Distributed Services) 시스템의 역방향 채널에서 TDMA(Time D Division Multiple Access) 방식으로 ATM(Asynchronous Transfer Mode) 셀을 효율적으로 전송하기 위해 전치부호를 줄일 수 있는 블록복조 알고리즘을 적용한 $\pi$/4 QPSK 변복조 방식 시스댐을 제안하고. 블록복 조의 동기성능을 향상시키기 위해 새로운 반송파 동기회로를 설계하였다. 제안한 블록동기복조 알고리즘을 적용한 $\pi$/4 QPSK 변복조 방식 시스템은 LMDS 환경에서 ATM 셀 단위의 버스트 데이터로 반송파 위상동 기. 심별 타이밍 동기, 슬롯 타이밍 동기 등을 수행할 때 전치부호를 아주 적게 사용하므로 효율적인 프레임 전송을 얻어질 수 있도록 하고 있다. 본 논문에서 제안한 블록동기복조 알고리즘을 적용한 $\pi$/4 QPSK 변복 조 방식 시스템을 모의설험을 통하여 분석한 결과. 페이딩 환경에서 심벌 타이멍 옹기, 주파수 오프셋, 반송 파 위상동기할 때 전치부호를 아주 적게까지 줄이더라도 좋은 성능을 발휘함을 확인할 수 있었다.
본 논문에서는 새로운 헤어핀 공진기를 제안하고 이를 X 밴드 발진기에 응용하는 연구에 관한 것이다. 새로이 제안된 헤어핀 공진기는 스파이럴 구조를 이용하여 coupling을 강화시키는 구조이다. 기존의 헤어핀 공진기와 새로이 제안된 공진기를 마이크로스트립 선로 상에서 제작하여 특성을 비교하였다. 공진 주파수 9.2 GHz에서 제안된 공진기는 더 높은 loaded quality factor를 보여주었고, 면적 또한 약 50 % 정도 줄어들었음을 확인하였다. 새롭게 제안된 헤어핀 공진기를 이용한 발진기의 측정 결과, 출력 전력은 10.87 dBm이고, 기준 주파수 대비 2차 고조파 성분 억압은 41.99 dBc이며, 100 kHz 오프셋에서 위상 잡음은 -101.49 dBc/Hz의 특성을 얻었다. 이는 기존의 헤어핀 공진기를 이용한 발진기보다 6.17 dB 정도 개선된 위상 잡음 특성에 해당한다.
본 논문에서는 모바일 RFID 시스템 환경을 제시하였고, 그 환경에 적합한 저 잡음 차동 콜피츠 전압 제어 발진기를 구현하였다. 밀집 리더 환경에 맞춘 전압 제어 발진기는 $0.35{\mu}m$ 공정을 사용하였고, 주파수 범위는 RFID 주파수 범위인 $860{\sim}960 MHz$를 포함시킬 수 있도록 $1.55{sim}2.053 GHz$로 설계하였다. 2분주기 출력에서 측정한 위상 잡음은 오프셋 주파수가 40 kHz일 때 -106 dBc/Hz로 측정되었고, 1MHz일 때에는 -135 dBc/Hz로 측정되었다. 5 비트의 디지털 튜닝을 이용하여 낮은 발진기 이득(<45 MHz/V)을 갖게 하여 주파수 합성기에서의 위상 잡음 특성을 좋게 하였다. 설계한 차동 콜피츠 발진기의 FOM은 1.93 dB로 타 2 GHz 대역의 발진기들 보다 높게 측정되었다.
본 논문은 UWB주파수 합성기용 광대역 전압 제어 발진기로 시그마-델타 모듈레이션을 이용하여 미세한 성긴 튜닝을 구현하였다. 제안된 성긴 튜닝 방법은 위상 잡음 성능의 저하 없이 작은 유효 주파수 해상도를 제공한다. 3단계의 성긴 튜닝구조로 전압제어 발진기는 광대역과 미세 튜닝 단계를 동시에 구현한다. 본 전압 제어기를 포함한 주파수 합성기는 0.13 ${\mu}m$ CMOS공정으로 구현되었고, 5.8-6.8 GHz의 대역에 3.9 kHz의 유효 주파수 해상도를 갖는다. 측정된 위상 잡음은 1 MHz 오프셋에서 -108 dBc/Hz이고, 5.9 mW 전력 소모로 16.8 %의 튜닝 범위를 갖으며, 튜닝 범위를 갖는 Figure-of-merit(FoM)은 -181.58 dBc/Hz이다.
본 논문에서는 WCDMA 시스템을 위한 판정궤환 동기식 동기추적 회로 (decision-feedback coherent code tracking loop)를 설계하고 AWGN 환경과 페이딩 환경에서 위상 에러와 심볼 에러의 영향을 고려하여 지터 분산을 해석한다. 먼저, AWGN 환경에서의 지터 분산을 위상 에러와 비트 오율을 포함하여 펄스성형 필터(pulse-shaping filter), 타이밍 오프셋 (timing offset), 신호 대 잡음비 (signal-to-interferences ratio), 루우프 대역폭(loop-bandwidth)에 대한 일반식으로 유도하고 페이딩 환경에서 지터 분산의 상한치 (upper bonnd)를 유도한다. 끝으로, WCDMA 순방향 링크의 DPCH 프레임 포맷 #13을 목표 시스템(target system)으로 설정하여 2차 동기식 등기추적 회로를 설계하고 AWGN 환경과 Rayleigh 페이딩 환경에서 지터 분산의 이론치와 시뮬레이션 결과를 비교, 분석한다.
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[게시일 2004년 10월 1일]
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