• 제목/요약/키워드: 웨이퍼 공정

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기류방출형 정전기제거장치의 개발에 관한 연구

  • 이동훈;박훈규
    • 한국산업안전학회:학술대회논문집
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    • 한국안전학회 2003년도 춘계 학술논문발표회 논문집
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    • pp.167-172
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    • 2003
  • 액정판넬(LCD) 및 반도체 제조공정에 있어서 정전기 발생으로 인하여 미세한 먼지가 LCD 및 반도체 웨이퍼에 부착되거나, 정전기 방전에 의해 반도체소자 및 LCD 유리기판상의 패헌의 파괴를 야기하여 제품의 수율을 저하시키고 제조원가를 상승시키는 주요한 요인이 된다. 현재 이러한 제조공정에서 정전기를 위한 대책으로 코로나방전에 의한 이온바(Ion Bar) 및 이온브로어(Ion Blower)를 제전설비로 사용하고 있으나, 이 장치는 코로나 방전에 의한 이온을 발생시키고 이온화된 공기를 불어 내기 위하여 팬을 사용하여 공기를 대류 시킨다.(중략)

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질소 가스의 흡입량에 의해 발생되는 진공도의 변화에 따른 건식진공펌프의 소음특성 (Noise characteristics of dry vaccum pump according to change of vaccum degree arising from inhalation capacity of $N_2$ Gas)

  • 이현남;정완섭;홍동표;이완형
    • 한국소음진동공학회:학술대회논문집
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    • 한국소음진동공학회 2002년도 추계학술대회논문초록집
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    • pp.322.1-322
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    • 2002
  • 국내외의 반도체 회사의 반도체 제작공정에서 여러 종류의 가스를 흡입하여 웨이퍼의 증착에 이용하게 되는데 각각의 과정에서 요구되는 진공도를 유지하기 위하여 사용되는 것이 드라이 진공펌프이다. 이때 사용되는 질소가스의 흡입압력에 의해 발생되는 진공도의 변화에 따른 진공펌프의 소음 특성을 실험을 통해 분석하였다.

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광소자 제작용 레이저 묘화 시스템 개발

  • 김정민;조성학;이응숙
    • 한국정밀공학회:학술대회논문집
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    • 한국정밀공학회 2004년도 춘계학술대회 논문요약집
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    • pp.123-123
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    • 2004
  • 최근에 급속히 성장하고 있는 광통신, 전자, 생명산업 등의 발전에 있어서 주목할 만한 경향중의 하나는 제품의 소형화 및 집적화라고 할 것이다. 현재 제조되고 있는 초정밀 미세 가공 부품 및 제조시스템은 반도체 공정에 기반을 두고 생산되고 있다. 반도체 공정은 기본적으로 웨이퍼 규모의 소형제품 제조에 최적화 되도록 제조시스템이 설계 및 제작되어 있다 그리고 광통신 분야에 사용되는 광기능성 소자는 벌크형 광부품 및 광섬유형 광부품 기술에서 평면 광도파로형(PLC) 광부품으로 발전되고 향후 평면 광도파로형 부품은 집적화되어 광IC화로 발전하고 있다.(중략)

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신경망과 웨이브렛을 이용한 플라즈마 식각공정 모델링 (Modeling of plasma etch process usuing neural network and wavelet)

  • 이수진;김병환;유임수;우봉주
    • 한국표면공학회:학술대회논문집
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    • 한국표면공학회 2011년도 춘계학술대회 및 Fine pattern PCB 표면 처리 기술 워크샵
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    • pp.93-94
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    • 2011
  • 플라즈마 감시를 위한 신경망 진단 모델을 개발한다. 이를 위해 광반사분광기, 웨이브릿, 주인자 분석, 그리고 신경망이 이용되었다. 플라즈마 식각공정데이터에 적용하여 비교 평가한 결과 모델의 예측성능이 식각특성, 분산비율, 그리고 웨이브릿의 종류에 따라 다름을 확인하였다. 개발된 모델은 웨이퍼 단위의 플라즈마 감시시스템의 개발에 응용될 수 있다.

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결함없는 구리 충진을 위한 경사벽을 갖는 Via 홀 형성 연구 (Fbrication of tapered Via hole on Si wafer for non-defect Cu filling)

  • 김인락;이영곤;이왕구;정재필
    • 한국표면공학회:학술대회논문집
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    • 한국표면공학회 2009년도 춘계학술대회 논문집
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    • pp.239-241
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    • 2009
  • DRIE(Deep Ion Reactive Etching) 공정은 실리콘 웨이퍼를 식각하는 기술로서 Si wafer 비아 홀 제조에 주로 사용되고 있다. 즉, DRIE 공정은 식각 및 보호층 증착을 반복함으로써 직진성 식각을 가능하게 하는 공정이다. 또한, 3차원 적층 실장에서 Si wafer 비아 홀에 결함없이 효과적으로 구리 충진을 하기 위해서는 직각형 via보다 경사벽을 가진 via가 형상적으로 유리하다. 본 연구에서는 3차원 적층을 위한 Si wafer 비아 홀의 결함 없는 효과적인 구리 충진을 위해, DRIE 공정을 이용하여 기존의 경사벽을 가지는 via 흘 형성 공정보다 더욱 효과적인 공정을 개발하였다.

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수치해석을 이용한 팬 아웃 웨이퍼 레벨 패키지의 휨 경향 및 신뢰성 연구 (Numerical Analysis of Warpage and Reliability of Fan-out Wafer Level Package)

  • 이미경;정진욱;옥진영;좌성훈
    • 마이크로전자및패키징학회지
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    • 제21권1호
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    • pp.31-39
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    • 2014
  • 최근 모바일 응용 제품에 사용되는 반도체 패키지는 고밀도, 초소형 및 다기능을 요구하고 있다. 기존의 웨이퍼 레벨 패키지(wafer level package, WLP)는 fan-in 형태로, I/O 단자가 많은 칩에 사용하기에는 한계가 있다. 따라서 팬 아웃 웨이퍼 레벨 패키지(fan-out wafer level package, FOWLP)가 새로운 기술로 부각되고 있다. FOWLP에서 가장 심각한 문제 중의 하나는 휨(warpage)의 발생으로, 이는 FOWLP의 두께가 기존 패키지에 비하여 얇고, 다이 레벨 패키지 보다 휨의 크기가 매우 크기 때문이다. 휨의 발생은 후속 공정의 수율 및 웨이퍼 핸들링에 영향을 미친다. 본 연구에서는 FOWLP의 휨의 특성과 휨에 영향을 미치는 주요 인자에 대해서 수치해석을 이용하여 분석하였다. 휨을 최소화하기 위하여 여러 종류의 epoxy mold compound (EMC) 및 캐리어 재질을 사용하였을 경우에 대해서 휨의 크기를 비교하였다. 또한 FOWLP의 주요 공정인 EMC 몰딩 후, 그리고 캐리어 분리(detachment) 공정 후의 휨의 크기를 각각 해석하였다. 해석 결과, EMC 몰딩 후에 발생한 휨에 가장 영향을 미치는 인자는 EMC의 CTE이며, EMC의 CTE를 낮추거나 Tg(유리천이온도)를 높임으로서 휨을 감소시킬 수 있다. 캐리어 재질로는 Alloy42 재질이 가장 낮은 휨을 보였으며, 따라서 가격, 산화 문제, 열전달 문제를 고려하여 볼 때 Alloy 42 혹은 SUS 재질이 캐리어로서 적합할 것으로 판단된다.