In this paper, we propose a new addressing mode, which can be used for programmable image processor to perform image- processing algorithms effectively. Conventional addressing modes are suitable for one-dimensional data processing such as voice, but the proposed addressing mode consider two-dimensional characteristics of image data. The proposed instruction for two-dimensional addressing requires two operands to specify a pixel and doesn't require any change of memory architecture. Combining several instructions to load a pixel-data from an external memory to a register, the proposed instruction reduces code size so that satisfy hish performance and low power requirements of image processor. In addition, it uses inherent two-dimensional characteristics of image data and offers user-friendly instruction to assembler programmer.
The Wavelet Transform has been applied in mathematics and computer sciences. Numerous studies have proven its advantages in image processing and data compression, and have made it a basic encoding technique in data compression standards like JPEG2000 and MPEG-4. Software implementations of the Discrete Wavelet Transform (DWT) appears to be the performance bottleneck in real-time systems in terms of performance. And hardware implementations are not flexible. Therefore, FPGA implementations of the DWT has been a topic of recent research. The goal of this thesis is to investigate of FPGA implementations of the DWT Processor for image compression applications. The DWT processor design is based on the Lifting Based Wavelet Transform Scheme, which is a fast implementation of the DWT The design uses various techniques. The DWT Processor was simulated and implemented in a FLEX FPGA platform of Altera
현대의 고도화된 산업현장에서 로봇의 사용은 보편화되고 있는 실정이다. 사람이 하기 어려운 작업을 대신함으로 인해 작업의 효율성과 생산의 극대화를 이루고 있다. 이런 가운데 로봇의 쓰임이 다양화되고 있는 추세에 있다. 그 중 한 분야로 무인 탐사 로봇을 만들어 보려 한다. 무인 탐사로봇의 주요기능으로는 악조건에서도 움직일 수 있는 이동체와 원거리에서도 사람이 실시간으로 볼 수 있는 영상전송기능 등을 필요로 한다. 이런 기능을 담당하는 부품들을 제어하기 위해 프로세서가 사용된다.
본 논문은 비디오 워터마킹 알고리즘을 적용한 비디오 시스템 구현에 관한 것이다. 시스템은 압축 알고리즘과 워터마킹 알고리즘을 실시간으로 처리하기 위해 DSP 프로세서를 기본으로 하여 구성하였다. 비디오 워터마킹 알고리즘은 공간영역과 프레임간의 정보를 이용하여 워터마크를 삽입하는 방법을 사용하였다. 실험결과, DSP에서 D1 영상 한 프레임 당 처리 시간이 약 32.1ms 소요되었다.
3자원 정보모델에 기반한 건설프로세서의 혁신이 새로운 추세가 되고 있고 고속철도와 같이 시스템엔지니어링에 해당하는 경우에는 가장 좋은 활용 사례가 될 수 있다. 정보모델은 3차원 영상에 기반하고 다양한 구성요소가 가진 기본정보와 설계와 유지관리에 이르는 생애주기 정보를 저장하고 재활용할 수 있도록 한다. 이 논문에서는 호남고속철도의 한 구간을 대상으로 이미 제안된 철도시설물정보모델의 개념에 근거하여 3차원 정보모델을 구성하였다. 구성된 정보모델에 기반하여 2차원도면, 해석, 견적, 시뮬레이션 등의 각 솔루션으로의 연동성 확보를 위한 시범사업의 결과를 정리하였다. 콘크리트 박스 교량을 대상으로 하는 시범사업을 통해서 생산성 향상 및 3차원 모델의 재활용성을 확보하였다.
파이프라인 프로세서를 위한 이중 경로 전략의 성능을 개선하기 위해, 본 논문에서는 통합 신뢰 매커지즘과 적극적 이중경로 전략(EDPS)을 제안한다. 통합 신뢰 매커니즘은 동적 신뢰 매커니즘과 정적 신뢰 매커니즘을 결합한 것으로 기존의 신뢰 매커니즘보다 신뢰 예측 정확도를 높일 수 있고 제안하는 EDPS와 결합하여 사용한다. EDPS는 높은 신뢰 집합에 g속하는 분기 명령어도 가능한 경우에는 두 경로를 모두 사용하여 조건 분기 명령어로 인해 발생하는 분기 지연의 총합을 줄일 수 있다. 6개 벤치마크에 대한 추적 기반의 시뮬레이션을 통해, 제안된 통합 신뢰 매커니즘을 사용하는 EDPS가 기존의 선택적 이중 경로 실행에 비해 분기 지연의 총합을 22%을 줄일 수 있다.
In this paper, we proposed a wavelet image coder based on the portable embedded microprocessor. The proposed coder stores the bit level information of the wavelet coefficient in the 2D significance array. Using this information, the coder make the significance check for coefficient and bit level scanning at the same pass. The proposed method has the advantage that we can reduce the scan iteratively and the memory usage for the coding process. Experimental results show that the proposed method outperforms popular image coders such as JPEG, EZW and SPIHT in based on the portable embedded system environment.
본 논문에서는 USN 기반 센서 정보수집기술과 지능형 영상분석기술을 이용하여 도시철도 역사와 지하도 상가의 유해가스, 미세먼지 등 지하공기 상태를 실시간 모니터링하고 분석할 수 있는 시스템을 설계하고 구현한다. 이를 위해 TinyOS를 탑재한 저전력 프로세서 시스템으로 IEEE 802.15.4 표준 무선 네트워크 통신을 지원하는 센서 노드를 구현하고, 이 센서 노드로부터 수집된 데이터를 이 기종 네트워크와 연동하여 상위 시스템에 전송할 수 있는 USN 게이트웨이 노드 시스템을 구현한다. 이러한 네트워크 시스템을 통해 수집된 센싱 데이터는 중앙의 DB서버로 취합 및 저장되도록 구현되며, 최종적으로는 어플리케이션 서버를 통해 공중이용시설의 이용자나 철도 안전 모니터링 요원에게 실시간으로 정보를 서비스할 수 있도록 구현된다.
DCT(Discrete Cosine Transform)는 현존하는 블록기반 영상 압축 코딩기법의 핵심이 되는 부분이다. 많은 고속 방법이 제안되었으며, 최근 들어 SIMD 병렬구조를 이용한 고속방법들이 제안되고 있다. 본 논문에서는 SIMD명령어를 가지는 프로세서에서 4$\times$4 정수변환의 속도를 최적화하기 위한 알고리즘을 제안한다. 본 논문에서 제안하는 알고리즘은 128비트 SIMD영령어로 확장이 가능하며 비슷한 구조를 가지는 Hadamard 변환에서 적용할 수 있다. 제안하는 방법을 펜티엄4 2.4G에서 구현할 경우 H.264 참조 부호화기의 4$\times$4 정수변환 방법보다 64비트 SIMD 명령어를 사용할 경우 4.34배 128-bit SIMD 명령어를 사용할 경우 6.77배의 성능을 얻을 수 있다.
최근 3차원 그래픽스 분야는 기존의 단순 이미지의 처리가 아닌 보다 나은 화질과 보다 많은 기법의 도입이 요구되어 지고 있다. 이에 본 논문에서는 가장 기본적인 실감영상의 표현 기법인 텍스쳐 매핑 기법에 대하여 논하였고, 3차원의 객체 공간에서 2차원의 스크린 공간으로의 변환으로 인해 생길 수 있는 문제점과 렌더링 알고리즘에 대해 분석하였으며, 이에 부합하는 렌더링 시스템을 설계, 분석하였다. 또한 본 시스템은 고성능 3차원 그래픽 처리를 위하여 채택되어지고 있는 프로세서-메모리 집적 방식을 이용, 래스터라이징 유닛과 프레임버퍼를 단일 칩으로 구성하여 렌더링과 텍스쳐 매핑 과정에서 발생할 수 있는 지연현상을 제거하였다.
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[게시일 2004년 10월 1일]
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