본 논문은 2세대 위성방송용 표준인 DVB-S2 (Digital Video Broadcasting - Second Generation) 에서 사용하는 대략적 주파수 동기회로를 효율적으로 설계하는 방법을 제안한다. DVB-S2에서 제거해야 하는 대략적인 주파수 오차는 심볼 전송률의 6.25%에 해당하며 심볼 전송률이 25Mspa일 경우 ${\pm}1.5625Mhz$에 달한다. 대략적인 주파수 오차 추정을 위한 데이터 도움방식 (Data-Aided) 의 알고리즘들을 분석하여 L&R (Luise & Reggiannini) 알고리즘이 복잡도와 추정성능 면에서 가장 효율적임을 밝혔다. 그러나 L&R 알고리즘도 여전히 곱셈기와 덧셈기를 다량으로 사용하므로 구현 복잡도가 매우 높다. 본 논문은 버퍼와 멀티플렉서를 이용한 직렬 상관도 연산구조를 제안한다. 제안된 구조는 기존의 구현 방법에 비해 하드웨어 복잡도가 약 92%정도 감소되었다. 제안된 구조는 Xilinx Virtex II FPGA에서 구현되어 검증되었다.
MultiCode-CDMA(MC-CDMA) 시스템은 채널수가 증가할수록 신호의 PAPR(Peak to Average Power Ratio)이 증가하게 되어 증폭기의 비선형 특성에 의해 시스템 성능이 열화된다. MultiPhase Clipped MultiCode CDMA(MP-CDMA)[1] 시스템은 이러한 증폭기의 비선형 특성에 의한 시스템 성능 열화를 상쇄한다. 본 논문에서는 변조방식을 MPSK가 아닌 차동 부호화된 MPSK 방식을 사용했고 이렇게 변형된 시스템을 DMP-CDMA 시스템이라고 부를것이다. 차동 검출 방식을 적용한 DMP-CDMA 시스템은 위상 보정을 위한 모듈이 필요없고, 파일럿(pilot) 신호를 위한 추가적인 데이터 전송이 필요 없다는 장점을 가진다. 그러나 동기 검출을 사용한 시스템에 비해서 약 4.0dB의 성능열화를 보인다. 차동 검출 방식을 사용한 DMP-CDMA 시스템의 성능 열화를 보상하기 위해서 다중 심볼 차동 검출 방식을 적용한 결과 차동 검출 방식에 비해서 약 3.6dH의 성능 개선 효과를 보았다.
본 논문에서는 VHDL '87 및 '93 LRM의 전체 사양을 지원하며 VHDL-to-C 사상의 전처리 과정을 수행하는 VHDL 컴파일러 전반부의 설계 및 구현에 대해서 논한다. VHDL 컴파일러 전반부는 I)VHDL의 계층적 구조체, 선언 영역 및 가시성, 다중 정의 및 동형 이의어, 병행적 다중 스택 구조를 표현하기 위해서 분석 터미널 데이터에 심볼 트리를 구성하였으며, 2) VHDL 고유의 객체, 타입 및 서브타입, 속성과 연산자 등을 나타내기 위한 구조체 및 지원 함수를 설계하였고, 3) VHDL의 병행문/순차문, 행위/구조 기술, 동기 메커니즘 등을 분석하여 VHDL-to-C 사상에 필요한 어의 정보를 구축하고, 4) VHDL 분석 과정에서 어의 데이터의 저장 및 검색이 효과적으로 이루어 지도록 어의 토큰 정의 및 어의 전파 기능 등을 설계하였다. Validation suite를 이용한 실험에서 VHDL 컴파일러 전반부는 LRM 전체 사양을 분석할 수 있음을 확인하였고, VHDL의 계층성/가시성/병행성/어의 검사 등을 효과적으로 처리하기 위해 설계 및 구현된 심볼 트리와 어의 토큰 등의 분석 데이터 모델에 대한 성능 분석 실험에서 VHDL컴파일러 전반부는20- 30%의 개선 효과를보였다.
버스트 방식 OFDM 시스템에서의 프레임 동기는 수신된 프레임의 시작 위치를 판단하고, 정확한 FPT-window 위치 추정을 위해 가장 우선적으로 수행되어야 한다. 유효 OFDM 심볼 내의 규정된 반복 패턴 또는 보호 구간의 상관을 이용하는 기존의 일반적인 프레임 동기 방식은 연속적으로 증가하다 감소하는 상관 출력 특성에 의해 정확한 프레임 시작 지점 검출이 어려우며, 수신 신호와 기준 신호 간의 상관 특성을 이용하는 방식은 주파수 옵셋으로 인한 성능 열화를 초래한다. 따라서, 본 논문에서는 프레임 동기 방식으로서 주파수 옵셋에 강인하고 정확한 프레임 시점 검출이 가능한 차동 상관(Differential Correlation) 방식을 기반으로 한 새로운 알고리즘을 제안하였다. 그러나, 일반적인 차동 신호의 상관 결과는 프리앰블의 반복 구조에 의해 다수의 Peak를 가지게 되며 이로 인하여 정확한 프레임 동기의 검출 성능이 열화된다. 본 논문에서는 이러한 차동 검출 방식의 단점을 보완하기 위하여 차동 신호 생성 시 반복되는 동일 패턴 구간의 샘플을 이용하여 단일 상관 Peak를 갖는 알고리즘을 제안한다. 또한 다중경로 페이딩 채널 환경에서 페이딩에 의한 프레임 시작 위치 검출 에러를 줄이기 위하여 신호 전력으로 상관 출력 값을 정규화하는 블록을 도입함으로써 고속 이동 채널 환경에서의 프레임 시작 지점 검출 확률을 높였다.
이동 통신망을 이용한 지상파 측위 기술은 GPS와 더불어 LBS를 구성하기 위한 핵심 기술이다. WiBro 시스템은 차세대 통신망으로 주목 받고 있으며, WiBro 망에서 매 프레임마다 방송되는 프리앰블 심볼의 특성을 이용하면 TDOA 방식의 무선 측위가 가능하다. 그러나 WiBro 시스템은 셀룰러 구조로 되어 있기 때문에 일반적으로 단말기가 다수의 기지국 신호로부터 거리정보를 구하기 어렵다. WiBro 망에서 삼변측량을 이용한 무선 측위를 하기 위해서는 수신 신호의 세기를 증가시켜야 하며, 장기 중첩 기법을 이용하여 가청성을 향상 시킬 수 있다. 본 논문에서는 주파수 잔여 오차와 수신 신호의 SNR에 따른 동기 중첩 및 비동기 중첩의 성능을 비교하여 WiBro 망에서 최적의 혼합 중첩 방법을 제시하였다. 컴퓨터 시뮬레이션을 통하여 혼합 중첩의 성능을 분석하고 WiBro 망을 이용한 무선 측위의 가능성 및 한계를 확인하였다.
M-ary DPSK는 대역 효율이 우수한 디지탈 변조 기법이고, 최큰에는 이용 가능한 무선 대역폭이 제한된 이동 위성통신 시스댐 분야의 응용에서 관심이 모아지고 있다. 동기 검파 방식은 잡음 환경에서 우수한 오류 성능을 제공하지만 페이딩 환경에서는 낀 포착 시간을 필요로 한다.본 논문에서는 라이시안 페이딩과 쉐도우 라이시안 페이딩 채널에서 다중 차동 궤환 검파 기법을 사용한 M-ary DPSK 신호의 오류 성능을 분석하였다. 다중 차동 궤환 검파 기법은 일반적인 차동 수신기의 복잡도를 증가시켜서 차동 수신과 동기 수선 사이의 성능 차이를 줄일 수 있는 효율적인 기법이다. 다중 심볼 최대 우도 검파 기법과 비교할 때 다중 차동 궤환 검파 기법은 H/W 구현상에서 매우 간단한 구조를 갖는다. 특히 이 기법은 잡음과 빠른 페이딩 채널 사이에서 시간과 공간에서 변할 수 있는 육상 이동위성 채널에 적용할 수 있다.
본 논문에서는 2003년 표준화된 저속, 저전력, 저가의 근거리 무선 통신망(WPAN, Wireless Personal Area Network)기술로서 유비쿼터스 센서 네트워크를 위한 IEEE 802.15.4 LR-WPAN 표준의 2.4GHz 대역의 물리계층에 대한 설계 및 검증에 관해 기술하였다. IEEE 802.15.4 LR-WPAN 표준에서 제시하는 주파수 tolerance 인 ${\pm}40ppm$을 만족하는 반송파 주파수 옵셋 보상 방법과 다양한 유비쿼터스 센서 네트워크 환경에 적절하게 반응하기 위한 임계값 재 설정 방법의 적응형 정합 필터에 기반한 심볼 동기부를 설계하였다. 본 논문에서 제안한 방법에 의해 동기를 위한 연산량이 i, q 위상에서 각각 1/l6으로 감소가 되었으며, 약 0.5dB의 성능 향상을 얻을 수 있었다. 하드웨어 구현은 verilog HDL을 사용하였고, FGPA를 이용한 테스트 보드를 통해 성능 검증을 수행하였다.
본 논문에서는 IEEE 802.113의 표준안에 정의된 OFDM (Orthogoanl Frequency Division Multiplexing) 기반의 무선 LAN 시스템의 수신기를 구현하였다. OFDM 방식은 데이터 전송시 다수의 직교 반송파를 사용하여 병렬전송을 하기 때문에 오류 정정 부호와 함께 사용할 때 고속 데이터 전송시에 나타나는 주파수 선택적 페이딩을 극복할 수 있다. 그러나 수신단에서 동기가 이루어지지 않는 경우 부반송파 사이에 직교성이 파괴되어 채널간 간섭이 발생하여 오류 성능이 크게 저하된다. 따라서 시스템의 동기를 이루기 위해 심볼을 구성하는 부반송파 사이의 위상관계를 이용하여 OFDM 신호의 주파수 옵셋을 추정하였으며 단일탭 등화기를 통하여 채널상의 잡음에 의한 오차를 개선하였다. 효율적인 하드웨어 구성을 위해 이들 블록을 Verilog HDL으로 모델링 하였으며 표준안의 벡터를 이용하여 기능 검증 및 성능 평가를 수행하였다.
본 논문에서는 직교 주파수 분할 다중화 기법을 이용하는 비동기 협력 통신 시스템에서 낮은 릴레이 복잡도를 갖는 새로운 Alamouti 시공간 전송 기법을 제안한다. 기존 기법은 릴레이 노드에서의 상수 곱 연산 외에도 추가적인 시간 반전 연산을 필요로 하므로 릴레이 노드에서의 시스템 복잡도가 크다는 문제점을 가지고 있다. 이와 달리 제안한 기법은 소스 노드에서의 간단한 심볼 조합과 릴레이 노드에서의 상수 곱만을 이용하여 목적지 노드에서 Alamouti 부호 구조를 획득함으로써 2차 다이버시티 이득을 달성한다. 모의실험 결과를 통하여 제안한 기법이 2차 다이버시티 이득을 달성하며, 릴레이 노드의 복잡도를 줄이면서도 기존 기법과 동일한 비트오류율 성능을 갖는 것을 확인한다.
디지털 위성방송의 복조단에서 사용되고 있는 동기 검파 방식의 QPSK복조기에서 복소 신호의 전송시 송신단과 수신단 사이의 반송파 위상이 동기 되지 않아서 위상차 ${\theta}$가 발생하면 복조된 심볼은 원래 전송 신호에 $e^{j{\theta}}$가 곱해진 형태로 변하게 된다. 이러한 복조기의 성능은 연산처리 비트수가 증가할수록 향상되는 반면 하드웨어의 복잡도가 증가하므로 복잡도와 시스템의 성능을 동시에 고려하여 비트수를 결정하여야 한다. 따라서 본 논문에서는 곱셈기 수를 줄임으로써 구현상의 복잡도를 감소시키고, lookup table을 사용하지 않는 조합 회로 구조로 설계하여 전력소모를 줄일 수 있었다.
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[게시일 2004년 10월 1일]
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