• 제목/요약/키워드: 비동기 회로

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WWW상에서의 MHEG 기반 원격 교육/훈련 시스템 (MHEG based Distance Learning /Training System on WWW))

  • 이세훈;윤경섭;안치돈;왕창종
    • 한국정보과학회논문지:소프트웨어및응용
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    • 제26권5호
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    • pp.674-681
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    • 1999
  • 본 연구에서는 MHEG을 기반으로 한 원격 교육/훈련 시스템으 설계한다. 설계하는 시스템은 코스웨어를 제공하고, 비동기모드로 브라우징하여 개별 학습을 지원하던 기존 시스템과는 달리 , 교육적 효과를 높이기 위해 비동기 방식과 동기 방식을 동시에 수용할수 있도록 설계하였다. 특히 동기 방식은 사용자 공동 작업 환경을 위한 세션 관리 모듈을 두어 실시간 화상 강의 응용에서 학습자 및 세션 제어에 대한 연산을 제공함으로써 학습 효율을 향상시킬수 있으며, MHEG 표준을 도입하여 학습자와의 실시간 상호 작용을 충분히 지원함으로써 훈련 시스템에서의 시뮬레이션 지원 능력을 극대화 할수 있도록 하였다.

비동기적 분산 시스템하에서 선출 문제와 합의 문제의 관련성 (The Relationship between Election and Consensus in Asynchronous Distributed System)

  • 박성훈
    • 한국정보과학회논문지:시스템및이론
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    • 제27권12호
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    • pp.967-973
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    • 2000
  • 본 논문에서는 신뢰할 수 없는 고장추적 장치로 구성된 비동기적 분산 시스템 하에서 선출(election) 문제와 합의(consensus) 문제의 관련성에 관하여 연구하고자 한다. 먼저 선출 문제는 합의 문제보다 더욱 어려운 문제임을 보인다. Chandra와 Toueg는 [8]에서 합의 문제는 비동기적 분산 시스템에서 신뢰할 수 없는 고장 추적 장치(unreliable failure detector)를 이용하여 해결 할 수 있음을 언급하였다. 그러나, 합의 문제와는 대조적으로 선출 문제는 시스템 상에서 단 한 개의 노드가 죽은 경우에도 신뢰 할 수 없는 고장 추적 장치를 이용하여 선출 문제를 해결할 수 없다. 이는 선출 문제는 합의의 문제보다 더욱 어려운 문제임을 의미한다. 보다 엄격하게 표현하자면, 선출 문제를 해결하는데 필요한 가장 약한 고장 추적 장치 (perfect failure detector) 이어야 하는 것으로, 이는 합의 문제를 해결하는데 필요한 가장 약한 고장 추적 장치보다 확실히 강한 것이다. 선출 문제가 합의 문제보다 어렵다는 것을 보이기 위해 축소(reduction) 프로토콜을 이용한다.

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속도 독립 회로를 위한 직접 합성 시스템 (A Direct Synthesis System for Speed-independent Circuits)

  • 김희숙;정성태;박희순
    • 한국정보과학회논문지:시스템및이론
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    • 제28권1_2호
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    • pp.110-123
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    • 2001
  • 본 논문에서는 자유 선택 신호 전이 그래프와 비동기 유한 상태기로 기술된 회로 명세로부터 직접 속도 독립 회로를 합성하는 시스템에 대해 기술한다. 기존의 상태 그래프 기반의 합성 시스템은 상태의 수가 지수승으로 증가할 수 있기 때문에 큰 규모의 회로에 대해서는 합성에 실패할 수 있다는 문제점을 가지고 있다. 이를 해결하기 위해 여러 직접 합성 방법들이 제안되었는데, 본 논문의 합성 시스템은 마크드 그래프 분할 방법과 임시 전이의 사용을 허용함으로써 합성할 수 있는 회로의 범위를 넓혔다. 기존의 벤치마크 회로에 대한 실험결과 본 합성 시스템은 기존의 상태 그래프 기반의 합성 시스템에 비하여 현저하게 수행 속도를 단축시킬 수 있었고 기존의 직접 합성 시스템에 비하여 보다 확장된 그리고 보다 실용적인 회로 명세를 처리할 수 있었다.

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성인의 비자살적 자해의 심각도에 영향을 미치는 요인: 자해 동기를 중심으로 (The effects of motivation on the severity of non-suicidal self-injury in a community sample of adults)

  • 권호인;최상은;김초원
    • 한국융합학회논문지
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    • 제13권2호
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    • pp.273-280
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    • 2022
  • 본 논문은 지역사회 성인 표본을 대상으로 비자살적 자해의 심각도에 영향을 미치는 요인을 탐색하고자 하였다. 본 연구의 대상은 지난 1년간 비자살적 자해행동을 1회 이상 한 적이 있는 54명의 성인으로, 이들을 대상으로 자해 빈도와 방법, 자해 동기, 인지적 재평가에 대한 자기보고식 설문을 실시하였다. 그 결과 정서 조절을 주요 목적으로 하는 개인 내적 동기가 사회적 동기에 비해 빈번하게 보고되었다. 회귀분석 결과 이른 나이에 자해를 시작하는 것이 자해의 심각도와 관련 있었다. 또한 개인 내적 동기가 자해의 심각도에 유의한 영향을 주는 것으로 나타났다. 이러한 결과는 자해의 정서조절 모형을 지지하며, 정서조절을 향상시키는데 초점을 둔 개입이 중요하다는 것을 시사한다.

발정동기화방법이 경산돈의 번식성적에 미치는 영향

  • 김인철;이장희;김현종;진현주;조창연;정경용;손동수;박창식
    • 한국동물번식학회:학술대회논문집
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    • 한국동물번식학회 2001년도 춘계학술발표대회
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    • pp.83-83
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    • 2001
  • 본 연구는 이유한 경산돈의 발정동기화방법이 번식성적에 미치는 영향을 조사하기 위하여 대조구(자연발정), T1(Regumate+PMSG+hCG), T2(PMSG+hCG) 및 T3(PG600)처리구로 발정을 유기한 후 12시간 간격으로 2회 인공수정 하여 수태율, 분만율 및 산자수를 조사하였다. 본 실험에 사용된 액상정액은 축산기술연구소 돼지인공수정센타의 종모돈 5두 정액을 혼합하여 이용하였으며, BTS(Beltsville thawing solution) 보존액으로 1회 주입 정자농도를 3.0$\times$$10^{9}$이 되도록 조절하였다. 수태율은 72구가 95.2%, 73처리구가 93.6%로 발정동기화 유도하지 않는 대조구의 91.3%보다 다소 높은 수태율을 나타내었으나 통계적인 유의차는 없었으며, T1 동기화 방법이 87.2%로 가장 낮은 수태율을 나타내었다(P<0.05). 분만율은 T2처리구가 90.4%로 가장 높았으며(P<0.05), T3구는 수태율은 높았으나 분만율이 가장 낮게 조사된 것은 임신 확인 후 각종 사고로 인한 조기 도태 매각 때문인 것으로 분석되었다. 복당 평균 총산자수는 대조구에 비하여 발정 동기화유도 처리구 모두 증가하였으나 통계적인 유의차는 인정되지 않았다.

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하이브리드 터너리 데이터 인코딩 기반의 비동기식 시스템 버스 래퍼 설계 (Design of Asynchronous System Bus Wrappers based on a Hybrid Ternary Data Encoding Scheme)

  • 임영일;이제훈;이승숙;조경록
    • 대한전자공학회논문지SD
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    • 제44권1호
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    • pp.36-44
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    • 2007
  • 본 논문은 Delay-Insensitive(DI) 지연 모델을 갖는 비동기식 회로에 3치 전압 레벨을 사용한 하이브리드 터너리 데이터 전송 방식을 제안하고, 이를 이용하여 다양한 비동기 프로토콜과의 데이터 송신 및 수신을 위한 래퍼를 설계하였다. 제안된 하이브리드 터너리 데이터 전송 방식은 기존의 2 선식 전송 방식이나 1-of-4 전송 방식에 비해 데이터 전송선을 50% 줄일 수 있으며, 터너리 전송 방식과 비교하였을 때도 50%의 신호 천이 감소 결과를 보였다. 본 논문에서는 $0.18-{\mu}m$ CMOS 공정을 적용하여 래퍼를 설계하고 검증하였다. 하이브리드 터너리 전송 방식이 적용된 래퍼는 2 GHz 이상의 속도로 동작 하였으며 2 선식, 1-of-4, 그리고 터너리 전송 방식에 비해 각각 65%, 43%, 36%의 소비 전력이 줄어든 결과를 보였다. 제안된 전송 방식과 설계된 래퍼 회로는 비동기식 고속 및 저전력 인터페이스로 사용 가능하다.

FPGA를 이용한 다채널 비동기 통신용 IC 설계 (The Design of Multi-channel Asynchronous Communication IC Using FPGA)

  • 옥승규;양오
    • 대한전자공학회논문지SD
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    • 제47권1호
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    • pp.28-37
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    • 2010
  • 본 논문에서는 FPGA와 VHDL을 이용하여 다채널 비동기 통신용 IC를 설계하였다. 기존에 상용되고 있는 대부분의 비동기 통신용 IC들은 최대 1~2채널(Channel)로 구성되어 있다. 따라서 2채널 이상의 통신 시스템을 구성할 때 원가가 높아지고 구현하기도 복잡해진다. 그리고 매우 적은 송수신 버퍼(Buffer)를 가지고 있으므로 고속으로 대용량의 데이터를 전송할 경우 마이크로프로세서에 걸리는 부하가 많아지게 된다. 이러한 문제를 해결하기 위해 본 논문에서는 비동기 통신 채널 8개를 단 한개의 IC로 설계하여 원가 절감 및 기능과 성능을 향상 시키도록 설계하였으며, 송수신 버퍼의 크기를 각각 256 바이트로 설계함으로써 고속의 통신을 가능하게 하였다. 또한 통신시 오동작을 방지하기 위해 디지털(Digital) 필터 및 첵섬(Check-sum) 로직을 설계하여 신뢰성을 향상시켰으며, 채널 먹스 로직을 설계하여 각 채널별 입/출력을 자유롭게 선택하도록 하여 통신 채널에 대한 입/출력 포트를 유연하게 사용할 수 있도록 설계하였다. 이와 같이 설계된 다채널 비동기 통신 IC를 ALTERA사의 Cyclone II Series EP2C35F672C8과 QuartusII V8.1을 이용하여 로직을 합성 및 시뮬레이션 하였다. QuartusII 시뮬레이션과 실험에서 성공적으로 수행되었으며, 설계된 IC의 우수성을 보이기 위해 비동기 통신 칩으로 많이 사용되고 있는 TI(Texas Instruments)사의 TL16C550A, ATMEL사의 ATmega128 범용 마이크로 콘트롤러와 수행시간 및 성능을 비교하여 본 논문에서 설계된 다채널 비동기 통신용 IC의 우수함을 확인하였다.

발정 제어 방법과 계절번식이 한우의 수태에 미치는 영향

  • 이명식;최창용;오운용;조영무;이지웅;양화정;손삼규
    • 한국동물번식학회:학술대회논문집
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    • 한국동물번식학회 2001년도 춘계학술발표대회
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    • pp.84-84
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    • 2001
  • 한우 농가의 다두화 사육규모에 적합한 번식관리모델 제시 및 수태율 증진을 위한 발정제어 방법을 개발하고자 수행하였다. 1. 년중 번식구의 분만간격은 412.9일, 수태당종부횟수 1.76회에 반하여 계절번식 I구와 II구는 각각 370.4일과 1.51회, 376.5일과 1.48회로 나타났다. 2. 송아지 생산율에 있어서 년중번식구 78.2%(174/184), 계절번식 I구 71.7%(99/138)에 비해 계절번식 II구에서는 79.2%(172/217)로 효율이 다소 높았다. 3. 발정유기방법별 동기화율에 있어서 PGF$_2$$_{\alpha}$ 2회 투여법에서 68.1%(141/207), PRID 삽입법 71.42%(15/21), CIDR 삽입법 86.3%(33/38)에 비해 GnRH-PGF$_2$$_{\alpha}$-GnRH 처리법은 93.1%(216/232)로 효율이 가장 높았다. 4. 발정유기방법별 1회 수정수태율은 PGF$_2$$_{\alpha}$ 2회 투여법 55.1%(64/l16), PRID 삽입법 54.0%(20/37), CIDR 삽입법 58.6%(17/29), 일괄수태법 58.8%(60/102)로 나타났고, 수태율은 각각 75%(87/116), 81%(30/37), 89.6%(26/29), 91.1%(93/102)였다. 5. 일괄수태 처리후 수정시점에 따른 수태율은 최종 GnRH 투여후 16~20 시간구가 65.3%로 가장 좋았다.

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병렬배열구조를 사용한 비동기 곱셈기 (Asynchronous Multiplier with Parallel Array Structure)

  • 박찬호;최병수;이동익
    • 대한전자공학회논문지SD
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    • 제39권5호
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    • pp.87-94
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    • 2002
  • 본 논문에서는 기존의 배열구조의 문제점인 전력낭비와 느린 연산속도를 보완하기 위하여 병렬배열구조를 채택하고 비동기 시스템에 적합하도록 평균 연산속도를 최소화한 곱셈기를 제안한다. 실험 결과 제안된 비대칭 병렬배열구조는 기존의 배열구조와 비교하였을 때, 평균 55% 정도의 연산시간 단축이 가능하며, 이 구조를 이용한 Booth 인코딩 비동기 곱셈기는 기존의 Booth 인코딩 배열 곱셈기에 비해 40% 정도의 시간 단축 효과가 있음을 확인하였다.