고조파에 의한 전력품질저하로 인해 전기설비의 성능저하, 소음, 진동 등의 장해현상이 발생한다. 또한 앞으로 에너지 이용 효율을 높이기 위한 대책으로 반도체 회로를 사용하는 에너지 절약장치가 널리 보급되고, 전동기 속도 제어장치, 에너지 저장장치 등 에너지 변환장치의 사용이 증가될 전망이어서 고조파의 발생은 필연적이며 그 문제점은 심각하게 대두될 것이다. 이러한 고조파에 의한 장애를 해결하기 위해서는 전압, 전류, 전력, 역률, 고조파 차수별 성분 및 고조파 총합 왜형률 등의 정확한 전력품질을 측정하고 분석할 필요가 있다. 본 연구에서는 이러한 고조파 관련 전력품질을 측정하고 분석할 수 있는 저가형 측정시스템을 개발하였으며 3상 4선식 계통에서 전력품질을 측정하고 분석함으로써 그 성능을 입증하였다.
반도체 소자의 미세화와 더불어 세정공정의 중요성이 차지하는 비중이 점점 커지고, 이에 따라 세정 기술 개발에 대한 요구가 증대되고 있다. 기존 세정 기술은 화학약품 위주의 습식 세정 방식으로 표면 손상, 화학 반응, 부산물, 세정 효율 등 여러 가지 어려움이 있다. 따라서 건식세정 방식이 활발하게 도입되고 있으며 대표적인 것이 에어로졸 세정이다. 에어로졸 세정은 기체상의 작동기체를 이용하여 에어로졸을 형성하고 표면 오염물질과 직접 물리적 충돌을 함으로써 세정한다. 하지만 이 또한 생성되는 에어로졸 내 발생 입자로 인해 패턴 손상이 발생하며 이러한 문제점을 극복하기 위하여 본 연구에서는 가스클러스터 장치를 이용한 세정 특성 평가에 관한 연구를 수행하였다. 가스 클러스터란 작동기체의 분자가 수십에서 수백 개 뭉쳐 있는 형태를 뜻하며 이렇게 형성된 클러스터는 수 nm 크기를 형성하게 된다. 그리고 짧은 시간의 응축에 의해 수십 nm 크기까지 성장하게 된다. 에어로졸 세정과 다르게 클러스터가 성장할 환경과 시간을 형성하지 않음으로써 작은 클러스터를 형성하게 되며 이로 인해 패턴 손상을 최소화 하고 상대적으로 높은 효율로 오염입자를 제거하게 된다. 클러스터 세정 장비를 이용한 표면 처리는 충돌에 의한 제거에 기반한다. 따라서 생성 및 가속되는 클러스터로부터 대상으로 전달되는 운동량의 정도가 세정 특성에 영향을 미치며 이는 생성되는 클러스터의 크기에 종속적이다. 생성 클러스터의 크기 분포는 분사 거리, 유량, 분사 각도, 노즐 냉각 온도 등의 변수에 관한 함수이다. 따라서 본 연구에서는 $CO_2$ 클러스터를 이용한 세정 특성을 평가하기 위하여 이러한 변수에 따라서 오염 입자의 종류, 크기에 따른 PRE (particle removal efficiency)를 평가하고 다양한 선폭의 패턴을 이용하여 손상 실험을 수행하였다. 제거 효율에 사용된 입자는 $CeO_2$와 $SiO_2$이며, 각각 30, 50, 100, 300 nm 크기를 정량적으로 오염시킨 쿠폰 웨이퍼를 제조하여 세정 효율을 평가하였다. 정량적 오염에는 SMPS (scanning mobility particle sizer)를 이용한 크기 분류와 정전기적 입자 부착 시스템이 사용되었다. 또한 패턴 붕괴 평가에는 35~180 nm 선폭을 가지는 Poly-Si 패턴을 이용하였다. 실험 결과 클러스터 형성 조건에 따라 상대적으로 낮은 패턴 붕괴에서 95% 이상의 높은 오염입자 제거효율을 전반적으로 보이는 것을 확인할 수 있었다. 따라서 이론적 계산에 기반하여 세정에 요구되는 클러스터 크기를 가정하고, 이를 통하여 세정에 적용할 경우 높은 기존 세정 방법의 단점을 보완하면서 높은 세정 효율을 가지는 대체 세정 방안으로 이용할 수 있음을 확인하였다.
자동차, 반도체, 플랜트 등 다양한 산업현장에서 PLC(Programmable Logic Controller) 기반으로 생산자동화 시스템을 제어하여 제품 양산이 이루어지고 있다. 이에 따라 산업현장에서는 PLC를 능숙하게 사용할 수 있는 전문 인력과 PLC 교육을 위한 교육 플랫폼이 필요하다. 기존에 개발된 교육 플랫폼들의 경우 PLC를 기반으로 하여 다양한 액추에이터와 센서를 제어할 수 있다. 하지만 화면상 나타나는 생산자동화 시스템이 화면에 2D로만 나타나 현실성이 결여되기 때문에 학습 시 정확한 이해가 힘들다는 단점이 있다. 본 논문에서는 이러한 단점을 보완하여 가상현실에서 학습이 가능한 교육용 V-Factory 시스템을 제안한다. 개발한 V-Factory 시스템은 가상 I/O 드라이버를 도입하여 다양한 종류의 센서 및 액추에이터를 제어할 수 있고, 가상현실에서 가시화된 생산자동화 시스템이 구동되는 모습을 확인할 수 있다. 또한 HMD(Head Mounted Display)를 사용하여 현실적인 PLC 시뮬레이션이 가능하다. 개발한 V-Factory 시스템을 통해 가상현실에서 효과적인 PLC 학습이 이루어질 것으로 기대한다.
Current semiconductor industry factories are relying on the end-of-pipe treatment technology for waste water treatment and thus they mostly suffer from severe industrial water shortage. As a result in order to solve those waste and industrial water problems, there requires to be changed to the Clean Technology, that is Pollution Prevention Technology. Through above strategic actions with the Clean Technology, we shall strength more powerful and logical environmental pollution prevention system than those in the past. By changing the end-of-pipe treatment technology for waste water treatment and thus they mostly suffer from severe industrial water problems, there requires to be changed to the Clean Technology, that is Pollution Prevention Technology. Through above strategic actions with the Clean Technology, we shall strength more powerful and logical environmental pollution prevention system than those in the past. By changing the end-of-pipe treatment technology with physical, chemical and biological treatment methods as a mixed stream basis for treating of semiconductor waste stream into clean technology with pollution prevention technology as a waste segregation basis, we can bet 20 to 30% investment reduction as compared with end-of-pipe treatment technology.The results for water quality analysis were as follows : 1. Water quality analysis of the before treatment : pH : 9~10.5, Conductivity : $300~7,000{\mu}s/cm$, TDS : more then $3,000mg/{\ell}$, COD : $200~250mg/{\ell}$, SS : $500~600mg/{\ell}$, n-H : $8.3mg/{\ell}$ 2. Water quality analysis of the after treatment : pH : 6.5~7.5, Conductivity : 0.059, TDS : $40{\mu}s/cm$, COD : $20mg/{\ell}$, SS : $5mg/{\ell}$ n-H : $0.6mg/{\ell}$
최근 화석연료를 대체하기 위한 지속가능한 신에너지에 대한 요구가 증대됨에 따라 태양광 발전에 대한 연구도 폭발적으로 늘어가고 있는 추세이다. 태양광이 화석연료 대체에너지로 실효성을 가지기 위해서는 태양광 발전 시스템의 발전효율을 높이고 생산 비용을 저감하는 문제가 선결되어야 한다. 기존 실리콘 태양전지 시스템 설비 비용의 60% 이상을 차지하는 모듈의 제조과정에서 소재 손실을 최소화함으로써 저가격화를 실현하고자 박막형 태양전기 기술이 태동되었다. 현재 박막 태양전지와 관련하여 활발한 기술 개발이 진행되고 있으며 상당한 시장 점유율을 보이고 있는 실정이다. 박막 태양전지 분야에서 CIGS와 같은 화합물 반도체 박막 태양전지 시장이 확대되고 있는 실정을 고려한다면 실리콘 박막 태양전지의 경우 고효율화 저가격화 달성은 더욱 절실한 문제이다. 실리콘 박막의 경우 독성이 없으며 고갈 우려가 없는 소재이면서 기존의 직접회로 산업의 인프라 구조를 활용할 수 있어 많은 기대와 관심을 끌고 있는 박막 태양전지 후보이다. 박막 태양전지 제조에 있어서 핵심기술은 도핑된 실리콘층과 광흡수를 위한 진성 실리콘층을 합성하는 공정 기술이다. 현재 박막 태양전지 산업에서 실리콘 박막 소재의 합성은 주로 PECVD법에 의해 이루어지고 있다. 그러나 스퍼터 공정을 이용한 실리콘 박막 합성 연구 또한 20년 이상의 오랜 기간 동안 연구되어 오고 있다. 스퍼터 공정을 이용한 실리콘 박막합성는 독성 가스를 사용하지 않으며, 디스플레이와 같은 기존의 소자 공정 기술을 채용할 수 있다는 장점을 가지고 있어 주목 받고 있다. 실제로 반응성 마그네트론 스퍼터링에 의해 제조된 실리콘 박막은 PECVD공정에 의한 실리콘 박막에 상응하는 우수한 광전자적 특성을 보인다. 스퍼터 공정에서는 박막 성장을 위한 수송 물질들이 열적 평형 상태에 근접한 라디칼들이라기 보다 대부분 고에너지 원자종과 이온들이 주류를 이루고 있어 합성된 실리콘 박막의 결함 제어가 어렵다는 문제가 있다. 박막 합성 기구의 규명을 통하여 이러한 문제를 해결하기 위한 시도들이 이루어 지고 있으며, 본 발표를 통하여 스퍼터 공정을 이용한 태양전지용 실리콘 박막 합성기술에 대한 현황을 소개하고자 한다.
열전 재료로 사용되는 $Ag_2S$의 단결정을 밀폐된 석영관내에서 고상의 $Ag_2S$가 분해되면서 성장 계면에 $Ag^+$이온과 전자를 공급하고, 휘발성이 강한 황은 vapour 상태로 전송되면서, $Ag_2S$ 계면에서부터 단결정이 성장하는 고상에서의 전기 화학적인 방법을 이용한 vapour 성장법으로 성장시켰다. 고상에서의 $Ag^+$ 이온의 확산이 성장을 지배하는 온도 영역에서는 bulk $Ag_2S$ 단결정을 얻었으며, Ag 분해 온도가 높을수록, Ag분해 온도와 성장 계면의 온도 차이가 클수록 성장속도가 빠름을 확인하였다. 한편 기상으로의 황의 확산이 성장을 지배하는 영역에서는 whisker Ag$_2$S가 성장되었으며 황의 포화 압력이 증가할수록 성장속도는 증가하였다. 또한, 열전재료의 효율을 결정하는 물성치인 전기 전도도를 측정한 결과 고온상에서 다결정의 전기 전도도가 단결정보다 크게 나타나며, 따라서 열전 효율은 다결정이 우수하다고 생각된다.
본 연구는 최근 새로운 제조 수단으로 각광받고 있는 3D프린팅 기술의 통합제어 시스템과 품질개선을 위한 모니터링 SW 기술개발을 위한 프레임워크 및 연구개발 방향을 제시하고자 한다. 이를 위해 본 연구에서는 금속프린팅 기술로 조명되고 있는 DED와 PBF 3D프린팅 기술의 통합 제어기술 개발 Framework와 최근 반도체 장비 등에서 큰 관심을 받고 있는 음향센서를 이용한 모니터링 기술 등 품질 개선을 위한 4가지 모니터링 기술을 제안 소개하고자 한다. 본 연구를 위하여, 국내 3D프린팅 전문기업인 (주)컨셉션, 원광이엔텍(주), (주)디이엔티 등에서 개발 중인 국내 최신 금속 3D프린팅 시스템 장비를 활용하여 연구하였으며(1KW급 Dual Laser PBF 및 DED 프린팅 시스템), 2017년 이래 지속적인 연구개발을 수행해온 경험을 바탕으로 다음세대 3D프린팅 개발자를 위한 연구초안을 제시함으로서 국내 3D프린팅 기술 발전 및 연구개발 협력을 위한 기초자료를 제시하고자 한다.
최근의 메모리 반도체에 있어서, 수율과 품질을 유지하기 위하여 불량셀은 반드시 수리가 필요하다. 대부분의 워드단위 입출력을 갖는 system-on-chip (SoC)를 포함한 많은 메모리가 다중 블록으로 구성되어 있음에도 불구하고, 기존의 대부분의 자체내장수리연산회로의 연구들은 단일블록을 대상으로 하였다. 워드 단위 입출력 메모리의 특성상 다중메모리 광역대체수리구조를 갖는 경우가 많다. 본 논문에서는 이러한 메모리를 대상으로 기존에 최적 수리효율을 갖는 대표적인 자체내장 수리연산 회로인 CRESTA를 기본으로 하여, 보다 적은 면적으로 최적 수리효율을 낼 수 있는 알고리즘과 연산회로을 제안한다. 제안하는 자체내장수리 회로는 단위블록의 연산결과를 순차적으로 비교하여 워드단위 메모리의 제약조건을 만족시키는 최종 수리해를 구해내며, 기존의 회로보다 훨씬 빠른 시간 내에 최적의 수리 해를 구해 낼 수 있다.
전자 제품의 경박 단소화 및 고집적화가 이루어 지면서 반도체 칩뿐만 아니라 유기 기판도 고집적화가 요구되고 있다. 본 연구는 인쇄회로기판의 미세 피치 회로에 대한 고온고습 전압인가 시험을 실시하여 불량 메커니즘을 연구하였다. $130^{\circ}C/85%RH/3.3V$와 $135^{\circ}C/90%RH/3.3V$ 시험조건에서 고온고습 전압시험(Biased HAST)의 가속 계수는 2.079로 계산되었다. 불량 메커니즘 분석을 위하여 집속이온빔(FIB) 분석이 이용되었다. (+)전극에서는 콜로이드 형태의 $Cu_xO$와 $Cu(OH)_2$가 형성되었으며, (-)전극에서는 수지형태의 Cu가 관찰되었다. 이를 통해 $Cu^{2+}$ 이온과 전자($e^-$)가 결합한 수지상 Cu에 의해 절연파괴가 일어난다는 것을 확인하였다.
본 연구에서는 MicroTec4.0을 이용하여 더블게이트 MOSFET의 문턱전압이하특성을 채널도핑농도의 변화에 따라 분석하였다. DGMOSFET는 구조상 단채널효과를 감소시킬 수 있다는 장점 때문에 많은 연구가 진행중에 있다. 이에 DGMOSFET에서 단채널효과로서 잘 알여진 문턱전압이하 스윙 및 문턱전압 등을 반도체소자 시뮬레이이터인 MicroTec을 이용하여 분석하고자 한다. 나노소자인 DGMOSFET의 구조적 특성도 함께 고찰하기 위하여 채널의 두께, 길이, 폭 등 크기요소에 따라 분석하였다. 본 논문에서 사용한 MicroTec 프로그램은 여러 논문에서 수치해석학적 값과 비교하여 그 타당성이 입증되었으므로 이 모델을 이용하여 DGMOSFET의 문턱전압이하특성을 분석하였다.
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[게시일 2004년 10월 1일]
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