• 한국컴퓨터정보학회논문지
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• 제18권10호
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• pp.13-21
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• 2013

최근 들어 칩 멀티 프로세서 상의 코어 개수는 지속적으로 증가하는데 반해, 이를 효율적으로 뒷받침하기 위한 멀티 프로그래밍 혹은 멀티 쓰레딩 기법은 부족한 실정이다. 이로 인해 실제 작업을 수행하지 않는 유휴 코어가 발생하였고, 해당 코어가 소유한 자원들 중 개별 캐시 부분은 유휴 캐시로 낭비되었다. 본 논문에서는 유휴 개별 캐시의 발생이 불가피함을 인지함과 동시에 그것을 칩 내 메모리 공간으로써 효율적으로 활용할 수 있는 기법을 제안한다. 제안된 기법은 유휴 캐시를 희생 캐시로 활용하는 방법이며, 이를 위해 요구되는 새로운 시스템 구성 및 캐시 일관성 프로토콜의 세부 동작을 소개한다. 본 논문에서 제시된 기법은 유휴 캐시를 사용하지 않을 때와 비교하여 4-코어 및 16-코어 기반 칩 멀티 프로세서 환경에서 각각 19.4%와 10.2%의 IPC 향상을 가져왔다.

• 한국정보처리학회:학술대회논문집
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• 한국정보처리학회 2001년도 추계학술발표논문집 (하)
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• pp.1463-1466
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• 2001

본 논문은 ISDN 통신망에서 멀티미디어 통신 서비스를 제공하기 위해 단말에 사용되는 ISDN 시스템 칩 설계 및 단말 구현에 관한 것이다. 저가의 통신 단말을 구현하기 위하여 32 비트 RISC 프로세서인 ARM7 프로세서 코어를 중심으로 ISDNS S/T 인터페이스를 통한 통신망 접속 기능, 톤 발생 및 음성 코덱 기능, TDM 버스 정합 기능, PC 정합 기능을 가지는 ISDN 시스템 칩을 설계 및 개발하였고, 이 칩을 시험하기 위한 시험 프로그램 및 통신 단말 소프트웨어를 개발하였으며, 응용단말을 구현하여 자체 기능 시험 및 실제 망 접속 시험을 통하여 기능을 검증하였다.

• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2002년도 춘계종합학술대회
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• pp.96-99
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• 2002

본 논문에서는 ISDN 망에서 멀티미디어 통신 단말용으로 구현된 시스템-온-칩에 관해 기술하고 칩에 내장되는 통신단말의 소프트웨어 구조와 서비스 절차에 대해 살펴보며, 구현된 단말용 시스템-온-칩과 소프트웨어를 활용하여 구성되는 통신단말의 구조에 관해 검토한다.

• 한국멀티미디어학회:학술대회논문집
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• 한국멀티미디어학회 2012년도 춘계학술발표대회논문집
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• pp.323-324
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• 2012

본 논문에서는 효과적인 시스템 온 칩을 구성하는 방법을 제안하였다. 제안한 방법은 이전의 방법에 비해 좀 더 콤팩트하고 효과적이었으며, 높은 수행시뮬레이션을 요구하며 하드웨어/소프트웨어 통합설계 툴을 사용하여 규격화된 적절함을 요구하였다. 시스템 인터페이스처럼 이미 존재하고 있는 부품의 재사용은 지원하지만, 작업 이후에는 단지 하드웨어/소프트웨어 통합설계 툴의 프로그램에 의해 수행되어지는 특성이 있다.

• 조명전기설비학회논문지
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• 제23권12호
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• pp.23-30
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• 2009

LED조명장치는 자동차분야, 항공, 디스플레이, 전송장치 그리고 특수조명등의 응용장치로의 활용이 증가하고 있다. 일반적으로 고출력 RGB 멀티칩 LED는 표시용이나 경관조명용 또는 감성조명용으로 적용되고 백색 LED는 표시용 조명에서 최근 들어 일반조명용으로 적용되고 있으며, 고출력 백색 LED의 출시와 광효율의 증가는 이를 더욱 가속화하고 있다. 본 논문에서는 백색 LED와 RGB 멀티칩 LED 조명장치를 동일한 사양으로 제작하여 물리적, 전기적, 광학적 조명특성을 분석하여 향후 LED조명시스템의 제작에 정량적 데이터를 제공하고자 한다. 이를 위해 LED의 주요한 물리적 특성인 방열특성에 대한 성능분석, 전기적 특성의 분석을 위한 전력 및 드라이브 효율에 대한 성능분석을 수행하였고 조명특성을 위한 연색성, 배광특성, 광효율을 측정하였다. 백색 LED와 RGB 멀티칩 LED 조명장치를 활용한 응용장치의 적용방법을 확립하고 나아가 다양한 조명시스템에 LED 조명장치를 적용하는데 참고가 되는 기초 데이터를 제시하고자 한다.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2008년도 한국컴퓨터종합학술대회논문집 Vol.35 No.1 (B)
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• pp.405-410
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• 2008

성능 / 에너지를 강조하는 현재의 멀티코어 추세에서 임베디드 시스템에 사용되는 대부분의 프로세서들은 단일 프로세서와 메모리를 버스 형태로 연결하여 구현하였다. 하지만 칩 내부의 프로세서 코어 수가 증가 하게 되면, 기존 버스 형태의 구조는 제한된 대역폭으로 인하여 확장성이 제약된다. 본 논문에서는 멀티코어 프로세서에서 사용 가능한 기존 연결 망 구조들을 분석하고, 기존 계층적 링 구조에서의 지연 시간 문제를 극복하여 성능을 개선할 수 있는 새로운 이중 광역 계층 링 구조를 제안한다.

• 한국멀티미디어학회논문지
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• 제14권2호
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• pp.194-200
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• 2011

RFID(Radio Frequency IDentification) 산업의 시장 동향은 가격 문제로 인하여 정체성을 보이고 있다. 근래에는 칩 가격의 하락으로 인해 칩을 제외한 태그 인레이 가격이 상대적으로 높아지고 있는 실정이며 태그 저 가격화를 실현하기 위해서는 빠르고 간단하면서도 저비용의 RFID 태그 설계 기술이 필수적이다. 따라서 본 논문에서는 안테나 설계를 위한 기반기술 중 하나인 칩 임피던스를 고려하여 태그를 설계하여 보다 정확하고 빠른 설계가 가능한 시스템 개발을 제안하였다. 제안한 시스템의 성능평가 결과 기존 시스템보다 20Mhz 내에서 공진 범위오차가 줄어들었으며, 판독 오류도 1.5m 이내로 줄어드는 성능개선 효과가 있었다.

• 대한전자공학회논문지TC
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• 제37권1호
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• pp.76-87
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• 2000

멀티캐리어 DS-CDMA는 다중경로 페이딩 채널에서 광대역 시스템의 구현에 효과적인 방법이다. 본 논문에서는 콘볼류션 코딩을 적용한 중복된 멀티캐리어 DS-CDMA 시스템을 제안하고, 기존의 멀티캐리어 시스템과 비교하여 성능의 우수성을 입증한다. 제안된 멀티캐리어 DS-CDMA 시스템을 분할된 각 서브밴드를 가용주파수 대역 내에서 보다 효율적으로 구성하기 위하여 50% 중복 (overlapping) 된 구조를 갖도록 한다. 그리고 전송률이 1/M인 콘볼루션 채널코딩과 반복율이 1/R인 반복코딩을 적용하여 채널 코딩에 의한 이득과 주파수 다이버시티 (frequency diversity) 효과를 동시에 획득하고, 또한 MUI(Multiple User Interference)를 효과적으로 감소시키기 위하여 각 서브밴드의 확산신호에 raised-cosine 칩 성형필터를 적용하였다. 사용된 칩 성형필터의 rolloff 인자 (0< ${\beta}{\le}1$)의 변화에 따른 MUI를 분석하여 기존의 멀티캐리어 시스템의 성능보다 우수함을 보인다.

• 한국정보과학회논문지:시스템및이론
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• 제35권11호
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• pp.527-539
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• 2008

본 논문은 큐잉 이론을 이용한 멀티 프로세서 시스템-온-칩(MPSoC)의 버스 매트릭스 기반 통신 구조에 대한 성능 예측 기법을 제안한다. 버스 매트릭스 기반 통신 구조는 다양한 설계 인자를 가지고 있어 이에 대한 성능 최적화는 방대한 설계 공간의 탐색을 필요로 하지만, 현재 널리 사용되고 있는 시뮬레이션에 기반한 방법은 많은 시간을 요하기 때문에 점점 짧아지고 있는 시장 적기 출하(time-to-market) 제약 조건을 만족하기 어렵다. 이러한 문제를 해결하기 위하여 본 논문에서는 시뮬레이션보다 훨씬 빠르면서 정확하게 성능을 예측할 수 있는 기법을 개발하였다. 제안한 성능 분석 기법은 고성능의 버스 매트릭스를 위해 사용되는 버스 프로토콜인 multiple outstanding transaction을 고려한다. 또한 지수 분포(exponential distribution)를 이용하여 비현실적으로 메모리 시스템을 모델하였던 기존의 연구들과 달리 실제적인 메모리 시스템 모델을 위하여 일반 분포(general distribution)를 이용하였다. 제안한 성능 예측 기법의 정확도 및 효율성을 검증하기 위하여 무작위로 생성된 버스 트랜잭션들과 4-채널 DVR 예제에 적용하였을 때, 사이클 단위의 정확도를 갖는 시뮬레이션과 비교하여 $10^5$배 이상 빠르면서 평균 94% 이상의 정확도를 갖는 것으로 분석되었다.

• 전자통신동향분석
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• 제18권6호통권84호
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• pp.19-26
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• 2003

다양한 이동통신기기들을 한 시스템에 수렴시킬 수 있는 기술로서 SDR 기술이 각광받고 있다. 본 논문은 W-CDMA 물리계층 업링크의 트래픽 채널을 DSP로 구현하여 베이스밴드 프로세싱 하는 것을 목적으로 한다. 이러한 소프트웨어 모뎀은 초기화, 소스 데이터 발생, 스프레딩, 스크램블링, 출력단 등으로 이루어진다. 기존의 FPGA, ASIC 등으로 구현된 하드웨어 모뎀을 소프트웨어적인 DSP로 구현할 때 생기는 주요 문제들을 고찰하였다. 로드 밸런싱, 동시성과 실시간성, 버퍼 스킴, 멀티 태스킹, 인터럽트 관리, OVSF 및 스크램블링 코드의 복소수 연산 등이다. 전통적인 구조는 FPGA와 DSP 혼합체인데 각각 칩레벨 프로세싱, 심볼 프로세싱을 담당한다. FPGA와 DSP 혼합체 구조를 넘어서 멀티 DSP를 이용한 병렬처리기법, 또는 reconfiguable 칩을 개발해서 칩레벨 및 심볼 프로세싱을 한 번에 할 수 있는 개발제품도 출시되었다.