질산산화법(nitric acid oxidation method)은 저온에서 안정적인 산화막을 형성하는 직접산화공정으로 azeotropic point(68 wt%)인 120도 이하의 온도에서 산화막을 형성한다. 120도에서 형성한 질산산화막은 CVD법으로 형성한 산화막 보다 낮은 누설전류밀도(leakage current density)를 나타낸다. 또한 질산의 농도가 증가함에 따라 형성한 산화막의 누설전류밀도가 감소하며, 이는 열산화법으로 형성한 산화막 보다 낮다. 질산산화의 낮은 누설전류밀도는 형성한 산화막의 높은 원자 밀도와 낮은 계면준위밀도에 의한 것으로 이 특성을 이용하여 게이트 절연막(gate insulator)과 태양전지의 passivation막으로 응용되고 있다.
Ba0.5Sr0.5TiO3박막을 RF 마그네트론 스퍼터링법을 이용하여 Pt/Ti/SiO2/Si(100) 기판에 증착하였다 .누설전류에 영향을 주는 것으로 알려진 열처리 조건, dopant 효과 등을 평가하고자 이온반경이Ti와 유사하고 대부분이 Ti 자리를 치환하는 것으로 알려진 Nb와 Al을 각각 danor와 acceptor로 선택하여 BST 박막에 첨가한 후 누설전류를 측정하였다. 고온에서 in-situ 증착된 BST 박막은 거친 표면 형상을 보이며 낮은 전압에서 파괴가 발생하고, Nb 첨가로 누설전류가 증가하였다. 삼온 증착후 후열처리된 박막은 표면 형상도 평할도가 증가하였으며 in-situ로 제조된 박막에 비해 높은 파괴전압과 낮은 누설전류를 나타내었다. 특히 Al이 첨가된 BST 박막의 누설전류밀도는 ~10A/cm2로 도핑을 하지 않은 박막이나 Nb가 첨가된 박막에 비해 매우 낮은 누설전류밀도를 나타내었으며, 이는 산화로 인한 산소공공의 감소, 이동 가능한 hole의 감소와 후열처리과정중 계면 및 입계의 산화로 Schottky 장벽에 높아진 결과로 판단된다.
고유전 (Ba, Sr)TiO₃ (BST) 박막을 이용한 DRAM storage capacitor의 저전계 영역에서의 전하손실을 발생시키는 커패시터의 누설전류는 유전완화전류와 진성 누설전류로 이루진다고 알려져 있다. 특히, 기가급 DRAM의 동작 전압(~IV)에서 유전완화전류가 진성 누설전류에 비해 훨씬 크기 때문에 이에 대한 심도 있는 연구가 필요하다. 본 연구에서는 thermally stimulated current (TSC) 측정법을 BST 박막에 처음으로 적용하여 트랩의 에너지 level 및 공정변화에 따른 트랩 밀도의 상대적 평가를 하였다. 그리고, 기존에 사용되던 전류-전압(I-V) 측정이나 전류-시간(I-t) 측정과 비교 및 분석함으로써 유전완화 전류의 원인을 규명하고 TSC 측정법의 신뢰성을 살펴보았다. 먼저 안정적인 TSC 측정을 위해 전계, 시간, 온도 및 승온속도에 따른 polarization condition을 알아보았다 이 조건을 이용한 TSC 측정으로부터 BST 박막에서의 트랩의 energy level이 0.20(±0.01) eV와 0.45(±0.02) eV임을 알 수 있었다. Rapid thermal annealing (RTA)을 이용한 후속 열처리에 따른 TSC 측정을 통하여 이 트랩들이 산소결핍(oxygen vacancy)에 기인함을 확인할 수 있었다. MIM BST 커패시터의 열처리에 대한 TSC 특성은 전류-전압(I-V) 및 전류-시간(I-t) 특성과 같은 경향성을 보인다. 이것은 TSC 측정이 BST 박막내의 트랩을 평가하는데 있어서 매우 효과적인 방법이라는 것을 보여준다.
매년 증가하고 있는 누전사고에 대한 대책수립을 위해 누전검출장치 및 누전조사작업을 시행하고 있지만, 대부분 전압변화 및 영상전류 및 z임피던스에 의한 계측이 주를 이루고 있다. 본 논문에서는 누전지역에서의 누설전류에 자속밀도 분포를 조사함으로 손쉬운 누전검출장비 개발 및 비접촉에 의한 누전검출장비 개발과 누전환경에서의 기초 연구자료를 제공하고자 정상선로에서의 자속밀도 분포 및 전압변화에 따른 자속밀도 분포를 조사하였다. 그 결과 정상도선에서는 거리변화에 따른 자속밀도가 감소하였으며, 이에 반해 침수된 누전지역에서는 자속밀도변화가 거의 없음을 확인할 수 있었으며, 전압 증가에 따라 누전지역의 전류값이 정상상태보다 더 크게 변화하는 것을 확인할 수 있었다.
본 연구에서는 RF sputtering법을 이용하여 Si기판 위에 SBN 박막을 증착시켜서, 온도 범위 600~800[$^{\circ}C$]에서 열처리를 하였는데, 650[$^{\circ}C$]에서 열처리된 박막의 경우 표면거칠기는 약 0.42[nm]로 나타났으며, 누설전류밀도는 전압 범위 -5~+5[V]에서 10-5[$A/cm^2$] 이하로 안정된 값을 나타내었다.
최근 반도체 회로의 미세화로 인해 디자인 공정이 20 nm 이하로 내려갔다. 그 결과 회로간의 간격이 줄었으며 많은 문제가 발생 한다. 첫 번째 문제는 미세하게 여러 박막 층들을 쌓기 때문에 박막 층이 그전 50 nm 공정에 비해선 쉽게 무너질 수 있다. 따라서 하나의 박막 층은 다른 여러 박막들의 하중을 잘 견뎌야 할 것이다. 결과적으로 회로의 미세화에 따라 박막의 기계적 특성이 좋아야 될 것이다. 또 다른 문제는 너무 좁은 회로의 간격으로 인해 다른 회로에 영향을 미치는 크로스토크라는 전기적 문제이다. 크로스토크가 크다는 것은 회로간의 누설 전류가 크다는 것을 의미하며 그만큼 신호 전달 능력이 감소 한다는 것을 뜻한다. 크로스토크의 문제점을 해결하기 위해 회로 사이에 절연 막을 만들어 누설전류를 막아야 한다. 이러한 문제를 바탕으로 본 연구는 Zirconium nitride (ZrN) 박막이 이러한 문제점을 해결 할 수 있는 지연구해 보았다. 박막 제작 시 변화 요인은 질소유량 과 열처리 온도 이며 질소유량 변화는 2 sccm 과 8 sccm 두 경우로 하였다. 또한 열처리는 As-deposited state, $600^{\circ}C$ 와 $800^{\circ}C$로 열처리 하였다. 박막 증착은 RF magnetron sputtering을 이용하였으며 열처리는 질소 분위기에서 furnace를 이용하였다. 기계적 특성분석 결과 질소유량이 2 sccm 인 박막의 hardness는 as-deposited stste에서 18.8 GPa이고 $600^{\circ}C$에선 18.4 GPa로 거의 비슷하고 $800^{\circ}C$ 열처리한 경우는 15.4 GPa 으로 hardness가 감소하는 것을 알 수 있었다. 질소 유량을 8 sccm 흘려주며 증착한 박막의 경우는 as-deposited state, $600^{\circ}C$, $800^{\circ}C$에서의 hardness가 각각 17.5, 16.4, 21.1 GPa 으로 감소하다가 증가하는 경향을 보였다. 또한 zrN 박막의 전기적 특성인 누설 전류 밀도도 측정하였다. 결과적으로 본 연구는 ZrN 박막의 질소 유량 변화와 열처리에 따른 기계적, 전기적 특성변화를 확인 하였다.
집적회로의 밀도가 높이기 위해 단일 소자의 크기를 줄이는 과정에서 발생하는 소자의 성능 저하를 줄이기 위해 새로운 구조 및 구성 물질을 변경하는 연구가 활발하게 진행되고 있다. 기존의 평면 구조를 변형한 3차원 구조의 n-channel FinFet는 소자의 구성 물질을 바꾸지 않고도 쇼트 채널효과와 누설전류를 줄일 수 있다. 다양한 구조의 유전 물질을 응용한 n-channel FinFEET은 기존의 n-channel FinFET보다 소자의 크기를 줄일 수 있는 가능성을 제시하고 있다. FinFETs에 관한 많은 연구가 진행되어 왔지만, 유전체 물질을 이용한 n-channel FinFETs의 구조에 대한 연구는 매우 적다. 본 연구는 FinFET의fin channel 영역에 유전 물질을 삽입하여 그 영향을 분석한 연구이다. FinFET의 fin channel 영역에 유전 물질을 삽입하여 평면 구조의 MOSFET에서 fully depletion SOI 구조와 같은 동작을 하도록 만들었다. 유전 물질을 삽입한 FinFET 소자의 전기적 특성을 3차원 TCAD 시뮬레이션을 툴을 이용하여 계산하였다. 유전 물질을 삽입한 n-channel FinFET에서 전자 밀도와 측면 전계의 영향이 기존의 FinFET보다 좋은 특성을 확인하였다. 또한 유전물질을 삽입한 FinFETs은 subthershold swing, 누설전류, 소비전력을 줄여 주었다. 이러한 결과는 n-Channel FinFETs의 성능을 향상시키는데 많은 도움이 될 것이다.
사이리스터 소자의 신뢰성은 HVDC, SVC, FACTs와 같은 대용량 전력 시스템의 신뢰성에 많은 영향을 미친다. 따라서 사이리스터 소자의 신뢰성을 분석하는 것은 시스템의 안정적인 운용과 신뢰성의 확보에 필수적이다. 본 논문에서는 장시간동안 전압 및 열을 인가하여 사이리스터를 가속열화 시켰을 때 사이리스터 소자의 차단전압 및 누설전류 특성의 변화에 대해 실험을 통해 분석하였다. 가속열화 시험에는 14개의 사이리스터가 사용되었고, 1000V, $100^{\circ}C$의 조건에서 가속열화를 진행하였으며, 7일에서 10일의 간격으로 소자의 누설전류 및 차단전압 특성을 측정하여 초기 특성과 비교 분석하였다.
폴리머/세라믹 복합체는 내장형 캐패시터(embedded capacitor)의 유전 재료로 많은 관심을 불러 일으키고 있다. 본 연구는 BaTiO$_3$분말의 크기와 함량이 에폭시/BaTiO$_3$복합체 캐패시터의 유전 상수와 누설전류에 미치는 영향에 대해 살펴보고 이에 대해 고찰하고자 하였다. BaTiO$_3$분말이 67vo1% 함유된 Epoxy/BaTiO$_3$composite 필름의 유전상수는 전반적으로 사용한 BaTiO$_3$분말의 크기가 커짐에 따라 증가하였다. 이것은 입자의 크기가 증가함에 따른 입자의 유전상수의 증가 때문이며 XRD 분석을 통해 입자의 크기가 증가함에 따라 tetragonality가 증가함을 확인하였다. 복합체 필름의 누설전류도 또한 사용한 입자의 크기가 커짐에 따라 증가하였으며 이는 분말의 크기가 증가함에 따라 단위길이 당 입자의 수가 감소하는 것으로, 단위 길이 당 입자의 수가 감소하여 전류의 흐름을 방해하는 입자/폴리머/입자 계면의 수가 감소하기 때문이다. 분말의 함량에 따른 유전상수는 unimodal과 bimodal의 경우 각각 73vo1%와 80vo1%에서 최대 값을 나타냈으며 그 이상에서는 감소하는 것이 관찰되었는데 이는 과량의 분말이 조밀 충전을 깨고 필름의 밀도를 낮추기 때문이었다. 누설전류의 경우 unimodal과 bimodal 각각에 대해 73vo1%와 80vo1%에서 급격한 증가를 관찰 할 수 있었으며 이는 percolation 현상의 발생에 의해 입자와 입자간에 접촉이 이루어져 BaTiO$_3$분말을 따라 전류가 잘 흐를 수 있는 conduction path가 형성 되기 때문이다.
본 논문에서는 선간단락 시 단락전류에 의한 전력용 변압기의 단락특성을 해석하였다. 변압기 사양은 1[MVA], 6,600/660[V] 단상 내철형 배전용 변압기를 사용하였으며, 변압기에 유입되는 단락전류를 회로방정식을 이용해 계산하였다. 단락전류에 의해 발생되는 누설자속 밀도는 유한요소법을 이용해 계산하였고, 계산된 단락전류와 누설자속 밀도에 의해 권선에서 발생하는 축 방향과 반경방향 단락전자력을 계산하였다.
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[게시일 2004년 10월 1일]
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