• Title/Summary/Keyword: 논리아키텍쳐

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A Study on Revising the National ITS Architecture (국가 ITS 아키텍쳐 정비방안에 관한 연구)

  • Lee, Sibok
    • KSCE Journal of Civil and Environmental Engineering Research
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    • v.29 no.2D
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    • pp.175-181
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    • 2009
  • Korean government has developed the 1st version of the National ITS Architecture in 1999 and utilized it as the framework for ITS planning, design, and standardization. The National Architecture now needs to be revised to accommodate environmental changes in ITS market and advancement of ITS core technologies. This study evaluates the current version of the architecture and suggests the directions for revision for a new national ITS architecture. The two most popular methodologies for architecture development-the process-oriented approach and the object-oriented approach-were reviewed, and the process-oriented approach was selected for new architecture development. The concept of the national architecture was then newly defined based on evaluation of the existing architecture. The new National ITS Architecture is suggested to be composed of ITS user services, logical architecture, physical architecture, and project architecture. This study must be followed by actual architecture development efforts and supporting policy actions for successful deployment of the new National ITS Architecture.

A Study of Architecture for national Intelligent Transportation Systems (Methodology and Model) (국가 지능형 교통체계를 위한 아키텍쳐 연구 (모형 및 방법론))

  • 백인섭;이승환;이시복
    • Journal of Korean Society of Transportation
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    • v.19 no.6
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    • pp.19-31
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    • 2001
  • In this paper, 3 layered architecture model and related design guidelines are proposed, which have been actually applied in our national ITS-Architecture design. The domain architecture as the 1st layer is to structure all ITS related domains for maximizing the co-operability in national level. The logical architecture as the 2nd layer is to structure all ITS related application-systems for minimizing duplications, conflicts and dead-zones in service level and maximizing the co-operability in application-system level. The physical architecture as the 3rd layer is to structure all IT(Information Technology) related physical resources for maximizing.

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A Method for mapping an ADL Model to a target Java implementation model (ADL 모델을 Java 구현 모델로 매핑하는 방법)

  • 김수일;전태웅
    • Proceedings of the Korean Information Science Society Conference
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    • 2002.10d
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    • pp.22-24
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    • 2002
  • 아키텍쳐 기술 언어(ADL : Architecture Description Language)는 상위 추상화 수준에서의 소프트웨어 시스템의 구조와 행위를 기술하는데 필요한 아키텍쳐 모델 요소들에 대한 직접적인 표현 수단을 제공한다. ADL온 특히 명세 수준의 논리적인 아키텍처를 모델링, 분석하는데 유용하다. 그렇지만 ADL로 기술된 상위 수준의 아키텍쳐 명세가 하위 수준의 구현 시스템으로 어떻게 상세화 되는지 알기가 쉽지 않다. 즉, 상위 수준의 아키텍쳐 명세와 하위 수준의 아키텍쳐 구현 사이에 의미적 차이가 존재한다. 본 논문은 이러한 의미적 차이를 효율적으로 줄일 수 있는 방법을 찾기 위한 일차적인 연구 결과로서, C2 스타일 기반의 ADL로 기술된 아키텍쳐 모델을 Java 구현 코드로 자동 변환하는 방법을 제안한다.

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Design of Arithmetic Architecture Considering Leakage Power Minimization (누설 전력 최소화를 고려한 연산 아키텍쳐 설계)

  • 원대건;김태환
    • Proceedings of the Korean Information Science Society Conference
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    • 2004.10a
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    • pp.535-537
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    • 2004
  • 최근의 멀티미디어 시스템 설계 (예: 휴대폰, PDA) 경향에서 전력 소모를 줄이는 연구가 매우 긴요한 상황에, 본 연구는 누설 전류(leakage power)를 줄이는 연산 회로 아키텍쳐 합성 기법을 제안한다. 누설 전류를 줄이기 위한 방법으로 본 연구는 Dual threshold Voltage (Dual-V$_{T}$) 기법을 적용한다. 기존의 연구에서는 회로 설계 단계 중 논리나 트랜지스터 수준에서DUal-V$_{T}$를 적용한 방법과는 달리, 보다 상위 단계인 회로의 아키텍쳐 합성 단계에서의 지연시간 제약 조건을 만족하는 범위에서 최소의 누설전류 소모를 위한 합성 기법을 제안한다 따라서, 지연 시간과 누설전류 간의 Trade-Off를 이용하여 설계 조건에 맞는 융통성 있는 설계 결과를 얻을 수 있는 장점을 제공한다. 본 연구는 케리-세이브 가산기 (Carry-Save Adder) 모듈의 생성 과정에 국한된 합성 알고리즘의 적용을 보이고 있지만, 일반적인 연산 모듈을 사용한 아키텍쳐 설계 과정에서도 본 알고리즘을 쉽게 변형, 적용할 수 있다.

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A Conceptual Model for Location Based Public Transit Transfer Information Service (사용자 위치기반 환승정보서비스 개념모델)

  • Lim, Jung-Sil;Moon, Young-Jun;Oh, Young-Tae;Lee, Choul-Ki;Bae, Myoung-Hwan
    • The Journal of The Korea Institute of Intelligent Transport Systems
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    • v.7 no.4
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    • pp.1-12
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    • 2008
  • The issues of developing the value added services for public transport connectivity and transfer with information and communication technologies has been discussed in terms of incorporating system facilities with public transit modes to increase the ridership of public transit. This paper demonstrates a conceptual model for providing the location based public transit transfer information service on demand with respect to system requirements, subsystems, and logical architecture based on the national ITS architecture. The subsystems in this study which include transfer information center, parking concierge, user route guidance and information provision system are also investigated in detail in order for information service and/or contents provider to develop business models on public transit connectivity and transfer. This model is expected to be utilized in providing the variety of service models with the different types of public transit connectivity and transfer systems according to the system scale and the public transit modes.

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Design of a supporting Tool for modeling and developing EJB Components (EJB 컴포넌트의 모델링 및 생성 지원 도구의 설계)

  • 김민정;조진희;이우진;신규상
    • Proceedings of the Korean Information Science Society Conference
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    • 2000.10a
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    • pp.388-390
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    • 2000
  • 컴포넌트 소프트웨어 기술은 재사용성, 적시성, 유지 보수성 등이 업체의 경쟁력으로 대두되고 있는 정보기술 업계에서 점차 각광을 받고 있다. 현재 다양한 컴포넌트 생성 지원 도구들이 제공되고 있지만 컴포넌트의 식별, 모델링, 코드 생성, 배치 등 전 개발 단계를 밀접히 연계하여 지원하는 도구가 드물다. 이 논문에서는 컴포넌트 생성에 연관된 모든 과정을 지원하는 컴포넌트 모델링 및 생성 지원도구의 설계를 제안한다. 컴포넌트 모델링은 영역 특성을 고려한 시스템 분할 관점에서 컴포넌트 플랫폼 아키텍쳐에 관계없이 논리적(logical) 컴포넌트의 식별 및 모델링을 지원한다. 코트 생성 부분은 플랫폼 아키텍쳐에 의존적이어야 하므로 이 논문에서는 우선적으로 EJB 컴포넌트의 코드 생성을 지원한다.

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Design of a DSSS MODEM Architecture for Wireless LAN (무선 LAN용 직접대역확산 방식 모뎀 아키텍쳐 설계)

  • Chang, Hyun-Man;Ryu, Su-Rim;Sunwoo, Myung-Hoon
    • Journal of the Korean Institute of Telematics and Electronics C
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    • v.36C no.6
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    • pp.18-26
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    • 1999
  • This paper presents the architecture and design of a DSSS MODEM ASIC chip for wireless local area networks (WLAN). The implemented MODEM chip supports the DSSS physical layer specifications of the IEEE 802.11. The chip consits of a transmitter and a receiver which contain a CRC encoder/decoder, a differential encoder/decoder, a frequency offset compensator and a timing recovery circuit. The chip supports various data rates, i.e., 4,2 and 1Mbps and provides both DBPSK and DQPSK for data modulation. We have performed logic synthesis using the $SAMSUNG^{TM}$ $0.6{\mu}m$ gate array library and the implemented chip consists of 53,355 gates. The MODEM chip operates at 44MHz, the package type is 100-pin QFP and the power consumption is 1.2watt at 44MHz. The implemented MODEM architecture shows lower BER compared with the Harris HSP3824.

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Blog 기반의 Yard-Sale의 구현에 관한 연구

  • 김창수;한영춘;서영석
    • Proceedings of the Korea Association of Information Systems Conference
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    • 2005.12a
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    • pp.398-406
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    • 2005
  • 현재 인터넷상의 개인미디어로 각광 받고있는 블로그는 개인의 일상적인 정보라는 기본적 기능에서 사용자에게 빠른 속도로 사용이 전파되기 시작하여 그 영역을 확대해 기업 마케팅 채널의 일환으로 시장에 급격하게 수용되고 있다. 본 연구에서는 문헌연구를 통하여 블로그의 개념을 이론적으로 파악한 후 어떤 기술적인 특징을 가지고 마케팅 분야에 활용되는지를 고찰하였다. 이어서 블로그 본연의 개인적인 공간이라는 영역을 최대한 부각시키면서 블로그 상에서 전자상거래를 구현할 수 있는 논리적인 방안을 제시한 다음, 블로그 기반의 Yard-Sale시스템의 데이터베이스와 구성물(Class)의 설계, 이에 기반한 아키텍쳐의 실제적인 구현과 운영을 수행하였다.

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SIA-LVC : Scalable Interworking Architecture for Military L-V-C Training Systems Based on Data Centric Middleware (SIA-LVC: 데이터 중심 미들웨어 기반 확장성 있는 국방 L-V-C 훈련체계 연동 아키텍쳐)

  • Kim, Won-Tae;Park, Seung-Min
    • KIPS Transactions on Computer and Communication Systems
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    • v.5 no.11
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    • pp.393-402
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    • 2016
  • A Military L-V-C system consists of distributed complex systems integrating Live systems working on physical wall-clock time, Virtual systems ruled by virtually pseudo realtime events on a computer, and Constructive systems only depending on the causal relationship between the continuous events. Recently many needs for L-V-C training systems are increasing in order to achieve the maximum training effects with low costs. While theoretical/logical researches or only partially interworking technologies have been proposed, there are few perfect interworking architectures for totally interoperating L-V-C systems in world-wide. In this paper, we design and develop a novel interworking architecture based on data centric middleware for the consistent global time with the same states on the entire L-V-C data and events by means of integrating the heterogeneous distributed middleware standards of each L-V-C system. In addition, simulated L-V-C systems based on real systems will be used for the efficiency and performance of the developed interworking architecture.