• Title/Summary/Keyword: 구조적 파라미터

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A Design of Parameterized Viterbi Decoder using Hardware Sharing (하드웨어 공유를 이용한 파라미터화된 비터비 복호기 설계)

  • Park, Sang-Deok;Jeon, Heung-Woo;Shin, Kyung-Wook
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • 2008.05a
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    • pp.93-96
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    • 2008
  • This paper describes an efficient design of a multi-standard Viterbi decoder that supports multiple constraint lengths and code rates. The Viterbi decode. is parameterized for the code rates 1/2, 1/3 and constraint lengths 7, 9, thus it has four operation modes. In order to achieve low hardware complexity and low power, an efficient architecture based on hardware sharing techniques is devised. Also, the optimization of ACCS (Accumulate-Subtract) circuit for the one-point trace-back algorithm reduces its area by about 35% compared to the full parallel ACCS circuit. The parameterized Viterbi decoder core has 79,818 gates and 25,600 bits memory, and the estimated throughput is about 105 Mbps at 70 MHz clock frequency.

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A Design of Parameterized Viterbi Decoder for Multi-standard Applications (다중 표준용 파라미터화된 비터비 복호기 IP 설계)

  • Park, Sang-Deok;Jeon, Heung-Woo;Shin, Kyung-Wook
    • Journal of the Korea Institute of Information and Communication Engineering
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    • v.12 no.6
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    • pp.1056-1063
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    • 2008
  • This paper describes an efficient design of a multi-standard Viterbi decoder that supports multiple constraint lengths and code rates. The Viterbi decoder is parameterized for the code rates 1/2, 1/3 and constraint lengths 7,9, thus it has four operation nodes. In order to achieve low hardware complexity and low power, an efficient architecture based on hardware sharing techniques is devised. Also, the optimization of ACCS (Accumulate-Subtract) circuit for the one-point trace-back algorithm reduces its area by about 35% compared to the full parallel ACCS circuit. The parameterized Viterbi decoder core has 79,818 gates and 25,600 bits memory, and the estimated throughput is about 105 Mbps at 70 MHz clock frequency. Also, the simulation results for BER (Bit Error Rate) performance show that the Viterbi decoder has BER of $10^{-4}$ at $E_b/N_o$ of 3.6 dB when it operates with code rate 1/3 and constraints 7.

A Study on the Removal of Unusual Feature Vectors in Speech Recognition (음성인식에서 특이 특징벡터의 제거에 대한 연구)

  • Lee, Chang-Young
    • The Journal of the Korea institute of electronic communication sciences
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    • v.8 no.4
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    • pp.561-567
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    • 2013
  • Some of the feature vectors for speech recognition are rare and unusual. These patterns lead to overfitting for the parameters of the speech recognition system and, as a result, cause structural risks in the system that hinder the good performance in recognition. In this paper, as a method of removing these unusual patterns, we try to exclude vectors whose norms are larger than a specified cutoff value and then train the speech recognition system. The objective of this study is to exclude as many unusual feature vectors under the condition of no significant degradation in the speech recognition error rate. For this purpose, we introduce a cutoff parameter and investigate the resultant effect on the speaker-independent speech recognition of isolated words by using FVQ(Fuzzy Vector Quantization)/HMM(Hidden Markov Model). Experimental results showed that roughly 3%~6% of the feature vectors might be considered as unusual, and therefore be excluded without deteriorating the speech recognition accuracy.

Hardware Design of High Performance CAVLC Encoder (H.264/AVC를 위한 고성능 CAVLC 부호화기 하드웨어 설계)

  • Lee, Yang-Bok;Ryoo, Kwang-Ki
    • Journal of the Institute of Electronics Engineers of Korea SD
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    • v.49 no.3
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    • pp.21-29
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    • 2012
  • This paper presents optimized searching technique to improve the performance of H.264/AVC. By using the proposed forward and backward searching algorithm, redundant cycles of latency for data reordering can be removed. Furthermore, in order to reduce the total number of execution cycles of CAVLC encoder, early termination mode and two stage pipelined architecture are proposed. The experimental result shows that the proposed architecture needs only 36.0 cycles on average for each $16{\times}16$ macroblock encoding. The proposed architecture improves the performance by 57.8% than that of previous designs. The proposed CAVLC encoder was implemented using Verilog HDL and synthesized with Magnachip $0.18{\mu}m$ standard cell library. The synthesis result shows that the gate count is about 17K with 125Mhz clock frequency.

A Study on the Prediction of the Nonlinear Chaotic Time Series Using Genetic Algorithm based Fuzzy Neural Network (유전 알고리즘을 이용한 퍼지신경망의 시계열 예측에 관한 연구)

  • Park, In-Kyu
    • The Journal of the Institute of Internet, Broadcasting and Communication
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    • v.11 no.4
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    • pp.91-97
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    • 2011
  • In this paper we present an approach to the structure identification based on genetic algorithm and to the parameter identification by hybrid learning method in neuro-fuzzy-genetic hybrid system in order to predicate the Mackey-Glass Chaotic time series. In this scheme the basic idea consists of two steps. One is the construction of a fuzzy rule base for the partitioned input space via genetic algorithm, the other is the corresponding parameters of the fuzzy control rules adapted by the backpropagation algorithm. In an attempt to test the performance the proposed system, three patterns, x(t-3), x(t-6) and x(t-9), was prepared according to time interval. It was through lots of simulation proved that the initial small error of learning owed to the good structural identification via genetic algorithm. The performance was showed in Table 2.

Analysis of Stopband Characteristics for 1D Photonic Band-Gap Structures (1D PBG 구조의 저지대역 특성 분석)

  • 신윤미;이지면;이범선
    • The Journal of Korean Institute of Electromagnetic Engineering and Science
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    • v.13 no.2
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    • pp.136-145
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    • 2002
  • In this paper, we facilitate the analysis of 1D PBG structure using a ABCD matrix formulation after converting field parameters into circuit parameters. Dispersion diagrams for an infinite 1D PBG structure are derived and compared with the frequency responses for a finite structure (N=10). When the proposed method is adopted, the analysis and synthesis of 1D PBG structures become very convenient.

Study of ONU Buffer Size For Ethernet PON Using OPNET Simulation Tool (OPNET 시뮬레이션 도구를 이용한 Ethernet PON의 ONU 버퍼 크기에 대한 연구)

  • 윤상원;장용석;엄종훈;김승호
    • Proceedings of the Korean Information Science Society Conference
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    • 2002.04a
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    • pp.172-174
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    • 2002
  • Ethernet PON(Passive Optical Network)은 최근 들어 활발하게 연구되고 있는 경제적이고 효율적인 가입자망 구조이다. 본 논문에서는 OPNET 시뮬레이션 도구를 사용하여 Ethernet PON 시뮬레이션 모델을 구현하고, 시뮬레이션 한다. OLT(Optical Line Termination)에 연결되는 ONU(Optical Network Unit)의 개수, 트래픽 및 네트워크 파라미터에 대한 ONU의 버퍼 크기(buffer size)를 분석하고, 이 결과로서 실제 네트워크에 적용할 효율적이고 적정한 ONU의 버퍼 크기를 제안한다.

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A study of Appropriate Technologies for Grounding System Planning of Sub-Station (변전소 접지 설계의 적정성에 관한 연구)

  • Chang, Jeong-Ho;Choi, Hyeung-Cheol
    • Proceedings of the KIEE Conference
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    • 2007.07a
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    • pp.13-14
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    • 2007
  • 전기설비에 대한 접지의 근본 목적은 인체에 대한 감전으로부터의 안정성의 확립과 기기 및 설비의 기능 향상을 위하여 사고 시 고장전류를 대지로 안전하게 방전시켜 안전을 확보하는 데 그 목적이 있다. 변전소 접지 설계 시 고려해야 할 중요한 설계 요소로는 토양조건, 대지저항률의 측정과 분석, 구조체 접지방식의 이용, 고장전류 선정 등이 있으며 주요 설계 파라미터에 따라 접지 설계 방법 및 물량이 결정되므로 적정한 기술적, 경제적 여건을 고려한 설계 요소의 선정과 기준 정립에 대한 연구가 필요한 실정이다.

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Asymmetric MOSFET 소자의 특성 평가

  • Choe, Pyeong-Ho;Kim, Sang-Seop;Choe, Byeong-Deok
    • Proceedings of the Korean Vacuum Society Conference
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    • 2013.08a
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    • pp.232.1-232.1
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    • 2013
  • 본 연구에서는 asymmetric과 symmetric 구조의 n채널 MOSFET 소자의 성능 평가에 관한 실험을 진행하였다. 소자의 성능 평가에 있어 아날로그 회로에서의 DC 이득은 중요한 파라미터 중 하나 이다. 따라서 본 연구에서는 gm/ID 측정법을 이용하여 각 소자의 DC 이득 특성을 분석하였다. 게이트 전압에 따른 드레인 전류-드레인 전압 특성 곡선으로부터 early voltage 값을 추출하였다. 이후 최종적으로 수치적 계산을 통해 DC 이득 값을 추출하였다. 실험 결과 asymmetric과 symmetric 소자의 경우 early voltage 값이 각각 -34 V와 -15 V였으며 따라서 DC 이득 특성 또한 asymmetric 소자의 경우가 우수한 것을 확인하였다.

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Development of KBASIN-HSPF system for estimating parameter of watershed based model (유역모형 파라미터 산출을 위한 KBASIN-HSPF 시스템 개발)

  • Park, Dae-Hee;Ha, Sung-Ryong
    • Proceedings of the Korea Water Resources Association Conference
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    • 2006.05a
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    • pp.328-332
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    • 2006
  • 환경모델링 기법은 비선형 오염유출현상을 구조화하여 배출특성 규명 및 정책대안의 영향예측 도구로서 활용도가 증가하고 있다. 반면 복잡한 입력 파라미터의 구성은 모형운영에 있어 비정량적 수치를 적용할 수 있는 가능성을 내포하고 있다. 이러한 한계성을 극복하기 위해 최근 들어 GIS와 정보기술의 연계를 통한 자료관리 및 모형 매개변수 산출을 위한 연구들이 활발히 진행 중에 있다. GIS-모델링 분야의 기술적 성장에도 불구하고 정보구축의 시점, 주기, 구축 형태 등의 통일화가 이루어지지 않았다. 따라서 BASINS과 같은 기 구축된 정보 분석체계를 사용하고자 할 때 단위사업별로 구축된 공간정보의 구조해석을 다시 수행해야 하는 문제를 지니고 있다. 이는 구축된 정보를 사용하여 해석하고자 하는 주체가 분명하지 않고, 분석모델에서 요구하는 입력 자료의 구조를 명확하게 해석할 수 있는 정보기술과 분석기술의 연계부족으로 발생한 문제이다. 이에 본 연구의 목적은 NGIS사업을 통해 축척된 지형공간 데이터베이스와 GIS의 공간분석기능을 연계하여 유역 오염원 기상 공간정보의 관리, 유역 오염유출모형인 HSPF(Hydrologic Simulation Program-Fortran)의 운영정보 생성을 지원하는 지능형 정보관리시스템을 개발하는데 있다. 주 연구내용은 시스템 분석 및 설계, 기초 데이터 수집과 DB 구축, 지형 매개변수 산정을 위한 GIS-HSPF의 통합 인터페이스 구축이다. 개발된 KBASIN-HSPF는 EPA에 의해 개발된 BASIN의 유역분할, 하천망생성, 지형특성계수 산정 기능과 함께 우리나라의 지형.오염원.기상정보의 저장구조를 고려한 데이터 모델링, Tissen망에 준한 강우자료 생성 그리고 HSPF 모형운영정보 산정 및 전환기능을 포함하고 있다. KBASIN-HSPF는 유역기반 점.비점오염원 정보를 통합 관리하고자 하는 오염총량관리제의 기술적 정보관리 환경으로 활용가능하며, 기존의 오염유출모델링을 위해 자료준비부터 정보연계, 모형운영까지 분산된 환경에서 수행되었던 것을 통합환경하에서 진행함으로써 정보의 질적보장과 정보전환의 표준화방안을 제시하는 정보분석시스템이다.

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