본 논문에선 병렬 십진 곱셈기의 축약 단계의 면적과 지연시간을 감소시켜 성능을 향상시키기 위해 다중 피연산자 십진 CSA과 개선된 십진 CLA를 이용한 트리 구조를 제안한다. 제안한 부분곱 축약 트리는 십진수 부분곱에 대해 다중 피연산자 십진 CSA를 사용하여 빠르게 부분곱을 축약한다. 각 CSA에서는 리코딩에 입력의 범위를 제한함으로써 가장 간단한 리코더 로직을 얻는다. 그리고 각 CSA는 특정한 아키텍처 트리의 특정한 위치에서 범위가 제한된 십진수를 더하기 때문에 부분곱 축약 단계의 연산을 효율적으로 수행할 수 있다. 또한, 사용되는 십진 CLA의 로직을 개선하여 BCD 결과를 빠르게 얻을 수 있다. 제안한 십진 부분곱 축약 단계의 성능의 평가를 위해 Design Compiler를 통해 SMIC사의 180nm CMOS 공정 라이브러리를 이용하여 합성하였다. 일반 방법을 이용하는 축약 단계에 비해 제안한 부분곱 축약 단계의 지연시간은 약 15.6% 감소하였고 면적은 약 16.2% 감소하였다. 또한 십진 CLA의 지연시간과 면적이 증가가 있음에도 불구하고 전체 지연시간과 전체 면적이 감소함을 확인하였다.
본 논문에선 병렬 십진 곱셈기의 축약 단계의 면적과 지연시간을 감소시켜 성능을 향상시키기 위해 다중 피연산자 십진 CSA과 개선된 십진 CLA를 이용한 트리 구조를 제안한다. 제안한 부분곱 축약 트리는 십진수 부분곱에 대해 다중 피연산자 십진 CSA를 사용하여 빠르게 부분곱을 축약한다. 각 CSA에서는 리코딩에 입력의 범위를 제한함으로써 가장 간단한 리코더 로직을 얻는다. 그리고 각 CSA는 특정한 아키텍처 트리의 특정한 위치에서 범위가 제한된 십진수를 더하기 때문에 부분곱 축약 단계의 연산을 효율적으로 수행할 수 있다. 또한, 사용되는 십진 CLA의 로직을 개선하여 BCD 결과를 빠르게 얻을 수 있다. 제안한 십진 부분곱 축약 단계의 성능의 평가를 위해 Design Compiler를 통해 SMIC사의 180nm CMOS 공정 라이브러리를 이용하여 합성하였다. 일반 방법을 이용하는 축약 단계에 비해 제안한 부분곱 축약 단계의 지연시간은 약 15.6% 감소하였고 면적은 약 16.2% 감소하였다. 또한 십진 CLA의 지연시간과 면적이 증가가 있음에도 불구하고 전체 지연시간과 전체 면적이 감소함을 확인하였다.
본 논문에서는 디지털 위상고정루프(All-digital PLL)를 구성하는 핵심 블록인 시간-디지털 변환기(Time-to-Digital Converter)를 제안하고 구현하였다. 본 연구에서는 게이티드 링 오실레이터 시간-디지털 변환기(GRO-TDC)의 기본 구조에 버니어 지연단(VDL)을 이용하여 다중 위상을 얻음으로써 보다 높은 해상도를 얻을 수 있는 구조를 제안하였다. 게이티드 링 오실레이터(GRO)는 총 7개의 지연셀을 사용하였고, 버니어 지연단(VDL) 3단을 이용하여 총 21개의 다중 위상을 사용하여 시간-디지털 변환기(TDC)를 설계하였다. 제안한 회로는 $0.13{\mu}m$ 1P-6M CMOS 공정을 사용하여 설계 및 구현하였다. 측정결과, 제안한 시간-디지털 변환기(TDC)의 최대 입력 주파수는 100MHz이고, 해상도는 26ps로 측정되었으며, 출력은 8-비트이며, 검출이 가능한 최대 위상 차이는 5ns의 위상 차이까지 검출이 가능하였다. 전력 소비는 측정된 Enable 신호의 크기에 따라 최소 8.4mW에서 최대 12.7mW로 측정되었다.
2007년 미국에서 시작된 글로벌 금융위기의 영향은 국내의 해운 조선 분야에도 크게 영향을 미쳤다. 이와 관련하여 국내 조선소는 해운경기 악화로 인한 상선 수주물량 감소의 대체수단으로 여러 방면에서 수주전략을 수립하였고, 선택한 분야가 해양플랜트였다. 그러나 국내 조선소는 해양플랜트 관련 계약이 갖고 있는 위험성 분석에 대한 대비 없이 단순한 매출액 확대와 일감확보를 위한 무리한 영업 수주전략을 추진하였다. 이러한 결과, 해양플랜트 발주자와 초기에 계약한 금액보다 많은 비용이 투입되거나 제조물 인도지연에 따른 지체상금을 지급해야 하는 법적인 문제로 확대되었다. 주요 법적분쟁의 원인은 해양플랜트공사 시 발생할 수 있는 비선형모델에 의한 위험성 분석, 공정관리의 미숙, 국내 조선소가 "Engineering Procurement Construction 일괄계약"을 사용하는 해양플랜트공사계약의 이해 부족에 기인한다. 특히, 위험성 관리 항목의 한 요소로써 계약상의 독소조항에 대한 충분한 검토가 이루어지지 않은 점에 있다. 이러한 계약서를 검토할 만한 인력도 부재하다. 따라서 이 연구에서는 계약목적물의 인도지연이 발생할 수 있는 구체적 위험성의 존재를 식별하고, 해양플랜트공사계약 상에는 어떠한 불공정조항이 존재하며, 그러한 불공정조항이 실제 양 당사자에게 어떻게 적용되는지를 국내 조선소의 프로젝트 관리자의 인터뷰와 선행연구를 참조하여 구체적 위험요소가 계약상으로 어떻게 함의되는가에 대해서 살펴보았다. 이를 통하여 해양플랜트공사계약상 제조물인도지연에 관한 계약당사자의 법적 책임관계와 국내 조선 해양플랜트 산업발전에 기여할 수 있는 개선방안을 도출하였다.
원유 또는 가스 생산을 위해 해상에 설치되는 플랜트 해양설비는 크게 jacket과 module로 나눌 수 있다. Jacket은 module을 지지하기 위한 구조물로써 jacket 본체와 pile로 구성되어 있으며, 미국용접학회(AWS)의 규정에 의해 대부분의 맞대기 완전용접 이음부(full penetration butt welds)에 대해 100% 방사선투과검사를 실시하게 되어 있다. 그러나 지금까지 방사선투과검사를 실시해 온 경험으로 미루어 볼 때 방사성에 대한 안전성, 생산공정의 영향(검사지연) 등 방사선투과검사는 많은 문제점을 가지고 있었다. 이에 대한 문제점을 해소하고, 국내의 비파괴검사 기술 향상을 위해 자동 초음파탐상 system을 개발, 방사선투과검사를 자동 초음파탐상검사로 대체하여 적용한 사례를 간략하게 기술하였다. 또한, 적용 확대를 위해 개방중인 system을 소개하고 아울러 자동 초음파탐상기술에 대한 앞으로의 방향을 제시하였다.
본고에서는 시냅스의 생물학적 기능과 이를 모방하는 멤리스터, 멤리스터와 CMOS(Complementary Metal-Oxide-Semiconductor) 트랜지스터의 하이브리드, 그리고 멤리스터 기반의 집적회로 구현에 관한 최신 연구개발 동향을 다루었다. 기억과 스위칭을 동시에 수행할 수 있는 시냅스 모방 멤리스터는 Moore의 법칙에 따른 집적도 한계의 도래시점을 지연시킬 수 있으며, 디지털 컴퓨팅의 한계를 극복하여 학습능력을 가지는 지능형 실시간 병렬처리 시스템을 구현할 수 있는 잠재력을 가지고 있다. 또한 멤리스터는 신경세포의 기능을 재해석하는 계기가 되어 뇌과학 발전에도 크게 기여할 것으로 예상된다. 저전력으로 구동하는 지능형 프로세서의 조기 등장을 위해서는 뇌 과학, 나노소재 및 소자기술, 집적회로 설계 및 공정기술, 뉴로컴퓨팅(neuro-computing) 등 다양한 분야의 융합전략이 요구된다.
열간단조후 절삭가공하여 냉간 성형가공하는 알루미늄 제품은 열간단조하면 재료가 연화되어 있어 절삭가공시 연속적인 칩이 발생하여 공구와 피삭재를 감고 회전함으로서 가공면 손상, 공구파손 및 작업자의 안전을 초래함에 따라 가공이 어려워 단지 절삭성 개선 목적만을 위해 중간공정으로 T4 열처리하여 절삭가공하고 다시 어닐링처리하여 냉간성형을 하고 최종열처리를 한다. 따라서 본 연구는 열간단조후 제품을 급냉시키면 용제화처리의 효과를 얻어 재료가 경화됨으로써 절삭성이 개선될 수 있다는 이론에 근거하여 T4 열처리를 대체할 수 있는 후처리 방법에 대해 연구하였다. 최적의 후처리방법을 구하기 위해 열간단조후 수냉과 공냉처리를 비교 분석하였고, 열간단조후 냉각처리까지 지연된 시간과 수냉과정에서의 유지시간에 따른 분석을 통해 최적의 작업조건을 선정하였다.
차세대 양방향데이터방송 (BIFS: BInary Format for Scenes) 서비스에서는 하향링크(downlink) 데이터 전송률에 상응하는 높은 상향링크(uplink) 데이터 전송률이 요구되고 있다. 이에 무선 전송 채널의 한정된 자원 환경 속에서 상향링크 전송용량 증대를 위한 주파수 효율성 제고 기술의 필요성이 대두되고 있다. 본 논문에서는 차세대 양방향데이터방송을 위한 다중 모바일(mobile) 사용자의 클러스터(cluster) 기반 상향링크 협동 다이버시티(cooperative diversity) 기법을 제안한다. 제안된 기법은 하나의 단일 안테나(single antenna) 방송 기지국과 다수의 단일 안테나 모바일 사용자가 있는 상향링크 시분할다중접속 (TDMA: Time Division Multiple Access) 시스템에서 데이터 지연허용(delay-tolerant)에 따라 클러스터를 구성하고 제곱 다이버시티 차수(square diversity order)의 협동 프로토콜(cooperative protocol)을 통해 높은 공간다이버시티 이득(spatial diversity gain)을 얻는다. 또한, 비대칭(asymmetric) 무선 채널 환경에서 공정성(fairness)을 보장한다.
생산일정계획 수립 시스템을 통하여 수립된 생산계획을 현장에서 실천하고자 할 때, 일반적으로 계획수립 후 얼마 지나지 않아 계획수립시 고려할 수 없었던 기계고장 또는 자재조달 지연, 작업 지체, 주문 취소 등과 같은 요인으로 생산일정을 계획대로 실천할 수 없는 경우가 발생한다. 이런 상황에서는 기존의 생산계획을 계속 실행할 수 없으므로 손쉽게 대처할 수 있는 방안이 필요하다. 본 연구에서는 일정계획편집기를 이러한 문제점을 해결할 수 있는 대안으로 제시한다. 일정계획편집기를 GUI, 객체지향적 설계를 통해 구현하므로서 이상상황과 일정변동에 효과적으로 대처할 수 있다. GUI환경을 통해, 수립된 생산일정과 이상상황, 작업진척, 수행도 등을 화면에 Gantt 도표로 표시해 주어 현장 파악을 용이하게 하고 작업추가, 삭제, 작업시간 변경, 대체공정으로의 이동 등의 편집을 mouse와 icon을 이용, 편리하게 수행할 수 있다. 편집작업시 자동으로 생산일정의 타당성을 만족시켜 줄 수 있는 지능화를 위한 기초 단계로서 객체지향설계를 이용한 규칙기반 일정계획 편집기를 설계한다.
본 논문에서는 CMOS로 구현된 3.3V 8-bit 200MSPS의 Folding / Interpolation 구조의 A/D 변환기를 제안한다. 회로에 사용된 구조는 FR(Folding Rate)이 8, NFB(Number of Folding Block)가 4, Interpolation rate 이 8이며, 분산 Track and Hold 구조를 회로를 사용하여 Sampling시 입력주파수를 Hold하여 높은 SNDR을 얻을 수 있었다. 고속동작과 저 전력 기능을 위하여 향상된 래치와 디지털 Encoder를 제안하였고 지연시간 보정을 위한 회로도 제안하였다. 제안된 ADC는 0.35㎛, 2-Poly, 3-Metal, n-well CMOS 공정을 사용하여 제작되었으며, 유효 칩 면적은 1070㎛×650㎛ 이고, 3.3V전압에서 230mW의 전력소모를 나타내었다. 입력 주파수 10MHz, 샘플링 주파수 200MHz에서의 INL과 DNL은 ±1LSB 이내로 측정되었으며, SNDR은 43㏈로 측정되었다.
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[게시일 2004년 10월 1일]
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