• The Journal of Korean Institute of Communications and Information Sciences
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• v.18 no.5
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• pp.675-684
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• 1993

In this paper, we analyze a traffic control schemes at the interworking unit(IWU) of the IEEE 802.6 DQDB MAN and the B-ISDN, and estimate its performance via computer simulation. We also study traffic management, relaying sublayers for the cases of four service classes defined in the B-ISDN. As for performance criteria, we consider slot waiting time, slot loss rate, and the fairness between DQDB nodes in access networks. We propose a simple control algorithm that decreases the waitint delay at the OWU. With the buffer size of 40 [slots] at the IWU, we have found that the slot loss rate was nearly zero at traffic load below 0.9, and the slot waiting time became less than 15 slot times.

• Journal of Korean Society of Water and Wastewater
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• v.30 no.3
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• pp.321-325
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• 2016

The Pressure Retarded Osmosis (PRO) is the next generation desalination technique and is considered as a eco-friendly energy. This was conducted to evaluate the effect of the temperature and pressure on the PRO performance. The flux of the permeation was measured under different operating conditions and estimated the power density. An improvement of PRO performance is depend on increasing solution temperature and optimum pressure. The effect of increasing feed solution temperature has stronger impact on the PRO performance comparing to the draw solution temperature. The reason of the results was due to the change of osmotic power, viscosity, water permeability and structure parameter(s).

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.37 no.9
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• pp.78-85
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• 2000

A new analytical VLSI interconnect delay model is presented and its accuracy is experimentally verified. In the model, the transmission line parameter variations due to skin effect, proximity effect, and silicon substrate effect are taken into account. That is, the circuit model of the interconnect line that includes these effects is newly developed and analyzed. For the model verification, test patterns combined the coplanar structure with microstrip were designed by using 0.35${\mu}m$ CMOS process technology. It is shown that the accuracy of the model is less than about 10% error.

• Journal of IKEEE
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• v.27 no.3
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• pp.234-238
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• 2023

In this paper, we propose a time-to-digital converter (TDC) with compensation capability for PVT (process, voltage, and temperature) variations. A typical delay line-based TDC measures time based on the inverter's propagation delay, making it fundamentally sensitive to PVT variations. This paper presents a method to minimize the resolution change of TDC by compensating for the propagation delay caused by the PVT variations. Additionally, it dopts Cyclic Vernier TDC (CVTDC) structure to provide a wide input detection range. The proposed CVTDC with PVT compensation function is designed using a 45nm CMOS process, consumes 8mW of power, offers a TDC resolution of 5 ps, and has an input detection range of about 5.1 ns.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.38 no.5
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• pp.323-328
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• 2001

A new time-to-digital converter is proposed which is based on a capacitor and a counter. The conventional time-to-digital converter requires rather longer processing time than the input time interval to obtain an accurate digital output. The resolution of the converted digital output is constant independent on the input time interval. However this study proposes the circuit in which the converted digital output can be obtained without delay time, and both the input time interval and the resolution can be easily improved through controlling passive device parameters.

• Journal of the Korea Academia-Industrial cooperation Society
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• v.6 no.6
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• pp.513-520
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• 2005

High-speed Portable Internet system provides 1-3 Mbps data transmission speed to terminals moving up to 60 km/sec. Since High-speed Portable Internet system supports services requiring different QoS, it needs an efficient scheduling method based on those different QoSs. This paper shows the performance comparisons of several different packet scheduling schemes for minimizing the mean delay over the downlink of High-speed Portable Internet system to support the packet data service. Simulation results show that proposed scheme superior to other schemes at side throughput and data loss rate.

• Proceedings of the KAIS Fall Conference
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• 2007.05a
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• pp.143-146
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• 2007

컴퓨터 네트워크에서 전송제어 프로토콜 상에서 다중시간 간격으로 혼잡제어의 지연을 피드백 루프의 시간간격을 조정하여 명시적 예측을 실행해 제어의 단점을 개선하는데 연구한다. 먼저 TCP의 모둘 형 확장에서 Tahoe, Reno, Vegas등 다양한 버전의 TCP에 적용되는 간단한 인터페이스를 통한 함수 호출을 정의하고, 이것이 성능을 크게 향상시는 것을 입증한다. 두 번째로, 광대역 WAN에서 지연-대역폭의 곱이 높을 경우 더욱 심각해지는 사후 제어의 불확실성 차이를 해소함으로써 MTS TCP가 기반 피드백 제어에 사전성을 부여한다는 것을 입증한다. 세번째는 트래픽 제어의 3가지 차원인, 즉 추적 능력, 연결 지속 기간, 공정성이 성능에 미치는 영향 등을 비교 분석하여 입증한다.

• Proceedings of the KIEE Conference
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• 2005.07d
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• pp.2525-2527
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• 2005

큰 지연시간을 갖는 고차계 시스템에 대하여 일반적으로 적용할 수 있는 PID 제어기의 동조방법중 한 가지 방법으로써 축소모델을 이용하는 방법이 있다. 이 방법은 큰 지연시간을 갖는 고차계 공정을 SOPTD(Second Order Plus Time Delay Model)로 축소를 하여 SOPTD의 고정된 형태의 모델에 대하여 PID 제어기를 동조하는 방법이다. SOPTD로 모델을 축소하는 방법과 최적화 PID 파라미터를 동조하는 방법이 제시되었다. 본 논문에서는 기존의 최적화 PID 제어구조에 RLSE를 추가하여 실시간으로 축소모델의 계수를 보정해주는 최적화 적응형 PID 제어구조를 제안하였고, 기존의 제어구조보다 우수한 적응성을 가짐을 시뮬레이션을 통하여 보였다.

• Proceedings of the Korea Information Processing Society Conference
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• 2003.05b
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• pp.1465-1468
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• 2003

본 연구는 실시간 서비스 트래픽, 즉 보장형 서비스를 위한 스케줄링 알고리즘들에 대한 성능 분석에 대한 연구이다. 특히 실시간 데이터 전송의 경우, 작은 지연 시간을 요구하면서 안정된 QoS를 요구하고 있다. 기존에 알려진 FQ, WFQ, WF2Q, Virtual Clock 스케줄링 알고리즘들을 사용해서 대기류의 수학적 모델이 아닌 시뮬레이션 도구를 사용하여, 지연에 민감한 보장형 서비스 트래픽에 대한 시간 복잡도, 공정성, 처리율 측면으로 성능을 분석하였다.

• Proceedings of the Korea Information Processing Society Conference
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• 2007.05a
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• pp.155-159
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• 2007

S/W 개발 프로젝트의 품질, 비용, 개발 기간을 잘 관리하여 프로젝트를 성공시키기 위해 PM 은 프로젝트의 종료시점과 예산의 초과를 예측할 수 있어야 한다. PMBOK 의 비용관리의 Earned Value Method 는 프로젝트의 진행에 따른 생산성의 변화와 그에 따른 비용과 일정의 증가 추정에 대한 규칙을 제시한다. 그러나 EVM 은 제조공정에서는 그 효과를 증명하였지만, S/W 프로젝트에서는 적용이 힘들어 잘 활용되고 있지 않다. 이는 사람이 주요 자원인 S/W 프로젝트에서는 Actual Cost 의 측정이 쉽지 않기 때문이다. 따라서 본 논문에서는 S/W 프로젝트 관리에서 Earned Value 의 측정이 쉽지 않아 추정되기 힘든 지연된 종료 시점에 대한 예측을 PMBOK 과 CMMI 에서 제시하는 관리 영역과의 연관성을 활용하고, EVM 을 보완하여 지연에 대한 예측모델을 만들어보고자 한다.