• Proceedings of the Korean Information Science Society Conference
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• 1998.10c
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• pp.647-649
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• 1998

본 논문에서는 다각 근사화 방법과 래스터 기반 연산 알고리즘을 이용하여 평면 지도상에 나타난 등고선을 3차원 가시화(Visualization)하여 보여준다. 다각 근사화 방법은 입력한 등고선에 대한 특징을 반영할 수 있는 최소한의 선형구분 오차 임계값을 이용하여 등고선에 근사화 시킨 것으로 저장 데이터의 양을 축소할 수 있다. 래스터 기반 알고리즘은 이웃한 두 개의 등고선 내부점의 높이 값을 그 점에서 두 등고선까지의 최단거리 및 등고선의 높이값을 변수로 하는 선형보간식으로 정의하고, 거리변환 연산을 도입하여 계산하는 알고리즘으로 구현이 용이하며, 간단한 계산만을 수행하기 때문에 처리 방법이 간단하다는 장점을 갖는다. 본 논문에서는 래스터 방법만을 이용한 복원보다 자료의 양이 감소함을 보였고, 전체 처리과정의 간단함과, 3차원 가시화된 등고선을 그래프 좌표상의 X, Y, Z축으로 원하는 각도만큼씩 회전시키며 관찰 할 수 있도록 하였다. 본 연구를 통해 지형의 특징을 원형 등고선과 유사하게 유지하면서, 데이터 양을 축소하고 계산식을 간략화된 효과적인 지형정보 시각화를 보여주었다.

• Journal of Internet Computing and Services
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• v.16 no.3
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• pp.33-41
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• 2015

In this paper, the simplification procedure of Karnaugh Map, which is essential to design digital logic circuits, was implemented as web-based educational Java applets. The learners will be able to experience interesting learning process by executing the proposed Java applets. In addition, since the proposed Java applets were designed to contain educational technologies by step-by-step procedure, the maximization of learning efficiency can be obtained. The learners can make virtual experiments on the simplification of digital logic circuits by clicking on some buttons or filling out some text fields. Furthermore, the Boolean expression and its schematic diagram occurred in the simplification process will be displayed on the separate frame so that the learners can learn effectively. The schematic diagram enables them to check out if the logic circuit is correctly connected or not. Finally, since the simplification algorithm used in the proposed Java applet is based on the modified Quine-McCluskey minimization technique, the proposed Java applets will show more encouraging result in view of learning efficiency if it is used as assistants of the on-campus offline class.

• The Magazine of the Society of Air-Conditioning and Refrigerating Engineers of Korea
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• v.29 no.8
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• pp.17-22
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• 2000

LCA의 필요성을 그린빌딩과 연계하여 설명하고 LCA의 정의 및 건물 라이프사이클 평가를 위한 입·출력 목록 작성에 대하여 간략하게 서술하였다.

• 전기의세계
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• v.37 no.10
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• pp.11-17
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• 1988

본 고에서는 주변여건의 변화와 필요에 따라 날로 증가하고 있는 지중송전설비의 내외실태 및 연구 동향과 연구개발 필요항목등을 간략하게 소개함으로써 이 분야에 관심이 있는 회원제위의 이해를 돕고자 한다.

• Bulletin of Food Technology
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• v.10 no.3
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• pp.114-119
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• 1997

필자는 1997년 9월 3일부터 11일까지 호주에 있는 접종균 스타터 연구센터(Australian Starter Culture Research Center)와 CSIRO(Commonwealth Scientific & Industrial Research Organization)연구소 및 New South Wales 대학을 방문하여, 현재 수행중인 "전통발효 식품의 미생물자원 발굴 및 보존연구"과제와 관련 호주에서 실시되고 있는 농어민에의 접종균 보급시스템을 조사 하였고, 발효식품에 대한 연구현황 조사를 한 후 호주 식음료 박람회(Fine Food'97) 참관하고 왔기에 수집된 자료들을 중심으로 간략하게 이들 연구소와 박람회를 소개하고자 한다.

• Transactions of the Korean Society of Mechanical Engineers
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• v.6 no.3
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• pp.289-299
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• 1982

동적운동 기구의 연결부분에 간극이 존재함으로 인해 발생하는 충격현상을 평면운동기구를 모델 로 하여 운동 역학적으로 해석하였다. 비정상 상태의 Reynolds 방정식을 적용하여 과도상태 및 정상 상태에 있어서 동하중과 유막 두께와의 관계를 압착 유막효과(squeeze film effect)에 중점을 두어 조사하였으며 탄성 변형을 고려하여 유도한 유막두께식과 Reynolds 방정식의 수치적분으로 는 무차원식으로 변형하여 Grubin의 간략해법을 이용하였다.

• Information and Communications Magazine
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• v.28 no.6
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• pp.21-30
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• 2011

본고에서는 안경식 3DTV가 가지고 있는 안경착용의 불편함을 해결할 수 있는 무안경 3DTV 개발을 위한 다시점 3D 영상 기술에 대해 기술한다. 다시점 3DTV 서비스를 위해서는 다시점 3D 영상 획득, 부호화 기술, 재현 및 디스플레이 기술 등의 개발이 필요하며, 본 고에서는 이들 기술에 대해 간략하게 소개하기로 한다.

• Proceedings of the Korean Society for Rock Mechanics Conference
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• 1995.03a
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• pp.181-185
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• 1995

현재 구미에서 터널의 설계에는 RMR, Q와 같은 암반분류 기법과 경계요소 해석법과 같은 간략한 탄성 프로그램에 경험적 파괴조건식을 적용하여 이완대를 계산하고 터널의 지보량을 추정하는 방식이 널리 적용되고 있다. RMR이나 Q와 같은 암반분류법은 지하공동의 안정성에 영향을 미치는 중요한 지질 요인들에 근거하여 암반을 몇가지 등급으로 분류하고 지보방법을 결정하는 분류 방식으로 가장 많이 사용되고 있으나 각 항목의 평가방식이 경험적인 판단을 요하게 되어 주관적인 오류에 빠질 가능성이 많고, 또 여러 가지 대체 수단이 있어 종합적인 판단을 얻기가 용이하지가 않다. (중략)

• Bulletin of the Society of Naval Architects of Korea
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• v.32 no.3
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• pp.12-18
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• 1995

본 고에서는 중소형 선박의 초기설계시 필요로 하는 종합적인 저한추진성능 추정 프로그램을 다루고자 한다. 국내의 중소형 선박 설계자들이 많이 사용하고 있는 도표 및 회귀식을 선종별로 고루 모아서 손쉽게 사용할 수 있도록 전산화하였다. 이 프로그램에는 저항추진계수의 추정, 프로펠러의 간략한 설계 및 단독효율 추정, 전달동력과 회전수의 추정이 포함되어 있다.

• Journal of the Korea Academia-Industrial cooperation Society
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• v.15 no.9
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• pp.5744-5749
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• 2014

An extraction technique for a common logic expression is an extremely important part of multiple-output logic synthesis. This paper presents a new Boolean extraction technique using an exclusive-OR logic synthesis principle. The logic circuits produced only have AND, OR and NOT gates. Heuristic methods can also be applied to reduce the execution time and the number of literals. The experimental results showed improvements in the literal counts over the previous methods.