그림 1. 트랜지스터 게이트 전압에 따른 기본 주파수와 2차 고조파 전류의 변화 Fig. 1. Change of fundamental frequency and second harmonic current according to transistor gate voltage
그림 2. W-대역 공통-소스 3단 주파수 8체배기 회로도 Fig. 2. Schematic of W-band common-source 3-stage frequency octupler
그림 4. 중간 증폭기를 이용한 불요파 억제 Fig. 4. Suppression of unwanted harmonics by using the buffer amplifiers
그림 3. 체배기 각 단의 출력 파워 최적화 Fig. 3. Output power optimization for each multiplying stage
그림 6. 입력(상)과 출력(하) 정합 특성 그래프 Fig. 6. Input and output matching of designed multiplier
그림 5. 제작된 주파수 8체배기 칩 사진 ( 3.2 × 1.2 mm2) Fig. 5. Microphotograph of designed frequency multiplier
그림 7. 주파수 대비 출력 전력(상)과 입력 대비 83 GHz 출력 전력(하) Fig. 7. Measured output power relative to frequency and 10.375 GHz input power
그림 8. 전 주파수 대역에의 출력 전력 스펙트럼 Fig. 8. Measured output power spectrum
표 1. 기존 주파수 체배기와의 비교표 Table 1. Comparison with the other frequency multipliers
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