하드웨어 복잡도를 줄이기 위한 RDO내 DCT 공유구조의 HEVC 화면내 예측부호화기

An HEVC intra encoder sharing DCT with RDO for a low complex hardware

  • 이석호 (한국전자통신연구원, 시스템반도체연구부, 멀티미디어프로세서연구실) ;
  • 장준영 (한국전자통신연구원, 시스템반도체연구부, 멀티미디어프로세서연구실) ;
  • 변경진 (한국전자통신연구원, 시스템반도체연구부, 멀티미디어프로세서연구실) ;
  • 엄낙웅 (한국전자통신연구원, 시스템반도체연구부, 멀티미디어프로세서연구실)
  • 투고 : 2014.11.18
  • 심사 : 2014.12.22
  • 발행 : 2014.12.31

초록

HEVC 차세대 비디오 압축 표준은 ITU-TSG16 WP와 ISO/IEC JTC1/SC29, WG 11 두 단체 공동으로 2013년 표준화가 완료되었으며 기존 H.264 하이프로파일과 비교하여 압축효율은 두배 정도이다. HEVC에서 화면내 예측 (intra prediction) 모드는 planar와 DC 모드를 포함한 35개의 방향성 모드가 있으나 모든 모드를 적용한 부호화기를 구현하기 위해서는 하드웨어 복잡도가 증가하며 각 코딩유닛(coding unit) 사이즈에 따라 정확한 모드예측을 위한 RDO (rate distortion optimization) 계산에 필요한 DCT 사이즈도 증가하였기 때문에 본 논문에서는 하드웨어 사이즈를 줄이기 위하여 양자화를 위한 DCT와 SSE 계산을 위한 RDO 블럭내 DCT를 공유하는 화면내 예측부호기를 제안한다. 성능은 HEVC 참조소프트웨어인 HM-13.0과 비교하여 BD-rate는 평균 20% 증가하며 부호화시간은 4배 이상 단축되어 300MHz에서 FHD ($1920{\times}1080p$) 영상의 초당 60 프레임 실시간 부호화가 가능하다.

HEVC is the latest joint video coding standard with ITU-T SG16 WP and ISO/IEC JTC1/SC29/WG11. Its coding efficiency is about two times compared to H.264 high profile. Intra prediction has 35 directional modes including dc and planer. However an accurate mode decision on lots of modes with SSE is too costly to implement it with hardware. The key idea of this paper is a DCT shared architecture to reduce the complexity of HEVC intra encoder. It is to use same DCT block to quantize as well as to calculate SSE in RDO. The proposed intra encoder uses two step mode decision to lighten complexity with simplified RDO blocks and shares the transform resources. Its BD-rate increase is negligible at 20% on hardware aspect and the operating clock frequency is 300MHz@60fps on FHD ($1920{\times}1080$) image.

키워드

참고문헌

  1. ISO/IEC 23008-2 and ITU-T H.265, "High Efficiency Video Coding (HEVC)," Apr. 2013.
  2. 안용조, 황태진, 유성은,한우진, 심동규, "HEVC 부호화기 소프트웨어 통계적 특성 및 복잡도 분석," 방송공학회논문지 제17권 6호, pp. 1091-1105, Nov. 2012.
  3. L. M. Po and K. Guo, "Transform- domain fast sum of the squared difference computation for H.264/AVC rate- distortion optimization," IEEE Trans. Circuits Sys. Video Technol., vol. 17, no.6, pp. 765-773, Jun. 2007. https://doi.org/10.1109/TCSVT.2007.896663
  4. L. Liu and X. Zhung, "Cabac based bit estimation for fast H.264 RD optimization decision," In Proc. IEEE Int. Conf. on Consumer Communication and Networking, pp. 1- 5, Jan. 2009.
  5. JCT- VC, "High Efficiency Video Coding (HEVC) Test Model 13 (HM 13) Encoder Description," JCTVC O1002, Oct. 2013.
  6. JCT-VC, "HM Software Manual (HM 13)," Apr. 20l4.
  7. JCT-VC, "Common test conditions and software reference configurations," JCTVC L1110, Jan. 2013.