DOI QR코드

DOI QR Code

Low Power Level-Up/Down Shifter with Single Supply for the SoC with Multiple Supply

다중전원 SoC용 저전력 단일전원 Level-Up/Down Shifter

  • 우영미 (충북대학교 정보통신공학과) ;
  • 김두환 (충북대학교 정보통신공학과) ;
  • 조경록 (충북대학교 정보통신공학과)
  • Published : 2008.03.31

Abstract

We propose a low power level-up/down shifter with single supply that can be used at SoC with multiple supply. The proposed circuit interfaces IPs which are operated on the different supply voltages. The circuit is designed with a single supply that decreases the low power consumption and the complexity of supply routing and layout. The proposed circuit operated at 500MHz for level-up and at 1GHz for level-down. The level-up/down shifter improves noise immunity of the system at I/O circuit. The circuit is evaluated for 1.8V, 2.5V, 3.3V supply with 0.18um CMOS technology, respectively.

본 논문은 다중전원공급 SoC(System-on-Chip)에 사용될 저전력 단일전원 level-up/down shifter를 제안한다. 제안된 회로는 다양한 전원을 사용하는 IP간의 신호의 인터페이스 회로로 사용할 수 있으며, 단일전원을 사용함으로써 저전력으로 동작하고 시스템의 전원배선과 레이아웃의 복잡도 및 지연시간이 감소하는 장점을 가지고 있다. 제안된 level-up/down shifter는 각각 IP간에 신호들이 level-up 일 때는 500MHz 입력 주파수에서 동작하고 level-down일 때는 1GHz에서 동작하도록 설계했다. I/O 회로에 level-up/down shifter를 사용하면 시스템간의 신호를 연결할 때 잡음에 강하다는 사실도 검증했다. 시뮬레이션 결과는 0.18um CMOS 공정에서 각각 1.8V, 2.5V, 3.3V의 전원을 사용하여 검증했다.

Keywords

References

  1. S.T. Shied, J.S. Wang "Design of low-power domino circuits using multiple supply voltages", in Proc. IEEE Int. conf. on Electronics, pp.711-714, 2001. https://doi.org/10.1109/ICECS.2001.957574
  2. J.M. Chang, "Energy minimization using multiple supply voltage", IEEE Trans. on VLSI Systems, vol.5, pp.436-443, 1997. https://doi.org/10.1109/92.645070
  3. C.Q. Tran, H. Kawaguchi, and T. Sakurai, " Low-power high-speed level shifter design for block-level dynamic voltage scaling enviro -nment", in Proc. ICICDT, pp.229-232, 2005. https://doi.org/10.1109/ICICDT.2005.1502637
  4. Q.A. Khan, S.K. Wadhwa, and K. Misri, "Single supply level shifter for multi-voltage systems", in Proc. ICVLSID, 2006. https://doi.org/10.1109/VLSID.2006.24
  5. J.H. Lim, J.C. Ha, W.Y. Jung, Y.J. Kim, and J.K. Wee "A novel high-speed and low-voltage CMOS level-up/down shifter design for multiple-clock domain chips", IEICE Trans. on Electron, vol.E90-C, pp.644-648, 2007. https://doi.org/10.1093/ietele/e90-c.3.644