Circuit Design of Frquency Hopping Wireless LAN PLCP Sublayer

주파수 호핑방식 무선 LAN의 PLCP 계층 회로 설계

  • 최해욱 (한국정보통신대학원대학교) ;
  • 김경수 (한국전자통신연구원 회로소자연구소) ;
  • 기장근 (공주대학교 전자공학과) ;
  • 조현묵 (공주대학교 전자공학과)
  • Published : 1998.08.01

Abstract

In this paper, hardware circuit that performs functions of IEEE 802.11 wireless LAN frequency hopping PLCP protocol is designed using 0.8 um CMOS cmn8a technology of the COMPASS. Transmission rate of the designed hardware is 1Mbps. The designed circuit have about 6300 gates and $2.5{\times}2.5mm^2$ area. In order to verify the circuit, two PLCP circuits are interconnected and frames are transmitted from one PLCP circuit to the other PLCP circuit. As a results of the simulation, we conclude that the designed PLCP circuit works well as the IEEE 802.11 standard specification.

본 논문은 IEEE 802.11 주파수 호핑방식 무선 LAN 규격에 적합한 프로토콜 프로세서 설계 연구의 일환으로, 물리계층의 PLCP(Physical Layer Convergence Protocol) 프로토콜 기능을 하드웨어로 설계하였다. 설계 환경으로는 UNIX 환경하에서 COMPASS 틀을 사용하였으며, $0.8\mu\textrm{m}$ CMOS 공정인 cmn8a technology를 이용하였다. 결과적으로 사용된 전체 게이트 수는 약 6300 게이트 정도이며, 전체 칩 면적은 약 $2.5{\times}2.5mm^2$ 정도이다. 개발된 PLCP 부계층 회로는 IEEE 802.11 무선 LAN 주파수 호핑방식 규격에서 규정한 내용을 만족시키도록 설계되었으며, 전송속도는 1Mbps를 갖는다. 설계된 회로의 기능 검증을 위해 COMPASS 틀 상에서 2개의 PLCP 칩을 상호 연결한 회로를 구성하고 시뮬레이션을 통해 데이터를 송수신 하도록 함으로써 모든 기능이 정상적으로 동작함을 확인하였다.

Keywords

References

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